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SN74AXC2T245 正在供货 Dual-bit, 2-DIR pin dual-supply bus transceiver w/ configurable voltage translation, 3-state output Pin-to-pin upgrade with a wider voltage range and improved performance
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产品详细信息

参数

Technology Family AVC Applications JTAG Bits (#) 2 High input voltage (Min) (Vih) 0.78 High input voltage (Max) (Vih) 3.6 Output voltage (Min) (V) 1.2 Output voltage (Max) (V) 3.6 IOH (Max) (mA) -12 IOL (Max) (mA) 12 Rating Catalog open-in-new 查找其它 方向控制型电压转换器

封装|引脚|尺寸

UQFN (RSW) 10 3 mm² 1.8 x 1.4 open-in-new 查找其它 方向控制型电压转换器

特性

  • Each Channel Has Independent Direction Control
  • Control Inputs VIH/VIL Levels Are Referenced to
    VCCA Voltage
  • Fully Configurable Dual-Rail Design Allows Each
    Port to Operate Over the Full 1.2 V to
    3.6 V Power-Supply Range
  • I/Os Are 4.6 V Tolerant
  • Ioff Supports Partial-Power-Down Mode Operation
  • VCC Isolation Feature - If Either VCC Input is at
    GND, Both Ports are in High-Impedance State
  • Typical Data Rates
    • 500 Mbps (1.8 V to 3.3 V Level-Shifting)
    • 320 Mbps (<1.8 V to 3.3 V Level-Shifting)
    • 320 Mbps (Translate to 2.5 V or 1.8 V)
    • 280 Mbps (Translate to 1.5 V)
    • 240 Mbps (Translate to 1.2 V)
  • Latch-Up Performance Exceeds 100 mA Per
    JESD 78, Class II
  • ESD Protection Exceeds JESD 22
    • 5000 V Human-Body Model (A114-A)
    • 200 V Machine Model (A115-A)
    • 1500 V Charged-Device Model (C101)
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描述

This dual-bit noninverting bus transceiver uses two separate configurable power-supply rails. The A port is designed to track VCCA. VCCA accepts any supply voltage from 1.2 V to 3.6 V. The B port is designed to track VCCB. VCCB accepts any supply voltage from 1.2 V to 3.6 V. This allows for universal low-voltage bidirectional translation between any of the 1.2 V, 1.5 V, 1.8 V, 2.5 V, and 3.3 V voltage nodes.

The SN74AVC2T245 is designed for asynchronous communication between two data buses. The logic levels of the direction-control (DIR) input and the output-enable (OE) activate either the B-port outputs or the A-port outputs or place both output ports into the high-impedance mode . The device transmits data from the A bus to the B bus when the B-port outputs are activated and from the B bus to the A bus when the A-port outputs are activated. The input circuitry on both A and B ports always is active and must have a logic HIGH or LOW level applied to prevent excess ICC and ICCZ.

The SN74AVC2T245 control pins (DIR1, DIR2, and OE) are supplied by VCCA.

This device is fully specified for partial-power-down applications using Ioff. The Ioff circuitry disables the outputs, preventing damaging current backflow through the device when it is powered down.

The VCC isolation feature ensures that if either VCC input is at GND, both ports are in the high-impedance state.

To ensure the high-impedance state during power up or power down, OE must be connected to VCC through a pull-up resistor; the minimum value of the resistor is determined by the current-sinking capability of the driver.

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技术文档

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类型 标题 下载最新的英文版本 日期
* 数据表 SN74AVC2T245 Dual-Bit Dual-Supply Bus Transceiver with Configurable Level-Shifting / Voltage Translation and Tri-State Outputs 数据表 2016年 2月 22日
选择指南 Voltage translation buying guide 2019年 6月 13日
用户指南 SN74AXC2T-SMALLPKGEVM Evaluation module user's guide 2019年 6月 4日
选择指南 Logic Guide 2017年 6月 12日
应用手册 Understanding and Interpreting Standard-Logic Data Sheets 2015年 12月 2日
应用手册 Voltage Translation Between 3.3-V, 2.5-V, 1.8-V, and 1.5-V Logic Standards 2015年 4月 30日
选择指南 逻辑器件指南 2014 (Rev. AA) 下载最新的英文版本 (Rev.AB) 2014年 11月 17日
用户指南 LOGIC Pocket Data Book 2007年 1月 16日
应用手册 选择正确的电平转换解决方案 (Rev. A) 下载英文版本 (Rev.A) 2006年 3月 23日
应用手册 Semiconductor Packing Material Electrostatic Discharge (ESD) Protection 2004年 7月 8日
应用手册 Voltage Translation Between 3.3-V, 2.5-V, 1.8-V, and 1.5-V Logic Standards 2004年 7月 8日
更多文献资料 Logic Cross-Reference 2003年 10月 7日
更多文献资料 LCD Module Interface Application Clip 2003年 5月 9日
用户指南 AVC Advanced Very-Low-Voltage CMOS Logic Data Book, March 2000 2002年 8月 20日
更多文献资料 Standard Linear & Logic for PCs, Servers & Motherboards 2002年 6月 13日
应用手册 16-Bit Widebus Logic Families in 56-Ball, 0.65-mm Pitch Very Thin Fine-Pitch BGA 2002年 5月 22日
应用手册 Dynamic Output Control (DOC) Circuitry Technology And Applications 1999年 7月 7日
应用手册 AVC Logic Family Technology and Applications 1998年 8月 26日

设计与开发

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硬件开发

评估板 下载
AXC2T-SMALLPKGEVM
AXC2T-SMALLPKGEVM
document-generic 用户指南
20
说明
This EVM is designed to support DTM and RSW packages for the AXC and LVC family of DIR controlled bidirectional devices. The AXC and AVC devices belong to the low voltage direction controlled translation family with operating voltage from 0.65V to 3.6V (AXC) and 1.2 to 3.6 (AVC) with 12mA of drive (...)
特性
  • Pre-populated with the SN74AXC2T45DTM package
  • Demonstrates the small package technology of TI 
  • Ground port for each header pin supports high speed measurement
  • DIR pin; have the option of 10K ohm resistor pullup or pulldown
开发套件 下载
document-generic 用户指南
699
说明

K2G 评估模块 (EVM) 可以让开发人员直接开始评估 66AK2Gx 处理器,并加速音频、工业电机控制、智能电网保护和其他高可靠性实时计算密集型应用的开发。66AK2Gx 与基于 KeyStone 的现有 SoC 器件类似,可以让 DSP 和 ARM 内核控制系统中的所有内存和外设。此架构有助于最大限度地提高软件灵活性,并可以在其中实现以 DSP 或 ARM 为中心的系统设计。

无论是 Linux® 还是 TI-RTOS 操作系统,处理器 SDK 均支持此 EVM,而且此 EVM 采用 USB、PCIe 和千兆位以太网等主要外设。它包括板管理控制器、SD 卡槽和板载 XDS200 仿真器,便于进行软件评估和调试。对于音频应用,K2G EVM 还互连到可选的配套音频子卡 (AUDK2G)。

特性
  • 以 600MHz 运行的 66AK2G02 C66x DSP+ARM A15 处理器
  • 带 ECC 的 2GB DDR3L
  • TPS659118 PMIC
  • 音频和串行扩展头
  • 处理器 SDK Linux 和 TI-RTOS 支持
  • 支持千兆位以太网
开发套件 下载
document-generic 用户指南 document-generic 下载英文版本 (Rev.B)
699
说明

EVMK2GX(也称为“K2G”)1GHz 评估模块 (EVM) 可以让开发人员迅速开始评估 66AK2Gx 处理器系列,并加速音频、工业电机控制、智能电网保护和其他高可靠性实时计算密集型应用的开发。  66AK2Gx 与基于 KeyStone 的现有 SoC (...)

特性
  • 以 1GHz 运行的 66AK2G12 C66x DSP+ARM A15 处理器
  • 带 ECC 的 2GB DDR3L
  • TPS65911A PMIC
  • 音频和串行扩展头
  • 处理器 SDK Linux 和 TI-RTOS 支持
开发套件 下载
document-generic 用户指南 document-generic 下载英文版本 (Rev.B)
1049
说明

K2G 1GHz 高安全性评估模块 (EVM) 可让开发人员开始对高安全性开发版本 66AK2Gx 处理器的编程进行评估和测试,并加快音频和工业实时应用的下一级安全引导产品开发。无论是 Linux 还是 TI-RTOS 操作系统,处理器 SDK 均支持此 EVM,而且此 EVM 可支持与 EVMK2GX 相同的特性和功能。

注意:请注意,该 EVM 需要获得购买批准以及对软件的访问权限。请使用“立即订购”表中的“申请”按钮提交请求。

特性
  • 以 1GHz 运行的 66AK2G12 C66x DSP+ARM A15 处理器
  • 带 ECC 的 2GB DDR3L
  • TPS65911A PMIC
  • 音频和串行扩展头
  • 处理器 SDK Linux 和 TI-RTOS 支持

设计工具和仿真

仿真模型 下载
SCEM532.ZIP (64 KB) - IBIS Model
仿真模型 下载
SCEM533.ZIP (102 KB) - HSpice Model

参考设计

参考设计 下载
EnDat 2.2 系统参考设计
TIDEP0050 TIDEP0050 TI 参考设计基于 HEIDENHAIN EnDat 2.2 标准实现了适用于位置或旋转编码器的 EnDat 2.2 主协议栈和硬件接口解决方案。此设计包含 EnDat 2.2 主协议栈、使用 RS485 收发器的半双工通信以及在 Sitara AM437x 工业开发套件上实施的线路端接。此设计经过完全测试,符合 HEIDENHAIN EnDat 2.2 标准。AM437x IDK 还可与 EnDat 位置反馈一起支持工业通信和电机驱动(如 AM437x 单芯片电机控制设计指南中所述)。
document-generic 原理图 document-generic 用户指南
参考设计 下载
采用 TLV320AIC3268 miniDSP 编解码器的超声波测距参考设计
TIDA-00403 TIDA-00403 参考设计使用针对超声测距解决方案的现成的 EVM,该解决方案使用 TLV320AIC3268 miniDSP 内的算法。通过将该设计与 TI 的 PurePath Studio 设计套件结合使用,只需点击鼠标即可设计出一个用户可配置的稳健的超声测距系统。用户可以修改超声波脉冲生成特性以及检测算法以适合工业和测量应用中的特定使用情况,从而让用户能解决其他固定功能传感器的限制,同时增加测量的可靠性。TLV320AIC3268 上的两个 GPIO 被自动触发,表明已发出并接收到超声波脉冲。通过利用主机 MCU 监测这些 GPIO 可以提取出飞行时间。
document-generic 原理图 document-generic 用户指南

CAD/CAE 符号

封装 引脚 下载
UQFN (RSW) 10 了解详情

订购与质量

支持与培训

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