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产品详细信息

参数

Technology Family AHC VCC (Min) (V) 2 VCC (Max) (V) 5.5 Channels (#) 1 IOL (Max) (mA) 8 IOH (Max) (mA) -8 ICC (Max) (uA) 10 Input type Standard CMOS Output type Push-Pull Features Balanced outputs, Very high speed (tpd 5-10ns), Over-voltage tolerant inputs Data rate (Mbps) 150 Rating Catalog open-in-new 查找其它 反向缓冲器/驱动器

封装|引脚|尺寸

SOT-23 (DBV) 5 5 mm² 2.9 x 1.6 SOT-23 (DBV) 5 5 mm² 2.926 x 1.626 SOT-5X3 (DRL) 5 3 mm² 1.6 x 1.6 SOT-SC70 (DCK) 5 4 mm² 2 x 2.1 open-in-new 查找其它 反向缓冲器/驱动器

特性

  • Operating Range 2 V to 5.5 V
  • Max tpd of 6.5 ns at 5 V
  • Low Power Consumption, 10-µA Max ICC
  • ±8-mA Output Drive at 5 V
  • Schmitt-Trigger Action at All Inputs Makes the
    Circuit Tolerant for Slower Input Rise and Fall
    Time
  • Latch-Up Performance Exceeds 250 mA Per
    JESD 17
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描述

The SN74AHC1G04 contains one inverter gate. The device performs the Boolean function Y = A.

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技术文档

= 特色
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类型 标题 下载最新的英文版本 发布
* 数据表 SN74AHC1G04 Single Inverter Gate 数据表 2016年 1月 22日
应用手册 How to Select Little Logic 2016年 7月 26日
应用手册 Implications of Slow or Floating CMOS Inputs 2016年 6月 23日
选择指南 逻辑器件指南 2014 (Rev. AA) 下载最新的英文版本 (Rev.AB) 2014年 11月 17日
选择指南 小尺寸逻辑器件指南 (Rev. E) 下载最新的英文版本 (Rev.G) 2012年 7月 16日
选择指南 逻辑器件指南 2009 (Rev. Z) 下载最新的英文版本 (Rev.AB) 2010年 7月 7日
解决方案指南 LOGIC Pocket Data Book 2007年 1月 16日
应用手册 选择正确的电平转换解决方案 (Rev. A) 下载英文版本 (Rev.A) 2006年 3月 23日
更多文献资料 Design Summary for WCSP Little Logic 2004年 11月 4日
应用手册 Semiconductor Packing Material Electrostatic Discharge (ESD) Protection 2004年 7月 8日
更多文献资料 Logic Cross-Reference 2003年 10月 7日
应用手册 Advanced High-Speed CMOS (AHC) Logic Family 2002年 12月 2日
应用手册 Texas Instruments Little Logic Application Report 2002年 11月 1日
应用手册 TI IBIS File Creation, Validation, and Distribution Processes 2002年 8月 29日
用户指南 AHC/AHCT Designer's Guide February 2000 2000年 2月 24日
应用手册 Benefits & Issues of Migrating 5-V and 3.3-V Logic to Lower-Voltage Supplies 1999年 9月 8日
更多文献资料 Military Advanced High-Speed CMOS Logic (AHC/AHCT) 1998年 4月 1日
更多文献资料 Military Advanced High-Speed CMOS Logic (AHC/AHCT) 1998年 4月 1日
应用手册 Migration From 3.3-V To 2.5-V Power Supplies For Logic Devices 1997年 12月 1日
应用手册 Bus-Interface Devices With Output-Damping Resistors Or Reduced-Drive Outputs 1997年 8月 1日
应用手册 CMOS Power Consumption and CPD Calculation 1997年 6月 1日
应用手册 Live Insertion 1996年 10月 1日

设计与开发

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硬件开发

评估板 下载
document-generic 用户指南
$10.00
说明
灵活的 EVM 设计用于支持具有 5 至 8 引脚数且采用 DCK、DCT、DCU、DRL 或 DBV 封装的任何器件。
特性
  • 电路板设计允许进行多功能性评估
  • 支持多种逻辑器件

设计工具和仿真

仿真模型 下载
SCLM003.ZIP (13 KB) - IBIS Model
仿真模型 下载
SCLM028.ZIP (6 KB) - IBIS Model
仿真模型 下载
SCLM029.ZIP (5 KB) - IBIS Model
仿真模型 下载
SCLM030.ZIP (6 KB) - IBIS Model
仿真模型 下载
SCLM031.ZIP (5 KB) - IBIS Model
仿真模型 下载
SCLM113.TSC (25 KB) - TINA-TI Reference Design
仿真模型 下载
SCLM114.ZIP (3 KB) - TINA-TI Spice Model
仿真模型 下载
SCLM274.ZIP (7 KB) - PSpice Model

参考设计

参考设计 下载
航天级 24A 负载点参考设计
TIDA-070005 这是一款 24A 直流/直流航空级电源硬件参考设计。

随着 FPGA 和 ASIC 技术的进步,核心电压要求越来越低,但电流需求却越来越大。最新的航空级 FPGA 和 ASICS 需要低电压和大电流来满足其核心功耗要求。这些大电流要求推动了对航空级直流/直流功率转换电路的需求。

document-generic 原理图 document-generic 用户指南 document-generic 下载英文版本 (Rev.A)
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适用于 24 位 ADC 的无变压器、双极隔离式电源参考设计
TIDA-01434 — 此隔离式 3.65mm 薄型参考设计采用 24 位 Δ-Σ 模数转换器 (ADC),可实现高度集成的双极性输入和高性能解决方案。现代模拟输入模块在不同的方面都需要高性能,例如以相同的空间大小提供更高的通道密度,因此同时也要求具有更低的功耗和更宽的工作温度范围。
document-generic 原理图 document-generic 用户指南 document-generic 下载英文版本 (Rev.A)
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用于消除高性能 DAQ 系统中的 EMI 影响的多轨电源参考设计
TIDA-01054 — TIDA-01054 参考设计采用 LM53635 降压转换器,可帮助消除 EMI 对高于 16 位的数据采集 (DAQ) 系统的性能降低影响。借助该降压转换器,设计人员可以将电源解决方案放置在靠近信号路径的位置,而不会产生不必要的 EMI 噪声降级,同时可以节省布板空间。该设计使用 20 位 1MSPS SAR ADC 支持 100.13dB 的系统 SNR 性能,这基本匹配使用外部电源时的 100.14dB SNR 性能。
document-generic 原理图 document-generic 用户指南 document-generic 下载英文版本 (Rev.A)
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用于高性能 DAQ 系统的 ADC 电压基准缓冲器优化参考设计
TIDA-01055 — 适用于高性能 DAQ 系统的 TIDA-01055 参考设计优化了 ADC 基准缓冲器,以提高 SNR 性能并降低功耗(使用 TI OPA837 高速运算放大器)。该器件用于复合缓冲器配置,与传统运算放大器相比,将功耗降低了 22%。具有集成缓冲器的电压基准源通常缺少在高通道数系统中实现最佳性能所需的驱动强度。该参考设计能够驱动多个 ADC 并实现 15.77 位的系统 ENOB(使用 18 位 2MSPS SAR ADC)。
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用于最大限度提高 20 位 ADC 的信号动态范围以实现真正 10Vpp 差分输入的参考设计
TIDA-01057 — This reference design is designed for high performance data acquisition(DAQ) systems to improve the dynamic range of 20 bit differential input ADCs. Many DAQ systems require the measurement capability at a wide FSR (Full Scale Range) in order to obtain sufficient signal dynamic range. Many earlier (...)
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用于在最大限度地减小 EMI 的同时优化供电效率的 20 位 1MSPS DAQ 参考设计
TIDA-01056 — 该适用于高性能数据采集 (DAQ) 系统的参考设计优化了功率级,以降低功耗并最大程度地减小开关稳压器的 EMI 影响(通过使用 LMS3635-Q1 降压转换器)。与 LM53635 降压转换器相比,该参考设计可在最轻负载电流下将效率提高 7.2%,从而实现 125.25dB 的 SFDR、99dB 的 SNR 和 16.1 的 ENOB。
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最大程度提升 SNR 和采样速率的 20 位、1MSPS 隔离器优化型数据采集参考设计
TIDA-01037 — TIDA-01037 是一款 20 位、1MSPS 隔离式模拟输入数据采集参考设计,使用两种不同隔离器器件,以最大限度地提高信号链 SNR 和采样率性能。对于需要低抖动的信号(例如 ADC 采样时钟),可使用 TI 的 ISO73xx 系列低抖动器件;而 TI 的高速 ISO78xx 系列器件则用于最大限度地提高数据采样率。通过结合这两种隔离器解决方案,可跨隔离边界最大限度地降低采样时钟抖动,使高频性能得到显著提高,并且可利用最大限度提高隔离器信号传输速率的方式提高数据吞吐量。通过使用 TI 的高级 ADC multiSPITM 和源同步功能,还可实现进一步改善。最后,说明了所有重要设计理论并展示了测量结果。
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优化 FPGA 利用率和自动测试设备数据吞吐量的参考设计
TIDA-01051 — TIDA-01051 参考设计用于演示极高通道数数据采集 (DAQ) 系统(如用在自动测试设备 (ATE) 中的系统)经过优化的通道密度、集成、功耗、时钟分配和信号链性能。利用串行器(如 TI DS90C383B)将多个同步采样 ADC 输出与几个 LVDS 线结合,可显著减少主机 FPGA 必须处理的引脚数量。因此,单个 FPGA 可处理的 DAQ 通道数量大幅增加,而且电路板布线的复杂性也大大降低。
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适用于 18 位 SAR 数据转换器的模拟前端优化型 DAQ 系统参考设计
TIDA-01050 — TIDA-01050 参考设计是为了改善通常与自动测试设备相关的集成、功耗、性能和时钟问题。该设计适用于任何 ATE 系统,但还是最适用于需要大量输入通道的系统。
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使用负电源输入改进满标量程 THD 的 ADC 驱动器参考设计
TIDA-01052 — TIDA-01052 参考设计旨在突显在模拟前端驱动器放大器上使用负电压轨而不是接地所致的系统性能提升。此概念与所有模拟前端有关,但此设计专门针对自动测试设备。
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CAD/CAE 符号

封装 引脚 下载
SC70 (DCK) 5 视图选项
SOT-23 (DBV) 5 视图选项
SOT-5X3 (DRL) 5 视图选项

订购与质量

支持与培训

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