ZHCSTG6B July   2023  – April 2025 TPS25984

PRODUCTION DATA  

  1.   1
  2. 1 特性
  3. 2 应用
  4. 3 说明
  5. 4 说明（续）
  6. 5 引脚配置和功能
  7. 6 规格
    1. 6.1 绝对最大额定值
    2. 6.2 ESD 等级
    3. 6.3 建议运行条件
    4. 6.4 热性能信息
    5. 6.5 电气特性
    6. 6.6 逻辑接口
    7. 6.7 时序要求
    8. 6.8 开关特性
    9. 6.9 典型特性
  8. 7 详细说明
    1. 7.1 概述
    2. 7.2 功能方框图
    3. 7.3 特性说明
      1. 7.3.1  欠压保护
      2. 7.3.2  插入延迟
      3. 7.3.3  过压保护
      4. 7.3.4  浪涌电流、过流和短路保护
        1. 7.3.4.1 压摆率 (dVdt) 和浪涌电流控制
          1. 7.3.4.1.1 启动超时
        2. 7.3.4.2 稳定状态过流保护（断路器）
        3. 7.3.4.3 启动期间的工作电流限制
        4. 7.3.4.4 短路保护
      5. 7.3.5  模拟负载电流监测器 (IMON)
      6. 7.3.6  模式选择 (MODE)
      7. 7.3.7  并联器件同步 (SWEN)
      8. 7.3.8  堆叠多个电子保险丝以使可扩展性不受限制
        1. 7.3.8.1 启动期间的电流平衡
      9. 7.3.9  模拟结温监测器 (TEMP)
      10. 7.3.10 过热保护
      11. 7.3.11 故障响应和指示 (FLT)
      12. 7.3.12 电源正常状态指示 (PG)
      13. 7.3.13 输出放电
      14. 7.3.14 FET 运行状况监测
      15. 7.3.15 单点故障缓解
        1. 7.3.15.1 IMON 引脚单点故障
        2. 7.3.15.2 ILIM 引脚单点故障
        3. 7.3.15.3 IREF 引脚单点故障
        4. 7.3.15.4 ITIMER 引脚单点故障
    4. 7.4 器件功能模式
  9. 8 应用和实施
    1. 8.1 应用信息
      1. 8.1.1 单器件独立运行
      2. 8.1.2 多个器件，并行连接
      3. 8.1.3 多个电子保险丝，与 PMBus 并行连接
      4. 8.1.4 采用外部微控制器的数字遥测
    2. 8.2 典型应用：数据中心服务器中的 12V、3.3kW 电源路径保护
      1. 8.2.1 应用
      2. 8.2.2 设计要求
      3. 8.2.3 详细设计过程
      4. 8.2.4 应用曲线
    3. 8.3 最佳设计实践
    4. 8.4 电源相关建议
      1. 8.4.1 瞬态保护
      2. 8.4.2 输出短路测量
    5. 8.5 布局
      1. 8.5.1 布局指南
      2. 8.5.2 布局示例
  10. 9 器件和文档支持
    1. 9.1 文档支持
      1. 9.1.1 相关文档
    2. 9.2 支持资源
    3. 9.3 商标
    4. 9.4 静电放电警告
    5. 9.5 术语表
  11. 10修订历史记录
  12. 11机械、封装和可订购信息

7.3.1 欠压保护

TPS25984x 会在 VDD 和 VIN 上实现欠压锁定，以防施加的电压变得过低，导致系统或器件无法正常运行。欠压锁定在 VDD 上的内部默认锁定阈值为 VUVP，在 VIN 上的默认锁定阈值为 VUVPIN。也可以通过 EN/UVLO 引脚上的 UVLO 比较器，从外部将欠压保护阈值调整为用户定义的值。图 7-1 和方程式 1 显示了如何使用电阻分压器设置给定电压电源的 UVLO 设定点。

TPS25984 可调节的欠压保护图 7-1 可调节的欠压保护
方程式 1. V I N U V = V U V L O R R 1 + R 2 R 2

EN/UVLO 引脚可实现双电平阈值。

  1. VEN > VUVLO(R)：器件完全导通。
  2. VSD(F) < VEN < VUVLO(F)：FET 以及大多数控制器电路均被关断，但一些关键偏置和数字电路除外。将 EN/UVLO 引脚保持在此状态的时间超过 tQOD 时，将激活输出放电功能。
  3. VEN < VSD(F)：器件内的所有有源电路均关断，并且不保留任何数字状态存储器。该引脚还会复位任何闭锁的故障。在这种情况下，器件的静态电流消耗非常小。