ZHCSGY3G January   2017  – January 2023 TMS320F280040-Q1 , TMS320F280040C-Q1 , TMS320F280041 , TMS320F280041-Q1 , TMS320F280041C , TMS320F280041C-Q1 , TMS320F280045 , TMS320F280048-Q1 , TMS320F280048C-Q1 , TMS320F280049 , TMS320F280049-Q1 , TMS320F280049C , TMS320F280049C-Q1

PRODUCTION DATA  

  1. 1 特性
  2. 2 应用
  3. 3 说明
    1. 3.1 功能方框图
  4. 4 修订历史记录
  5. 5 器件比较
    1. 5.1 相关产品
  6. 6 引脚配置和功能
    1. 6.1 引脚图
    2. 6.2 引脚属性
    3. 6.3 信号说明
      1. 6.3.1 模拟信号
      2. 6.3.2 数字信号
      3. 6.3.3 电源和接地
      4. 6.3.4 测试、JTAG 和复位
    4. 6.4 引脚多路复用
      1. 6.4.1 GPIO 多路复用引脚
      2. 6.4.2 ADC 引脚上的数字输入 (AIO)
      3. 6.4.3 GPIO 输入 X-BAR
      4. 6.4.4 GPIO 输出 X-BAR 和 ePWM X-BAR
    5. 6.5 带有内部上拉和下拉的引脚
    6. 6.6 未使用引脚的连接
  7. 7 规格
    1. 7.1  绝对最大额定值
    2. 7.2  ESD 等级 - 商用
    3. 7.3  ESD 等级 - 汽车
    4. 7.4  建议运行条件
    5. 7.5  功耗摘要
      1. 7.5.1 系统电流消耗（外部电源）
      2. 7.5.2 系统电流消耗（内部 VREG）
      3. 7.5.3 系统电流消耗（直流/直流稳压器）
      4. 7.5.4 工作模式测试说明
      5. 7.5.5 电流消耗图
      6. 7.5.6 减少电流消耗
        1. 7.5.6.1 每个禁用外设的典型 IDD 电流减少值（SYSCLK 为 100MHz 时）
    6. 7.6  电气特性
    7. 7.7  热阻特征
      1. 7.7.1 PZ 封装
      2. 7.7.2 PM 封装
      3. 7.7.3 RSH 封装
    8. 7.8  散热设计注意事项
    9. 7.9  系统
      1. 7.9.1 电源管理模块 (PMM)
        1. 7.9.1.1 引言
        2. 7.9.1.2 概述
          1. 7.9.1.2.1 电源轨监视器
            1. 7.9.1.2.1.1 I/O POR（上电复位）监视器
            2. 7.9.1.2.1.2 I/O BOR（欠压复位）监视器
            3. 7.9.1.2.1.3 VDD POR（上电复位）监视器
          2. 7.9.1.2.2 外部监控器使用情况
          3. 7.9.1.2.3 延迟块
          4. 7.9.1.2.4 内部 1.2V LDO 稳压器 (VREG)
          5. 7.9.1.2.5 VREGENZ
          6. 7.9.1.2.6 内部 1.2V 开关稳压器（直流/直流）
            1. 7.9.1.2.6.1 PCB 布局和元件指南
        3. 7.9.1.3 外部元件
          1. 7.9.1.3.1 去耦电容器
            1. 7.9.1.3.1.1 VDDIO 去耦
            2. 7.9.1.3.1.2 VDD 去耦
        4. 7.9.1.4 电源时序
          1. 7.9.1.4.1 电源引脚联动
          2. 7.9.1.4.2 信号引脚电源序列
          3. 7.9.1.4.3 电源引脚电源序列
            1. 7.9.1.4.3.1 外部 VREG/VDD 模式序列
            2. 7.9.1.4.3.2 内部 VREG/VDD 模式序列
            3. 7.9.1.4.3.3 电源时序摘要和违规影响
            4. 7.9.1.4.3.4 电源压摆率
        5. 7.9.1.5 电源管理模块电气数据和时序
          1. 7.9.1.5.1 电源管理模块运行条件
          2. 7.9.1.5.2 电源管理模块特征
          3.        电源电压
      2. 7.9.2 复位时序
        1. 7.9.2.1 复位源
        2. 7.9.2.2 复位电气数据和时序
          1. 7.9.2.2.1 复位 (XRSn) 时序要求
          2. 7.9.2.2.2 复位 (XRSn) 开关特性
          3. 7.9.2.2.3 复位时序图
      3. 7.9.3 时钟规格
        1. 7.9.3.1 时钟源
        2. 7.9.3.2 时钟频率、要求和特性
          1. 7.9.3.2.1 输入时钟频率和时序要求，PLL 锁定时间
            1. 7.9.3.2.1.1 输入时钟频率
            2. 7.9.3.2.1.2 XTAL 振荡器特征
            3. 7.9.3.2.1.3 X1 时序要求
            4. 7.9.3.2.1.4 PLL 锁定时间
          2. 7.9.3.2.2 内部时钟频率
            1. 7.9.3.2.2.1 内部时钟频率
          3. 7.9.3.2.3 输出时钟频率和开关特性
            1. 7.9.3.2.3.1 XCLKOUT 开关特性
        3. 7.9.3.3 输入时钟和 PLL
        4. 7.9.3.4 晶体 (XTAL) 振荡器
          1. 7.9.3.4.1 引言
          2. 7.9.3.4.2 概述
            1. 7.9.3.4.2.1 电子振荡器
              1. 7.9.3.4.2.1.1 运行模式
                1. 7.9.3.4.2.1.1.1 晶体的工作模式
                2. 7.9.3.4.2.1.1.2 单端工作模式
              2. 7.9.3.4.2.1.2 XCLKOUT 上的 XTAL 输出
            2. 7.9.3.4.2.2 石英晶体
            3. 7.9.3.4.2.3 GPIO 工作模式
          3. 7.9.3.4.3 正常运行
            1. 7.9.3.4.3.1 ESR – 有效串联电阻
            2. 7.9.3.4.3.2 Rneg - 负电阻
            3. 7.9.3.4.3.3 启动时间
            4. 7.9.3.4.3.4 DL – 驱动电平
          4. 7.9.3.4.4 如何选择晶体
          5. 7.9.3.4.5 测试
          6. 7.9.3.4.6 常见问题和调试提示
          7. 7.9.3.4.7 晶体振荡器规格
            1. 7.9.3.4.7.1 晶体振荡器参数
            2. 7.9.3.4.7.2 晶振等效串联电阻 (ESR) 要求
            3. 7.9.3.4.7.3 晶体振荡器电气特性
        5. 7.9.3.5 内部振荡器
          1. 7.9.3.5.1 INTOSC 特性
      4. 7.9.4 闪存参数
      5. 7.9.5 仿真/JTAG
        1. 7.9.5.1 JTAG 电气数据和时序
          1. 7.9.5.1.1 JTAG 时序要求
          2. 7.9.5.1.2 JTAG 开关特征
          3. 7.9.5.1.3 JTAG 时序图
        2. 7.9.5.2 cJTAG 电气数据和时序
          1. 7.9.5.2.1 cJTAG 时序要求
          2. 7.9.5.2.2 cJTAG 开关特性
          3. 7.9.5.2.3 cJTAG 时序图
      6. 7.9.6 GPIO 电气数据和时序
        1. 7.9.6.1 GPIO - 输出时序
          1. 7.9.6.1.1 通用输出开关特征
        2. 7.9.6.2 GPIO - 输入时序
          1. 7.9.6.2.1 通用输入时序要求
        3. 7.9.6.3 输入信号的采样窗口宽度
      7. 7.9.7 中断
        1. 7.9.7.1 外部中断 (XINT) 电气数据和时序
          1. 7.9.7.1.1 外部中断时序要求
          2. 7.9.7.1.2 外部中断开关特性
          3. 7.9.7.1.3 中断时序图
      8. 7.9.8 低功率模式
        1. 7.9.8.1 时钟门控低功耗模式
        2. 7.9.8.2 低功耗模式唤醒时序
          1. 7.9.8.2.1 空闲模式时序要求
          2. 7.9.8.2.2 空闲模式开关特性
          3. 7.9.8.2.3 空闲模式时序图
          4. 7.9.8.2.4 停机模式时序要求
          5. 7.9.8.2.5 停机模式开关特征
          6. 7.9.8.2.6 停机模式时序图
    10. 7.10 模拟外设
      1. 7.10.1 模数转换器 (ADC)
        1. 7.10.1.1 结果寄存器映射
        2. 7.10.1.2 ADC 可配置性
          1. 7.10.1.2.1 信号模式
        3. 7.10.1.3 ADC 电气数据和时序
          1. 7.10.1.3.1 ADC 运行条件
          2. 7.10.1.3.2 ADC 特性
          3. 7.10.1.3.3 ADC 输入模型
          4. 7.10.1.3.4 ADC 时序图
      2. 7.10.2 可编程增益放大器 (PGA)
        1. 7.10.2.1 PGA 电气数据和时序
          1. 7.10.2.1.1 PGA 运行条件
          2. 7.10.2.1.2 PGA 特征
          3. 7.10.2.1.3 PGA 典型特征图
      3. 7.10.3 温度传感器
        1. 7.10.3.1 温度传感器电气数据和时序
          1. 7.10.3.1.1 温度传感器特征
      4. 7.10.4 缓冲数模转换器 (DAC)
        1. 7.10.4.1 缓冲 DAC 电气数据和时序
          1. 7.10.4.1.1 缓冲 DAC 运行条件
          2. 7.10.4.1.2 缓冲 DAC 电气特性
          3. 7.10.4.1.3 缓冲 DAC 示意图
          4. 7.10.4.1.4 缓冲 DAC 典型特性图
      5. 7.10.5 比较器子系统 (CMPSS)
        1. 7.10.5.1 CMPSS 电气数据和时序
          1. 7.10.5.1.1 比较器电气特性
          2. 7.10.5.1.2 CMPSS DAC 静态电气特性
          3. 7.10.5.1.3 CMPSS 示意图
    11. 7.11 控制外设
      1. 7.11.1 增强型捕获 (eCAP)
        1. 7.11.1.1 eCAP 电气数据和时序
          1. 7.11.1.1.1 eCAP 时序要求
          2. 7.11.1.1.2 eCAP 开关特性
      2. 7.11.2 高分辨率捕捉子模块 (HRCAP6–HRCAP7)
        1. 7.11.2.1 HRCAP 电气数据和时序
          1. 7.11.2.1.1 HRCAP 开关特性
      3. 7.11.3 增强型脉宽调制器 (ePWM)
        1. 7.11.3.1 控制外设同步
        2. 7.11.3.2 ePWM 电气数据和时序
          1. 7.11.3.2.1 ePWM 时序要求
          2. 7.11.3.2.2 ePWM 开关特性
          3. 7.11.3.2.3 跳闸区输入时序
            1. 7.11.3.2.3.1 跳闸区域输入时序要求
        3. 7.11.3.3 外部 ADC 转换启动电气数据和时序
          1. 7.11.3.3.1 外部 ADC 转换启动开关特性
      4. 7.11.4 高分辨率脉宽调制器 (HRPWM)
        1. 7.11.4.1 HRPWM 电气数据和时序
          1. 7.11.4.1.1 高分辨率 PWM 特征
      5. 7.11.5 增强型正交编码器脉冲 (eQEP)
        1. 7.11.5.1 eQEP 电气数据和时序
          1. 7.11.5.1.1 eQEP 时序要求
          2. 7.11.5.1.2 eQEP 开关特性
      6. 7.11.6 Σ-Δ 滤波器模块 (SDFM)
        1. 7.11.6.1 SDFM 电气数据和时序
          1. 7.11.6.1.1 使用异步 GPIO (ASYNC) 选项时的 SDFM 时序要求
          2. 7.11.6.1.2 SDFM 时序图
        2. 7.11.6.2 SDFM 电气数据和时序（同步 GPIO）
          1. 7.11.6.2.1 使用同步 GPIO (SYNC) 选项时的 SDFM 时序要求
    12. 7.12 通信外设
      1. 7.12.1 控制器局域网 (CAN)
      2. 7.12.2 内部集成电路 (I2C)
        1. 7.12.2.1 I2C 电气数据和时序
          1. 7.12.2.1.1 I2C 时序要求
          2. 7.12.2.1.2 I2C 开关特征
          3. 7.12.2.1.3 I2C 时序图
      3. 7.12.3 电源管理总线 (PMBus) 接口
        1. 7.12.3.1 PMBus 电气数据和时序
          1. 7.12.3.1.1 PMBus 电气特性
          2. 7.12.3.1.2 PMBus 快速模式开关特性
          3. 7.12.3.1.3 PMBus 标准模式开关特性
      4. 7.12.4 串行通信接口 (SCI)
      5. 7.12.5 串行外设接口 (SPI)
        1. 7.12.5.1 SPI 电气数据和时序
          1. 7.12.5.1.1 非高速主模式时序
            1. 7.12.5.1.1.1 SPI 主模式开关特性（时钟相位 = 0）
            2. 7.12.5.1.1.2 SPI 主模式开关特性（时钟相位 = 1）
            3. 7.12.5.1.1.3 SPI 主模式时序要求
          2. 7.12.5.1.2 非高速从模式时序
            1. 7.12.5.1.2.1 SPI 从模式开关特性
            2. 7.12.5.1.2.2 SPI 从模式时序要求
          3. 7.12.5.1.3 高速主模式时序
            1. 7.12.5.1.3.1 SPI 高速主模式开关特性（时钟相位 = 0）
            2. 7.12.5.1.3.2 SPI 高速主模式开关特性（时钟相位 = 1）
            3. 7.12.5.1.3.3 SPI 高速主模式时序要求
          4. 7.12.5.1.4 高速从模式时序
            1. 7.12.5.1.4.1 SPI 高速从模式开关特性
            2. 7.12.5.1.4.2 SPI 高速从模式时序要求
      6. 7.12.6 本地互连网络 (LIN)
      7. 7.12.7 快速串行接口 (FSI)
        1. 7.12.7.1 FSI 变送器
          1. 7.12.7.1.1 FSITX 电气数据和时序
            1. 7.12.7.1.1.1 FSITX 开关特性
        2. 7.12.7.2 FSI 接收器
          1. 7.12.7.2.1 FSIRX 电气数据和时序
            1. 7.12.7.2.1.1 FSIRX 开关特性
            2. 7.12.7.2.1.2 FSIRX 时序要求
        3. 7.12.7.3 FSI SPI 兼容模式
          1. 7.12.7.3.1 FSITX SPI 信令模式电气数据和时序
            1. 7.12.7.3.1.1 FSITX SPI 信令模式开关特性
  8. 8 详细说明
    1. 8.1  概述
    2. 8.2  功能方框图
    3. 8.3  存储器
      1. 8.3.1 C28x 存储器映射
      2. 8.3.2 控制律加速器 (CLA) ROM 存储器映射
      3. 8.3.3 闪存映射
      4. 8.3.4 外设寄存器内存映射
      5. 8.3.5 存储器类型
        1. 8.3.5.1 专用 RAM (Mx RAM)
        2. 8.3.5.2 本地共享 RAM (LSx RAM)
        3. 8.3.5.3 全局共享 RAM (GSx RAM)
        4. 8.3.5.4 CLA 消息 RAM (CLA MSGRAM)
    4. 8.4  标识
    5. 8.5  总线架构 - 外设连接
    6. 8.6  C28x 处理器
      1. 8.6.1 嵌入式实时分析和诊断 (ERAD)
      2. 8.6.2 浮点单元 (FPU)
      3. 8.6.3 三角法数学单元 (TMU)
      4. 8.6.4 Viterbi、复杂数学和 CRC 单元 (VCU-I)
    7. 8.7  控制律加速器 (CLA)
    8. 8.8  直接存储器访问 (DMA)
    9. 8.9  引导 ROM 和外设引导
      1. 8.9.1 配置交替引导模式选择引脚
      2. 8.9.2 配置交替引导模式选项
      3. 8.9.3 GPIO 分配
    10. 8.10 双代码安全模块
    11. 8.11 看门狗
    12. 8.12 可配置逻辑块 (CLB)
    13. 8.13 功能安全
  9. 9 应用、实施和布局
    1. 9.1 器件主要特性
    2. 9.2 应用信息
      1. 9.2.1 典型应用
        1. 9.2.1.1 服务器电信电源单元 (PSU)
          1. 9.2.1.1.1 系统方框图
          2. 9.2.1.1.2 服务器和电信 PSU 资源
        2. 9.2.1.2 单相在线 UPS
          1. 9.2.1.2.1 系统方框图
          2. 9.2.1.2.2 单相在线 UPS 资源
        3. 9.2.1.3 微型光伏逆变器
          1. 9.2.1.3.1 系统方框图
          2. 9.2.1.3.2 微型光伏逆变器资源
        4. 9.2.1.4 电动汽车充电站电源模块
          1. 9.2.1.4.1 系统方框图
          2. 9.2.1.4.2 电动汽车充电站电源模块资源
        5. 9.2.1.5 伺服驱动器控制模块
          1. 9.2.1.5.1 系统方框图
          2. 9.2.1.5.2 伺服驱动器控制模块资源
  10. 10器件和文档支持
    1. 10.1 器件和开发支持工具命名规则
    2. 10.2 标识
    3. 10.3 工具和软件
    4. 10.4 文档支持
    5. 10.5 支持资源
    6. 10.6 商标
    7. 10.7 静电放电警告
    8. 10.8 术语表
  11. 11机械、封装和可订购信息
    1. 11.1 封装信息

6.3.1 模拟信号

表 6-2 模拟信号
信号名称说明引脚类型GPIO100 PZ64 PMQ64 PM56 RSH
A0ADC-A 输入 0I23151513
A1ADC-A 输入 1I22141412
A2ADC-A 输入 2I9998
A3ADC-A 输入 3I10
A4ADC-A 输入 4I36232321
A5ADC-A 输入 5I35
A6ADC-A 输入 6I666
A8ADC-A 输入 8I37
A9ADC-A 输入 9I38
A10ADC-A 输入 10I40252523
AIO224ADC 引脚上的数字输入 224I9998
AIO225ADC 引脚上的数字输入 225I36232321
AIO226ADC 引脚上的数字输入 226I7776
AIO227ADC 引脚上的数字输入 227I39242422
AIO228ADC 引脚上的数字输入 228I666
AIO229ADC 引脚上的数字输入 229I37
AIO230ADC 引脚上的数字输入 230I40252523
AIO231ADC 引脚上的数字输入 231I23151513
AIO232ADC 引脚上的数字输入 232I22141412
AIO233ADC 引脚上的数字输入 233I10
AIO234ADC 引脚上的数字输入 234I35
AIO236ADC 引脚上的数字输入 236I38
AIO237ADC 引脚上的数字输入 237I19121210
AIO238ADC 引脚上的数字输入 238I29181816
AIO239ADC 引脚上的数字输入 239I171111
AIO240ADC 引脚上的数字输入 240I28
AIO241ADC 引脚上的数字输入 241I41
AIO242ADC 引脚上的数字输入 242I8887
AIO244ADC 引脚上的数字输入 244I21131311
AIO245ADC 引脚上的数字输入 245I31191917
AIO246ADC 引脚上的数字输入 246I44
B0ADC-B 输入 0I41
B1ADC-B 输入 1I40252523
B2ADC-B 输入 2I7776
B3ADC-B 输入 3I8887
B4ADC-B 输入 4I39242422
B6ADC-B 输入 6I9998
B8ADC-B 输入 8I36232321
B15ADC-B 输入 15I23151513
C0ADC-C 输入 0I19121210
C1ADC-C 输入 1I29181816
C2ADC-C 输入 2I21131311
C3ADC-C 输入 3I31191917
C4ADC-C 输入 4I171111
C5ADC-C 输入 5I28
C6ADC-C 输入 6I7776
C8ADC-C 输入 8I39242422
C10ADC-C 输入 10I40252523
C14ADC-C 输入 14I44
C15ADC-C 输入 15I23151513
CMP1_HN0CMPSS-1 高电平比较器负输入 0I10
CMP1_HN1CMPSS-1 高电平比较器负输入 1I19121210
CMP1_HP0CMPSS-1 高电平比较器正输入 0I9998
CMP1_HP1CMPSS-1 高电平比较器正输入 1I19121210
CMP1_HP2CMPSS-1 高电平比较器正输入 2I18121210
CMP1_HP3CMPSS-1 高电平比较器正输入 3I10
CMP1_LN0CMPSS-1 低电平比较器负输入 0I10
CMP1_LN1CMPSS-1 低电平比较器负输入 1I19121210
CMP1_LP0CMPSS-1 低电平比较器正输入 0I9998
CMP1_LP1CMPSS-1 低电平比较器正输入 1I19121210
CMP1_LP2CMPSS-1 低电平比较器正输入 2I18121210
CMP1_LP3CMPSS-1 低电平比较器正输入 3I10
CMP2_HN0CMPSS-2 高电平比较器负输入 0I35
CMP2_HN1CMPSS-2 高电平比较器负输入 1I29181816
CMP2_HP0CMPSS-2 高电平比较器正输入 0I36232321
CMP2_HP1CMPSS-2 高电平比较器正输入 1I29181816
CMP2_HP2CMPSS-2 高电平比较器正输入 2I30181816
CMP2_HP3CMPSS-2 高电平比较器正输入 3I35
CMP2_LN0CMPSS-2 低电平比较器负输入 0I35
CMP2_LN1CMPSS-2 低电平比较器负输入 1I29181816
CMP2_LP0CMPSS-2 低电平比较器正输入 0I36232321
CMP2_LP1CMPSS-2 低电平比较器正输入 1I29181816
CMP2_LP2CMPSS-2 低电平比较器正输入 2I30181816
CMP2_LP3CMPSS-2 低电平比较器正输入 3I35
CMP3_HN0CMPSS-3 高电平比较器负输入 0I8887
CMP3_HN1CMPSS-3 高电平比较器负输入 1I21131311
CMP3_HP0CMPSS-3 高电平比较器正输入 0I7776
CMP3_HP1CMPSS-3 高电平比较器正输入 1I21131311
CMP3_HP2CMPSS-3 高电平比较器正输入 2I20131311
CMP3_HP3CMPSS-3 高电平比较器正输入 3I8887
CMP3_LN0CMPSS-3 低电平比较器负输入 0I8887
CMP3_LN1CMPSS-3 低电平比较器负输入 1I21131311
CMP3_LP0CMPSS-3 低电平比较器正输入 0I7776
CMP3_LP1CMPSS-3 低电平比较器正输入 1I21131311
CMP3_LP2CMPSS-3 低电平比较器正输入 2I20131311
CMP3_LP3CMPSS-3 低电平比较器正输入 3I8887
CMP4_HN1CMPSS-4 高电平比较器负输入 1I31191917
CMP4_HP0CMPSS-4 高电平比较器正输入 0I39242422
CMP4_HP1CMPSS-4 高电平比较器正输入 1I31191917
CMP4_HP2CMPSS-4 高电平比较器正输入 2I31191917
CMP4_LN1CMPSS-4 低电平比较器负输入 1I31191917
CMP4_LP0CMPSS-4 低电平比较器正输入 0I39242422
CMP4_LP1CMPSS-4 低电平比较器正输入 1I31191917
CMP4_LP2CMPSS-4 低电平比较器正输入 2I31191917
CMP5_HN1CMPSS-5 高电平比较器负输入 1I171111
CMP5_HP0CMPSS-5 高电平比较器正输入 0I666
CMP5_HP1CMPSS-5 高电平比较器正输入 1I171111
CMP5_HP2CMPSS-5 高电平比较器正输入 2I161111
CMP5_LN1CMPSS-5 低电平比较器负输入 1I171111
CMP5_LP0CMPSS-5 低电平比较器正输入 0I666
CMP5_LP1CMPSS-5 低电平比较器正输入 1I171111
CMP5_LP2CMPSS-5 低电平比较器正输入 2I161111
CMP6_HN0CMPSS-6 高电平比较器负输入 0I38
CMP6_HN1CMPSS-6 高电平比较器负输入 1I28
CMP6_HP0CMPSS-6 高电平比较器正输入 0I37
CMP6_HP1CMPSS-6 高电平比较器正输入 1I28
CMP6_HP2CMPSS-6 高电平比较器正输入 2I28
CMP6_HP3CMPSS-6 高电平比较器正输入 3I38
CMP6_LN0CMPSS-6 低电平比较器负输入 0I38
CMP6_LN1CMPSS-6 低电平比较器负输入 1I28
CMP6_LP0CMPSS-6 低电平比较器正输入 0I37
CMP6_LP1CMPSS-6 低电平比较器正输入 1I28
CMP6_LP2CMPSS-6 低电平比较器正输入 2I28
CMP6_LP3CMPSS-6 低电平比较器正输入 3I38
CMP7_HN0CMPSS-7 高电平比较器负输入 0I41
CMP7_HN1CMPSS-7 高电平比较器负输入 1I44
CMP7_HP0CMPSS-7 高电平比较器正输入 0I40252523
CMP7_HP1CMPSS-7 高电平比较器正输入 1I44
CMP7_HP2CMPSS-7 高电平比较器正输入 2I43
CMP7_HP3CMPSS-7 高电平比较器正输入 3I41
CMP7_LN0CMPSS-7 低电平比较器负输入 0I41
CMP7_LN1CMPSS-7 低电平比较器负输入 1I44
CMP7_LP0CMPSS-7 低电平比较器正输入 0I40252523
CMP7_LP1CMPSS-7 低电平比较器正输入 1I44
CMP7_LP2CMPSS-7 低电平比较器正输入 2I43
CMP7_LP3CMPSS-7 低电平比较器正输入 3I41
DACA_OUT缓冲 DAC-A 输出O23151513
DACB_OUT缓冲 DAC-B 输出O22141412
PGA1_GNDPGA-1 地I1410109
PGA1_INPGA-1 输入I18121210
PGA1_OFPGA-1 输出滤波器（可选）O9998
PGA2_GNDPGA-2 地I32202018
PGA2_INPGA-2 输入I30181816
PGA2_OFPGA-2 输出滤波器（可选）O36232321
PGA3_GNDPGA-3 地I1510109
PGA3_INPGA-3 输入I20131311
PGA3_OFPGA-3 输出滤波器（可选）O7776
PGA4_GNDPGA-4 地I32202018
PGA4_INPGA-4 输入I31191917
PGA4_OFPGA-4 输出滤波器（可选）O39242422
PGA5_GNDPGA-5 地I1310109
PGA5_INPGA-5 输入I161111
PGA5_OFPGA-5 输出滤波器（可选）O666
PGA6_GNDPGA-6 地I32202018
PGA6_INPGA-6 输入I28
PGA6_OFPGA-6 输出滤波器（可选）O37
PGA7_GNDPGA-7 地I42
PGA7_INPGA-7 输入I43
PGA7_OFPGA-7 输出滤波器（可选）O40252523
VDAC片上 DAC 的可选外部基准电压。无论是用于 ADC 输入还是 DAC 基准，此引脚上有一个连接至 VSSA 且无法禁用的 100pF 电容器。如果将此引脚用作片上 DAC 的基准，请在此引脚上放置至少一个 1µF 电容器。I8887
VREFHIAADC-A 高基准电压。在外部基准模式下，从外部将高基准电压驱动至此引脚。在内部基准模式下，电压由器件驱动到该引脚。在任一模式下，在此引脚上放置至少一个 2.2µF 电容器。此电容器应放置在 VREFHIA 和 VREFLOA 引脚之间尽可能靠近器件的位置。不要在内部或外部基准模式下从外部加载此引脚。I/O25161614
VREFHIBADC-B 高基准电压。在外部基准模式下，从外部将高基准电压驱动至此引脚。在内部基准模式下，电压由器件驱动到该引脚。在任一模式下，在此引脚上放置至少一个 2.2µF 电容器。此电容器应放置在 VREFHIB 和 VREFLOB 引脚之间尽可能靠近器件的位置。不要在内部或外部基准模式下从外部加载此引脚。I/O24161614
VREFHICADC-C 高基准电压。在外部基准模式下，从外部将高基准电压驱动至此引脚。在内部基准模式下，电压由器件驱动到该引脚。在任一模式下，在此引脚上放置至少一个 2.2µF 电容器。此电容器应放置在 VREFHIC 和 VREFLOC 引脚之间尽可能靠近器件的位置。不要在内部或外部基准模式下从外部加载此引脚。I/O24161614
VREFLOAADC-A 低基准电压I27171715
VREFLOBADC-B 低基准电压I26171715
VREFLOCADC-C 低基准电压I26171715