TIDEP0079

基于 Sitara AM57x 千兆位以太网和 PRU-ICSS 且具有“时间触发发送”功能的 EtherCAT® 参考设计

TIDEP0079

设计文件

概述

TIDEP0079 参考设计展示了采用 Acontis 提供的 EC 主站协议栈在 Sitara™ AM572x 处理器上运行的 EtherCAT® 主接口。此 EtherCAT 主站解决方案可用于基于 EtherCAT 的 PLC 或运动控制应用。EtherCAT 主站在 AM572x 处理器的以太网交换机端口和 PRU-ICSS 以太网端口上均可配置,以便设计人员在器件上灵活使用两个交换机端口或四个 PRU-ICSS 以太网端口中的任何一个。对于交换机端口和 PRU-ICSS 以太网端口,该 EtherCAT 主站实现方案均可实现短于 100µs 的周期时间。在 PRU-ICSS 上可以启用“时间触发发送”(TTS) 功能以减少抖动,实现更短的周期时间,并在未使用分布式时钟的情况下减少延时。

特性
  • 在以太网交换机 (CPSW) 端口和 PRU-ICSS 以太网端口上实现 EtherCAT 主站以进行灵活设计的示例
  • PRU-ICSS 上的 EtherCAT 主站具有“时间触发发送”功能
  • 高度可移植的 Acontis EC 主站协议栈
  • 对于以太网交换机端口和 PRU-ICSS 以太网端口,均可实现低于 30µs 的单周期 CPU 占用时间
  • EtherCAT A 类或 B 类主站协议栈符合 ETG.1500 规范
  • 此参考设计在 TMDXIDK5728 板上经过了测试,其中包括文档、软件、演示应用和硬件设计文件
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我们开发的全面组装电路板仅用于测试和性能验证,不可用于销售。

设计文件和产品

设计文件

下载现成的系统文件,加快您的设计过程。

TIDUBZ1B.PDF (2491 KB)

参考设计概述和经过验证的性能测试数据

TIDRLH6.ZIP (606 KB)

元件放置方式设计布局的详细原理图

TIDRLH5.ZIP (32 KB)

设计元件、引用标识符和制造商/器件型号的完整列表

TIDRLH7A.PDF (6325 KB)

IC 元件的 3D 模型和 2D 图纸使用的文件

TIDCC42A.ZIP (1496 KB)

包含设计 PCB 物理板层信息的设计文件

TIDRLH4.ZIP (1453 KB)

设计布局和元件的详细原理图

产品

在设计中包括 TI 产品和可能的替代产品。

多通道 IC (PMIC)

TPS659037适用于 ARM Cortex A15 处理器的电源管理 IC (PMIC)

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多媒体和工业网络 SoC

AM5726Sitara 处理器:双核 Arm Cortex-A15 和双核 DSP

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同相缓冲器和驱动器

SN74LVC1G07具有漏极开路输出的单通道 1.65V 至 5.5V 缓冲器

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多媒体和工业网络 SoC

AM5716Sitara 处理器:Arm Cortex-A15 和 DSP

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以太网 PHY

TLK105L具有工业级温度范围的单端口 10/100Mbps 以太网物理层收发器

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多媒体和工业网络 SoC

AM5728Sitara 处理器:双核 Arm Cortex-A15 和双核 DSP、多媒体

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RS-485 和 RS-422 收发器

SN65HVD78具有 IEC ESD 保护功能和 50Mbps 的 3.3V 半双工 RS-485

数据表: PDF | HTML
多媒体和工业网络 SoC

AM5718Sitara 处理器:Arm Cortex-A15 和 DSP、多媒体

数据表: PDF | HTML
时钟发生器

CDCE913具有 2.5V 或 3.3V LVCMOS 输出的可编程 1-PLL VCXO 时钟合成器

数据表: PDF | HTML

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* 设计指南 TIDEP0079 Design Guide (Rev. B) 2016-10-26
技术文章 Rise of the industrial robots. Overcoming the challenges of safe robot-human-inter PDF | HTML 2016-11-8

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