TIDEP0079

基于 Sitara AM57x 千兆位以太网和 PRU-ICSS(具有“时间触发发送”功能)的 EtherCAT® 参考设计

TIDEP0079

设计文件

概述

TIDEP0079 参考设计展示了采用来自 Acontis 的 EC-主站协议栈在 Sitara™ AM572x 处理器上运行的 EtherCAT® 主接口。此 EtherCAT 主站解决方案可用于基于 EtherCAT 的 PLC 或运动控制应用。EtherCAT 主站在 AM572x 处理器的以太网交换机端口和 PRU-ICSS 以太网端口上均可配置,从而让设计人员在器件上灵活使用 2 个交换机端口或 4 个 PRU-ICSS 以太网端口中的任何端口。对于交换机端口和 PRU-ICSS 以太网端口,此 EtherCAT 主站实施均可实现小于 100µs 的周期时间。在 PRU-ICSS 上可以启用“时间触发发送”(TTS) 以减少抖动,实现更短的周期时间,并在未使用分布式时钟的情况下减少延迟。

特性
  • 提供在以太网交换机 (CPSW) 端口和 PRU-ICSS 以太网端口上实施 EtherCAT 主站的示例,以便实现灵活设计
  • EtherCAT 主站在 PRU-ICSS 上可启用“时间触发发送”功能
  • 高度便携式 Acontis EC-主站协议栈
  • 对于以太网交换机端口和 PRU-ICSS 以太网端口,均可实现小于 30µs 的 CPU 周期功耗
  • 符合 ETG.1500 规范的 EtherCAT A 类或 B 类主站协议栈
  • 此参考设计在 TMDXIDK5728 板上经过了测试,包括文档、软件、演示应用和硬件设计文件

我们开发的全面组装电路板仅用于测试和性能验证,不可用于销售。

设计文件和产品

设计文件

下载现成的系统文件,加快您的设计过程。

TIDUBZ1B.PDF (2490 K)

参考设计概述和经过验证的性能测试数据

TIDRLH4.ZIP (1453 K)

设计布局和元件的详细原理图

TIDRLH5.ZIP (31 K)

设计元件、引用标识符和制造商/器件型号的完整列表

TIDRLH6.ZIP (606 K)

元件放置方式设计布局的详细原理图

TIDRLH7A.PDF (6325 K)

IC 元件的 3D 模型和 2D 图纸使用的文件

TIDRLH7.ZIP (19060 K)

IC 元件的 3D 模型和 2D 图纸使用的文件

TIDCC42A.ZIP (1495 K)

包含设计 PCB 物理板层信息的设计文件

TIDCC42.ZIP (10113 K)

包含设计 PCB 物理板层信息的设计文件

产品

在设计中包括 TI 产品和可能的替代产品。

RS-485 和 RS-422 收发器

SN65HVD78具有 IEC ESD 保护功能和 50Mbps 的 3.3V 半双工 RS-485

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以太网 PHY

TLK105LTLK105L、TLK106L 工业温度、单端口 10/100Mbs 以太网物理层

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同相缓冲器和驱动器

SN74LVC1G07具有漏极开路输出的单路 1.65V 至 5.5V 缓冲器

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基于 Arm 的处理器

AM5716Sitara 处理器:Arm Cortex-A15 和 DSP

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基于 Arm 的处理器

AM5718Sitara 处理器:Arm Cortex-A15 和 DSP、多媒体

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基于 Arm 的处理器

AM5726Sitara 处理器:双核 Arm Cortex-A15 和双核 DSP

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基于 Arm 的处理器

AM5728Sitara 处理器:双核 Arm Cortex-A15 和双核 DSP、多媒体

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多通道 IC (PMIC)

TPS659037适用于 ARM Cortex A15 处理器的电源管理 IC (PMIC)

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时钟发生器

CDCE913具有 2.5V 或 3.3V LVCMOS 输出的可编程 1-PLL VCXO 时钟合成器

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技术文档

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类型 标题 下载最新的英文版本 日期
* 设计指南 TIDEP0079 Design Guide (Rev. B) 2016年 10月 26日
技术文章 Rise of the industrial robots. Overcoming the challenges of safe robot-human-interaction in factory automation 2016年 11月 8日

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