LP2998
- AEC-Q100 Test Guidance with the following results
(SO PowerPAD-8):- Device HBM ESD Classification Level H1C
- Junction Temperature Range –40°C to 125°C
- 1.35 V Minimum VDDQ
- Source and Sink Current
- Low Output Voltage Offset
- No External Resistors Required
- Linear Topology
- Suspend to Ram (STR) Functionality
- Low External Component Count
- Thermal Shutdown
The LP2998 linear regulator is designed to meet JEDEC SSTL-2 and JEDEC SSTL-18 specifications for termination of DDR-SDRAM and DDR2 memory. The device also supports DDR3 and DDR3L VTT bus termination with VDDQ min of 1.35 V. The device contains a high-speed operational amplifier to provide excellent response to load transients. The output stage prevents shoot through while delivering 1.5 A continuous current and transient peaks up to 3 A in the application as required for DDR-SDRAM termination. The LP2998 also incorporates a VSENSE pin to provide superior load regulation and a VREF output as a reference for the chipset and DIMMs.
An additional feature found on the LP2998 is an active low shutdown (SD) pin that provides Suspend To RAM (STR) functionality. When SD is pulled low the VTT output will tri-state providing a high impedance output, but, VREF will remain active. A power savings advantage can be obtained in this mode through lower quiescent current.
技术文档
| 顶层文档 | 类型 | 标题 | 格式选项 | 下载最新的英语版本 | 日期 | |
|---|---|---|---|---|---|---|
| * | 数据表 | LP2998/LP2998-Q1 DDR Termination Regulator 数据表 (Rev. K) | PDF | HTML | 2014-8-20 | ||
| 应用手册 | DDR VTT Power Solutions: A Competitive Analysis (Rev. A) | 2020-7-9 | ||||
| 应用手册 | Limiting DDR Termination Regulators’ Inrush Current | 2016-8-23 | ||||
| 应用手册 | AN-1254 DDR-SDRAM Termination Simplified Using a Linear Regulator (Rev. A) | 2013-5-6 | ||||
| 应用手册 | Pwr Ref Design f/'C6472 12-Vin Digital Pwr Controllers and LDOs | 2010-4-28 | ||||
| 应用手册 | Power Two Xilinx(TM) LX240 Virtex-6(TM) Devices | 2010-4-20 | ||||
| 应用手册 | Power Ref Design for TMS320C6472 5Vin DC/DC Converters (1x C6472) | 2010-3-31 | ||||
| 应用手册 | 'C6472 12Vin Flexible Pwr Design Using DCDC Controllers and LDOs (8x C6472) | 2010-3-26 | ||||
| 应用手册 | TMS320C6472 5V Input Pwr Design, Integrated FET DC/DC Converters and Controllers | 2010-3-26 | ||||
| 应用手册 | Power Reference Design for the 'C6472, 12V DCDC Controllers, and LDOs | 2010-3-26 |
设计与开发
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LP2998EVAL — 用于 LP2998 的评估板
The LP2998 evaluation board is designed to provide the design Engineer with a fully functional prototype system in which to evaluate the LP2998 in both a static environment and with a complete memory system.
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PMP10601 参考设计提供为 Xilinx® Zynq® 7000 系列 (XC7Z015) FPGA 供电所需的所有电源轨。 此设计使用多个 LMZ3 系列模块、LDO 及 DDR 终端稳压器提供为 FPGA 供电所需的所有电源轨。 它还有一个用于上电和断电时序控制的 LM3880。 此设计使用 12V 输入。
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PMP10630 参考设计是一款适用于 Xilinx® Kintex® UltraScale™ XCKU040 FPGA 的完整高密度电源解决方案。此设计使用 SIMPLE SWITCHER® 模块和 LDO 的最佳组合，在 36mm x 43mm（1.4 英寸 x 1.7 英寸）的小型解决方案尺寸内提供所有必要的电压轨。该设计包括用于为内核轨供电的 LMZ31704 LMZ3 系列模块以及三个 LMZ21700/1 Nano 系列模块。此设计使用 LM3880 序列发生器管理正确的电源时序，它还具有一个采用 LP2998 DDR 终端稳压器的可选 DDR3 存储器电源。该参考设计采用 (...)
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此参考设计描述了一种备用电源电路，该电路通过使用降压-升压转换器和两个堆叠的超级电容器来解决电源中断的瞬时保护问题。该实施方案基于完全集成的 TPS63020 降压/升压转换器电路，可实现较小的总解决方案尺寸。该设计还提供了有源电池平衡电路。此配置已通过完整测试报告及操作说明进行测试。
TIDA-010011 — 适用于保护继电器处理器模块的高效电源架构参考设计
| 封装 | 引脚 | CAD 符号、封装和 3D 模型 |
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| HSOIC (DDA) | 8 | Ultra Librarian |
| SOIC (D) | 8 | Ultra Librarian |
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