LMK3H2104

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4 路输出、符合 PCIe 第 1 代至第 7 代标准的、无 BAW 参考的时钟发生器、时钟多路复用器和缓冲器

产品详情

Number of outputs 4 Output type LP-HCSL, LVCMOS, LVDS Output frequency (max) (MHz) 400 Core supply voltage (V) 1.8, 2.5, 3.3 Output supply voltage (V) 1.8, 2.5, 3.3 Operating temperature range (°C) -40 to 105 Features I2C, One-Time Programmable (OTP) memory, PCIe Gen 1 - 7 compliant, Pin programmable, Serial interface Rating Catalog
Number of outputs 4 Output type LP-HCSL, LVCMOS, LVDS Output frequency (max) (MHz) 400 Core supply voltage (V) 1.8, 2.5, 3.3 Output supply voltage (V) 1.8, 2.5, 3.3 Operating temperature range (°C) -40 to 105 Features I2C, One-Time Programmable (OTP) memory, PCIe Gen 1 - 7 compliant, Pin programmable, Serial interface Rating Catalog
VQFN (RGE) 24 16 mm² (4 mm × 4 mm)
  • 集成 BAW 谐振器
    • 无需外部 XTAL/XO
  • 灵活的输出频率
    • 2 个分数输出分频器 (FOD),单个通道分频器
    • 高达 400MHz 输出频率
  • 灵活的输出格式
    • 1.2/1.8/2.5/3.3V LVCMOS
    • 直流耦合或交流耦合 LVDS
    • 具有可编程摆幅的 LP-HCSL。LVPECL、CML 和其他格式可从 LP-HCSL 推导出来
  • 极低抖动
    • 最大抖动限制为 61fs 的 PCIe 第 5 代通用时钟 (CC),有 SSC 抖动
    • 最大抖动限制为 36.4fs 的 PCIe 第 6 代通用时钟 (CC),有 SSC 抖动
    • 最大抖动限制为 25.5fs 的 PCIe 第 7 代通用时钟 (CC),有 SSC 抖动
  • 符合 PCIe 第 1 代到第 7 代标准
  • 可配置 SSC
    • 可编程 -0.05% 至 -3% 向下展频和 ±0.025% 至 ±1.5% 中心展频,或预设 -0.1%、-0.25%、-0.3% 和 -0.5% 向下展频
  • 可以旁路至任何输出端的 3 个输入 (LMK3H2108) 或 1 个输入(LMK3H2104)
  • 5ms 最大启动时间
  • 器件电源关闭时,可以将失效防护输入引脚拉至高电平
  • 灵活的电源配置
    • 每个 VDD 引脚都可以独立连接,提供至 1.8V、2.5V 或 3.3V 电压
    • 每个 VDDO 引脚都可以独立连接且设置为 1.8V、2.5V 或 3.3V 电压
  • –40°C 至 105°C 环境温度
  • 集成 BAW 谐振器
    • 无需外部 XTAL/XO
  • 灵活的输出频率
    • 2 个分数输出分频器 (FOD),单个通道分频器
    • 高达 400MHz 输出频率
  • 灵活的输出格式
    • 1.2/1.8/2.5/3.3V LVCMOS
    • 直流耦合或交流耦合 LVDS
    • 具有可编程摆幅的 LP-HCSL。LVPECL、CML 和其他格式可从 LP-HCSL 推导出来
  • 极低抖动
    • 最大抖动限制为 61fs 的 PCIe 第 5 代通用时钟 (CC),有 SSC 抖动
    • 最大抖动限制为 36.4fs 的 PCIe 第 6 代通用时钟 (CC),有 SSC 抖动
    • 最大抖动限制为 25.5fs 的 PCIe 第 7 代通用时钟 (CC),有 SSC 抖动
  • 符合 PCIe 第 1 代到第 7 代标准
  • 可配置 SSC
    • 可编程 -0.05% 至 -3% 向下展频和 ±0.025% 至 ±1.5% 中心展频,或预设 -0.1%、-0.25%、-0.3% 和 -0.5% 向下展频
  • 可以旁路至任何输出端的 3 个输入 (LMK3H2108) 或 1 个输入(LMK3H2104)
  • 5ms 最大启动时间
  • 器件电源关闭时,可以将失效防护输入引脚拉至高电平
  • 灵活的电源配置
    • 每个 VDD 引脚都可以独立连接,提供至 1.8V、2.5V 或 3.3V 电压
    • 每个 VDDO 引脚都可以独立连接且设置为 1.8V、2.5V 或 3.3V 电压
  • –40°C 至 105°C 环境温度

LMK3H2104 和 LMK3H2108 是基于 BAW 的时钟发生器,不需要任何外部 XTAL 或 XO。这些器件可用作 PCIe 时钟发生器或通用时钟发生器。2个 FOD(分数输出分频器)在提供频率灵活性的同时实现低功耗和低抖动。

LMK3H2104 提供多达 4 个差分输出以及 2 个 LVCMOS 输出,或者提供多达 10 个 LVCMOS 输出。LMK3H2108 提供多达 8 个差分输出或 16 个 LVCMOS 输出。

LMK3H2104 具有 1 个时钟输入,LMK3H2108 具有 3 个时钟输入。时钟输入提供时钟多路复用和缓冲功能。每个输出组可以独立选择任何时钟源。

GPI 和 GPIO 引脚提供了额外的控制灵活性。这些引脚可以配置为单独 OE、分组 OE、I2C 地址选择、OTP 页面选择、PWRGD/PWRDN#、状态输出和其他功能。

该器件支持一次性可编程 (OTP) 非易失性存储器,后者可定制亦可出厂预编程。

LMK3H2104 和 LMK3H2108 是基于 BAW 的时钟发生器,不需要任何外部 XTAL 或 XO。这些器件可用作 PCIe 时钟发生器或通用时钟发生器。2个 FOD(分数输出分频器)在提供频率灵活性的同时实现低功耗和低抖动。

LMK3H2104 提供多达 4 个差分输出以及 2 个 LVCMOS 输出,或者提供多达 10 个 LVCMOS 输出。LMK3H2108 提供多达 8 个差分输出或 16 个 LVCMOS 输出。

LMK3H2104 具有 1 个时钟输入,LMK3H2108 具有 3 个时钟输入。时钟输入提供时钟多路复用和缓冲功能。每个输出组可以独立选择任何时钟源。

GPI 和 GPIO 引脚提供了额外的控制灵活性。这些引脚可以配置为单独 OE、分组 OE、I2C 地址选择、OTP 页面选择、PWRGD/PWRDN#、状态输出和其他功能。

该器件支持一次性可编程 (OTP) 非易失性存储器,后者可定制亦可出厂预编程。

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* 数据表 LMK3H2104 和 LMK3H2108 4 输出和 8 输出 PCIe 第 1 代至第 7 代兼容低抖动通用 BAW 时钟发生器 数据表 (Rev. A) PDF | HTML 英语版 (Rev.A) PDF | HTML 2025-11-14
* 用户指南 LMK3H2104A01 Register Map PDF | HTML 2026-1-22
* 用户指南 LMK3H2104A0E Register Map PDF | HTML 2026-1-22
* 用户指南 LMK3H2104A09 Register Map PDF | HTML 2026-1-22
* 用户指南 LMK3H2104A0D Register Map PDF | HTML 2026-1-22
* 用户指南 LMK3H2104A10 Register Map PDF | HTML 2026-1-21
用户指南 LMK3H2104A0E 配置指南 PDF | HTML 英语版 PDF | HTML 2026-1-26
用户指南 LMK3H2104A02 配置指南 PDF | HTML 英语版 PDF | HTML 2026-1-26
用户指南 LMK3H2104A09 配置指南 PDF | HTML 英语版 PDF | HTML 2026-1-26
用户指南 LMK3H2104A02 寄存器映射 PDF | HTML 英语版 PDF | HTML 2026-1-26
用户指南 LMK3H2104A01 配置指南 PDF | HTML 英语版 PDF | HTML 2026-1-26
用户指南 LMK3H2104 寄存器映射 PDF | HTML 英语版 PDF | HTML 2025-11-5
证书 LMK3H2104EVM EU Declaration of Conformity (DoC) 2025-7-22

设计与开发

如需其他信息或资源,请点击以下任一标题进入详情页面查看(如有)。

仿真模型

LMK3H210X IBIS Model

SNAM304.ZIP (291 KB) - IBIS 模型
支持的产品和硬件
设计工具

PLLATINUMSIM-SW — PLL 环路滤波器、相位噪声、锁定时间和杂散模拟工具

PLLATINUMSIM-SW 是一款仿真工具,允许用户创建我们 PLLatinum™ 集成电路的详细设计和仿真,其中包括 LMX 系列锁相环 (PLL) 和合成器。

支持的产品和硬件
封装 引脚 CAD 符号、封装和 3D 模型
VQFN (RGE) 24 Ultra Librarian

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