DAC5682Z
- 16-Bit Digital-to-Analog Converter (DAC)
- 1.0 GSPS Update Rate
- 16-Bit Wideband Input LVDS Data Bus
- 8 Sample Input FIFO
- Interleaved I/Q Data for Dual-DAC Mode
- High Performance
- 73-dBc ACLR WCDMA TM1 at 180 MHz
- 2x-32x Clock Multiplying PLL/VCO
- 2x or 4x Interpolation Filters
- Stopband Transition 0.4 to 0.6 Fdata
- Filters Configurable in Either Low-Pass or High-Pass
Mode Allows Selection of Higher Order Image
- Fs/4 Coarse Mixer
- On-Chip 1.2-V Reference
- Differential Scalable Output: 2 to 20 mA
- Package: 64-Pin 9-mm × 9-mm QFN
- APPLICATIONS
- Cellular Base Stations
- Broadband Wireless Access (BWA)
- WiMAX 802.16
- Fixed Wireless Backhaul
- Cable Modem Termination System (CMTS)
All other trademarks are the property of their respective owners
The DAC5682Z is a dual-channel 16-bit 1.0 GSPS DAC with wideband LVDS data input, integrated 2x/4x interpolation filters, onboard clock multiplier, and internal voltage reference. The DAC5682Z offers superior linearity, noise, crosstalk, and PLL phase noise performance.
The DAC5682Z integrates a wideband LVDS port with on-chip termination. Full-rate input data can be transferred to a single DAC channel, or half-rate and 1/4-rate input data can be interpolated by onboard 2x or 4x FIR filters. Each interpolation FIR is configurable in either low-pass or high-pass mode, allowing selection of a higher order output spectral image. An on-chip delay lock loop (DLL) simplifies LVDS interfacing by providing skew control for the LVDS input data clock.
The DAC5682Z allows both complex or real output. An optional Fs/4 coarse mixer in complex mode provides coarse frequency upconversion and the dual DAC output produces a complex Hilbert Transform pair. An external RF quadrature modulator then performs the final single sideband up-conversion. The interpolation filters and complex coarse mixers efficiently provide frequency plan flexibility while enabling higher output DAC rates to simplify image rejection filtering.
The DAC5682Z is characterized for operation over the industrial temperature range of –40°C to 85°C and is available in a 64-pin QFN package. Other single-channel members of the family include the interpolating DAC5681Z and the noninterpolating DAC5681.
技术文档
| 顶层文档 | 类型 | 标题 | 格式选项 | 下载最新的英语版本 | 日期 | |
|---|---|---|---|---|---|---|
| * | 数据表 | DAC5682Z 16-Bit, 1.0 GSPS 2x-4x Interpolating Dual-Channel Digital-to-Analog Converter (DAC) 数据表 (Rev. F) | PDF | HTML | 2015-1-20 | ||
| 模拟设计期刊 | Q3 2009 Issue Analog Applications Journal | 2018-9-24 | ||||
| 用户指南 | TSW3100 High Speed Digital Pattern Generator. (Rev. C) | 2016-5-26 | ||||
| 设计指南 | Wide-Bandwidth and High-Voltage Arbitrary Waveform Generator Front End | 2013-9-3 | ||||
| 应用手册 | High Speed, Digital-to-Analog Converters Basics (Rev. A) | 2012-10-23 | ||||
| 用户指南 | TSW1400 Pattern Generators | 2012-5-3 | ||||
| 用户指南 | GC5325 System Evaluation Kit (Rev. F) | 2011-4-20 | ||||
| 应用手册 | Design of Differential Filters for High-Speed Signal Chains (Rev. B) | 2010-4-30 | ||||
| 模拟设计期刊 | Interfacing op amps to high-speed DACs, Part 1: Current-sinking DACs | 2009-7-14 | ||||
| 应用手册 | Passive Terminations for Current Output DACs | 2008-11-10 | ||||
| 应用手册 | CDCE72010 as a Clocking Solution for High-Speed Analog-to-Digital Converters | 2008-6-8 | ||||
| 应用手册 | Phase Noise Performance and Jitter Cleaning Ability of CDCE72010 | 2008-6-2 |
设计与开发
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它能与 TSW3100 配合使用以执行各种测试程序。TSW3100 生成了测试模式，该模式将通过 1GSPS LVDS 接口被馈送至 DAC5681ZEVM。DAC5681ZEVM 具有可使 TSW3100 板与 DAC5681ZEVM 同步的可编程时钟芯片。
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