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模数转换器 (ADC)
高速 ADC (≥10 MSPS)

ADS5282

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八通道、12 位、65MSPS 模数转换器 (ADC)

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产品详情

Sample rate (max) (Msps) 65 Resolution (Bits) 12 Number of input channels 8 Interface type Serial LVDS Analog input BW (MHz) 520 Features Low Power Rating Catalog Peak-to-peak input voltage range (V) 2 Power consumption (typ) (mW) 616 Architecture Pipeline SNR (dB) 70 ENOB (Bits) 11.3 SFDR (dB) 85 Operating temperature range (°C) -40 to 85 Input buffer No
Sample rate (max) (Msps) 65 Resolution (Bits) 12 Number of input channels 8 Interface type Serial LVDS Analog input BW (MHz) 520 Features Low Power Rating Catalog Peak-to-peak input voltage range (V) 2 Power consumption (typ) (mW) 616 Architecture Pipeline SNR (dB) 70 ENOB (Bits) 11.3 SFDR (dB) 85 Operating temperature range (°C) -40 to 85 Input buffer No
VQFN (RGC) 64 81 mm² (9 mm × 9 mm)
  • Speed and Resolution Grades:
    • ADS5281: 12-bit, 50MSPS
    • ADS5282: 12-bit, 65MSPS
  • Power Dissipation:
    • 48mW/Channel at 30MSPS
    • 55mW/Channel at 40MSPS
    • 64mW/Channel at 50MSPS
    • 77mW/Channel at 65MSPS
  • 70dBFS SNR at 10MHz IF
  • Analog Input Full-Scale Range: 2VPP
  • Low-Frequency Noise Suppression Mode
  • 6dB Overload Recovery In One Clock
  • External and Internal (Trimmed) Reference
  • 3.3V Analog Supply, 1.8V Digital Supply
  • Single-Ended or Differential Clock:
    • Clock Duty Cycle Correction Circuit (DCC)
  • Programmable Digital Gain: 0dB to 12dB
  • Serialized DDR LVDS Output
  • Programmable LVDS Current Drive, Internal Termination
  • Test Patterns for Enabling Output Capture
  • Straight Offset Binary or Two’s Complement Output
  • Package Options:
    • 9mm × 9mm QFN-64
    • HTQFP-80 PowerPAD Compatible with ADS527x Family
  • Speed and Resolution Grades:
    • ADS5281: 12-bit, 50MSPS
    • ADS5282: 12-bit, 65MSPS
  • Power Dissipation:
    • 48mW/Channel at 30MSPS
    • 55mW/Channel at 40MSPS
    • 64mW/Channel at 50MSPS
    • 77mW/Channel at 65MSPS
  • 70dBFS SNR at 10MHz IF
  • Analog Input Full-Scale Range: 2VPP
  • Low-Frequency Noise Suppression Mode
  • 6dB Overload Recovery In One Clock
  • External and Internal (Trimmed) Reference
  • 3.3V Analog Supply, 1.8V Digital Supply
  • Single-Ended or Differential Clock:
    • Clock Duty Cycle Correction Circuit (DCC)
  • Programmable Digital Gain: 0dB to 12dB
  • Serialized DDR LVDS Output
  • Programmable LVDS Current Drive, Internal Termination
  • Test Patterns for Enabling Output Capture
  • Straight Offset Binary or Two’s Complement Output
  • Package Options:
    • 9mm × 9mm QFN-64
    • HTQFP-80 PowerPAD Compatible with ADS527x Family

The ADS528x is a family of high-performance, low-power, octal channel analog-to-digital converters (ADCs). Available in either a 9mm × 9mm QFN package or an HTQFP-80 package, with serialized low-voltage differential signaling (LVDS) outputs and a wide variety of programmable features, the ADS528x is highly customizable for a diversity of applications and offers an unprecedented level of system integration. An application note, XAPP774 (available at www.xilinx.com), describes how to interface the serial LVDS outputs of TI&3146;s ADCs to Xilinx field-programmable gate arrays (FPGAs). The ADS528x family is specified over the industrial temperature range of –40°C to +85°C.

The ADS528x is a family of high-performance, low-power, octal channel analog-to-digital converters (ADCs). Available in either a 9mm × 9mm QFN package or an HTQFP-80 package, with serialized low-voltage differential signaling (LVDS) outputs and a wide variety of programmable features, the ADS528x is highly customizable for a diversity of applications and offers an unprecedented level of system integration. An application note, XAPP774 (available at www.xilinx.com), describes how to interface the serial LVDS outputs of TI&3146;s ADCs to Xilinx field-programmable gate arrays (FPGAs). The ADS528x family is specified over the industrial temperature range of –40°C to +85°C.
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技术文档

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* 数据表 12-Bit Octal-Channel ADC Family Up to 65MSPS. 数据表 (Rev. I) 2012-6-1
* 勘误表 Errata to ADS528x, Datasheet Literature Number SBAS397 (Rev. B) 2007-10-19
用户指南 TSW6011EVM Quick Start Guide (Rev. D) 2016-8-17
应用手册 Design Considerations for Avoiding Timing Errors during High-Speed ADC, LVDS Dat (Rev. A) 2015-5-22
设计指南 Direct Down-Conversion System With I/Q Correction (TIDA-00078 CerTIfied Design) 2013-7-23
应用手册 Why Use Oversampling when Undersampling Can Do the Job? (Rev. A) 2013-7-19
应用手册 Understanding Serial LVDS Capture in High-Speed ADCs 2013-7-10
应用手册 Driving High-Speed ADCs: Circuit Topologies and System-Level Parameters (Rev. A) 2010-9-10
应用手册 Smart Selection of ADC/DAC Enables Better Design of Software-Defined Radio 2009-4-28
应用手册 CDCE62005 as Clock Solution for High-Speed ADCs 2008-9-4
用户指南 ADS528x 评估板用户手册 英语版 2008-8-12
应用手册 CDCE72010 as a Clocking Solution for High-Speed Analog-to-Digital Converters 2008-6-8
应用手册 Phase Noise Performance and Jitter Cleaning Ability of CDCE72010 2008-6-2
应用手册 QFN Layout Guidelines 2006-7-28

设计与开发

如需其他信息或资源，请点击以下任一标题进入详情页面查看（如有）。

评估板

ADS5282EVM — ADS5282 八通道 12 位 65MSPS 模数转换器评估模块

特别说明：希望评估 ADS528x 的客户应订购 ADS528xEVM、ADSDESER-50EVM 和 ADSDESER-50EVM 适配卡。

ADS5282EVM 提供一个平台，用于在各种信号、基准和电源条件下对八通道 ADS5282 模数转换器 (ADC) 进行评估。

该 EVM 提供了一个外部 SMA 连接器，用于连接 ADC 的八个模拟输入和 ADC 时钟的输入。可使用单端或差分时钟为 ADC 提供计时，EVM 上的配置允许用户使用单端 PECL 时钟或差分变压器耦合时钟来评估 ADC。

EVM 通过高速、高密度 Samtec 输出接头提供数字输出。数字输出连接器直接连接到 (...)

支持的产品和硬件
有库存
限制：
??asset.out-of-stock-ti_zh_CN??
无货
评估模块 (EVM) 用 GUI

DATACONVERTERPRO-SW — 高速数据转换器专业 GUI 安装程序，v5.31

该高速数据转换器专业版 GUI 是一款 PC（与 Windows® XP/7/10 兼容）程序，旨在帮助评估大多数 TI 高速数据转换器 [模数转换器 (ADC) 和数模转换器 (DAC)] 和模拟前端 (AFE) 平台。DATACONVERTERPRO-SW 支持整个 TSW14xxx 系列的数据采集和图形生成卡，为分析时域和频域中的数据转换器提供了快速强大的解决方案以及单音、多音和调制信号支持。此 GUI 还兼容用于快速合成单音、多音和调制信号的 TI 图形生成 GUI。

用户可以向 DATACONVERTERPRO-SW 提供自定义图形以加载到 TI DAC。支持从 ADC 捕获导出 (...)

支持的产品和硬件
支持软件

HSADC-SPI-UTILITY — ADS5400 EVM GUI

支持的产品和硬件
仿真模型

ADS5281/82/87 IBIS Model

SBOC249.ZIP (360 KB) - IBIS 模型
支持的产品和硬件
计算工具

ADC-HARMONIC-CALC — ADC Frequency Calculator Download

    ADC 谐波计算工具是基于 excel 的计算器，用于确定当模数转换器中出现奈奎斯特混叠后高次谐波的频率空间的位置。

    如果给定 ADC 采样速率和有用信号的范围，该计算器可以确定第 2 至第 9 谐波是否会返送到有用信号的频带中。图表以图形方式显示了在出现奈奎斯特混叠后基本信号以及第 2 至第 9 谐波的位置。

支持的产品和硬件
计算工具

ANALOG-ENGINEER-CALC — PC software analog engineer's calculator

模拟工程师计算器旨在加快模拟电路设计工程师经常运用的许多重复性计算。该基于 PC 的工具提供图形界面，其中显示各种常见计算列表，从使用反馈电阻器设置运算放大器增益到选择合适的电路设计元件，以稳定模数转换器 (ADC) 驱动器缓冲器电路。

除了可用作独立工具之外，该计算器还能很好地与模拟工程师口袋参考中所述的概念配合使用。

支持的产品和硬件
计算工具

JITTER-SNR-CALC — Jitter and SNR calculator

JITTER-SNR-CALC 可用于根据输入频率和时钟抖动来计算 ADC 的理论信噪比 (SNR) 性能。

支持的产品和硬件
设计工具

SBAC119 — TIGAR (Texas Instruments Graphical Evaluation of ADC Response Tool)

支持的产品和硬件
参考设计

TIDA-00078 — 具有 I/Q 校正的直接降频转换系统

TSW6011EVM 的现场可编程门阵列 (FPGA) 中实现的 I/Q 校正块，可帮助用户在无线系统中采用直接降压转换接收器架构。I/Q 校正块包含一个单抽头盲算法，该算法可校正复杂零中频接收器系统中与频率无关的 I/Q 不平衡。除了 I/Q 校正块外，FPGA 还包括一个数字增益块、一个数字功率测量块、2 个内插块、I/Q 偏移校正块和正交混合块。

支持的产品和硬件
封装 引脚 CAD 符号、封装和 3D 模型
VQFN (RGC) 64 Ultra Librarian
适用于评估类项目的 TI 标准条款与条件。

订购和质量

推荐产品可能包含与 TI 此产品相关的参数、评估模块或参考设计。

支持和培训

可获得 TI 工程师技术支持的 TI E2E™ 论坛

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