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产品详细信息

参数

Technology Family LVC VCC (Min) (V) 1.65 VCC (Max) (V) 5.5 Channels (#) 1 Inputs per channel 2 IOL (Max) (mA) 32 IOH (Max) (mA) -32 Input type Standard CMOS Output type Push-Pull Features Partial Power Down (Ioff), Over-Voltage Tolerant Inputs, Ultra High Speed (tpd <5ns) Data rate (Max) (Mbps) 100 Rating Catalog Operating temperature range (C) -40 to 125, -40 to 85 open-in-new 查找其它 或门

封装|引脚|尺寸

DSBGA (YZP) 5 2 mm² .928 x 1.428 SOT-23 (DBV) 5 5 mm² 2.9 x 1.6 SOT-5X3 (DRL) 5 3 mm² 1.6 x 1.6 SOT-SC70 (DCK) 5 4 mm² 2 x 2.1 USON (DRY) 6 1 mm² 1.5 x 1 X2SON (DPW) 5 1 mm² .8 x .8 X2SON (DSF) 6 1 mm² 1 x 1 open-in-new 查找其它 或门

特性

  • Available in the Ultra-Small 0.64 mm2
    Package (DPW) with 0.5-mm Pitch
  • Supports 5-V VCC Operation
  • Inputs Accept Voltages to 5.5-V
  • Supports Down Translation to VCC
  • Max tpd of 3.6 ns at 3.3-V
  • Low Power Consumption, 10-µA Max ICC
  • ±24-mA Output Drive at 3.3-V
  • Ioff Supports Live Insertion, Partial-Power-Down
    Mode, and Back-Drive Protection
  • Latch-Up Performance Exceeds 100 mA Per
    JESD 78, Class II
  • ESD Protection Exceeds JESD 22
    • 2000-V Human-Body Model (A114-A)
    • 200-V Machine Model (A115-A)
    • 1000-V Charged-Device Model (C101)
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描述

This single 2-input positive-OR gate is designed for 1.65-V to 5.5-V VCC operation.

The SN74LVC1G32 device performs the Boolean function Y = A + B or Y = A\ + B\ in positive logic.

The CMOS device has high output drive while maintaining low static power dissipation over a broad VCC operating range.

The SN74LVC1G32 device is available in a variety of packages, including the ultra-small DPW package with a body size of 0.8 × 0.8 mm.

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技术文档

= 特色
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类型 标题 下载最新的英文版本 发布
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设计与开发

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硬件开发

评估板 下载
document-generic 用户指南
$10.00
说明
灵活的 EVM 设计用于支持具有 5 至 8 引脚数且采用 DCK、DCT、DCU、DRL 或 DBV 封装的任何器件。
特性
  • 电路板设计允许进行多功能性评估
  • 支持多种逻辑器件
评估板 下载
document-generic 用户指南
说明
借助 DM38x 数字视频评估模块 (DVEVM),开发人员可立即开始评估 DM38x 数字媒体处理器,并开始构建数字视频应用,例如 IP 安全摄像头、运动摄像头、无人机、可视门铃、车用数字录像机和其他数字视频产品。此数字视频评估模块 (DVEVM) 支持开发人员编写适用于 ARM 的生产就绪型应用代码,并通过 API 访问 HDVICP 协处理器内核,适用于 DM385、DM388 和 DM389 数字媒体处理器。
特性
  • 基于 DM388 数字媒体处理器的开发板(带有 2Gb DDR3)
  • 通过组件 I/O 进行视频采集和 NTSC 或 PAL 信号输出
  • HDMI 视频输出
  • CSI2 和并行摄像头输入
  • PCIe、SATA 2x、以太网 2x、USB x2、音频、SD 卡槽

设计工具和仿真

仿真模型 下载
SCEJ254.ZIP (87 KB) - HSpice Model
仿真模型 下载
SCEM168C.ZIP (43 KB) - IBIS Model
仿真模型 下载
SCEM632.ZIP (7 KB) - PSpice Model

参考设计

参考设计 下载
TIDA-010065
TIDA-010065 — 该参考设计是一种用于为隔离式放大器生成隔离电源以测量隔离电压和电流的简化架构。一个具有增强型隔离功能且完全集成的直流/直流转换器,采用 5V 输入并提供可配置的 5V 或 5.4V 输出(低压降稳压器 (LDO (...)
document-generic 原理图 document-generic 用户指南 document-generic 下载英文版本
参考设计 下载
适用于 200-480VAC 驱动器且具有光模拟输入栅极驱动器的三相逆变器参考设计
TIDA-010025 — 此参考设计采用隔离式 IGBT 栅极驱动器以及隔离式电流/电压传感器实现了增强型隔离式三相逆变器子系统。所用的 UCC23513 栅极驱动器采用 6 引脚宽体封装和 LED 光模拟输入,可用作现有光隔离式栅极驱动器的引脚对引脚替代品。此设计表明,可使用用于驱动光隔离式栅极驱动器的所有现有配置来驱动 UCC23513 输入级。使用 AMC1300B (...)
document-generic 原理图 document-generic 用户指南 document-generic 下载英文版本 (Rev.A)
参考设计 下载
具有电流、电压和温度保护的增强型隔离式三相逆变器参考设计
TIDA-00366 此设计为额定功率高达 10kW 的三相逆变器提供了参考解决方案,该逆变器采用增强型隔离式栅极驱动器 UCC21530、增强型隔离式放大器 AMC1301 和 AMC1311 以及 MCU TMS320F28027 设计而成。通过配合使用 AMC1301 与 MCU 的内部 ADC 来测量电机电流,以及为 IGBT 栅极驱动器使用自举电源,可以实现更低的系统成本。该逆变器根据设计具有针对过载、短路、接地故障、直流总线欠压/过压和 IGBT 模块过温的保护功能。
document-generic 原理图 document-generic 用户指南 document-generic 下载英文版本 (Rev.C)
参考设计 下载
适用于 ARM® Cortex®-M 微控制器 (MCU) 的摄像机参考设计
TIDM-TM4C129CAMERA 此设计使用一块 QVGA 显示面板来实现网络摄像头,并利用一个嵌入式 Web 服务器进行远程监控。凭借用于 Web 服务器的 250KB 内存容量,TM4C129x 微控制器上有足够的存储器可用于额外定制。
document-generic 原理图 document-generic 用户指南 document-generic 下载英文版本 (Rev.A)
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Acontis EtherCAT 主站协议栈参考设计
TIDEP0043 Acontis EC-Master EtherCAT Master 堆栈是一种可移植度非常高的软件堆栈,可在各种嵌入式平台上使用。EC-Master 支持高性能的 TI Sitara MPU,可提供先进的 EtherCAT Master 解决方案,客户可使用该解决方案来实施 EtherCAT 通信接口电路板、基于 EtherCAT 的 PLC 或运动控制应用。EC-Master 结构设计让用户无需计划额外的任务,因此即使在没有操作系统的平台(例如 AM335x 上支持的 TI Starterware)上也可以使用全部堆栈功能。这种架构结合高速以太网驱动器让用户能在 Sitara 平台上实施 EtherCAT master,循环时间非常短,能达到 100 微秒甚至更短。
document-generic 原理图 document-generic 用户指南 document-generic 下载英文版本 (Rev.A)
参考设计 下载
IR 滤波器模拟控制器参考设计
TIDA-01165 — 参考设计 TIDA-01165 是一款用于红外滤波器的模拟控制器。该设计的亮点是 DRV8837C 电机驱动器,它用于在模块受高强度阳光照射时打开和关闭红外滤波器。简化的布局适合成本敏感型应用,同时还可创建无需固件的解决方案。
document-generic 原理图 document-generic 用户指南
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适用于变电站自动化的并行冗余协议 (PRP) 以太网参考设计
TIDEP0054 — TIDEP0054 TI 参考设计可实现高可靠性、低延迟网络通信解决方案,适用于智能电网传输和分配网络中的变电站自动化设备。它支持 IEC 62439 标准中的并行冗余协议 (PRP) 规范。此解决方案是 FPGA 方法的较低成本替代方法,可提供在无需额外组件的情况下添加 IEC 61850 支持等功能的灵活性和性能。
document-generic 原理图 document-generic 用户指南
参考设计 下载
采用 TMS320C6657 实现的高效 OPUS 编解码器解决方案参考设计
TIDEP0036 TIDEP0036 参考设计演示了如何在 TMS320C6657 器件上轻松运行经 TI 优化的 Opus 编码器/解码器。由于 Opus 支持各类比特率、帧大小和采样率且均延迟极低,因而适用于语音通信、联网音频甚至高性能音频处理应用。较之 ARM 等通用处理器,此设计还通过在 DSP 上实现 Opus 编解码器来提升性能。根据通用处理器上所运行代码的优化级别,通过在 C66x TI DSP 核心上实现 Opus 编解码器即可提供 3 倍于 ARM CORTEX A-15 方案的性能。
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CAD/CAE 符号

封装 引脚 下载
DSBGA (YZP) 5 了解详情
SC70 (DCK) 5 了解详情
SON (DRY) 6 了解详情
SON (DSF) 6 了解详情
SOT-23 (DBV) 5 了解详情
SOT-5X3 (DRL) 5 了解详情
X2SON (DPW) 5 了解详情

订购与质量

支持与培训

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