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CDCM9102

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低噪声双通道 100MHz PCIe 时钟发生器

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产品详情

Function Clock generator Number of outputs 2 Output frequency (max) (MHz) 1296 Core supply voltage (V) 3.3 Output supply voltage (V) 3.3 Input type LVPECL Output type LVDS Operating temperature range (°C) -40 to 85 Features 3.3-V VCC/VDD, Pin programmable Rating Catalog
Function Clock generator Number of outputs 2 Output frequency (max) (MHz) 1296 Core supply voltage (V) 3.3 Output supply voltage (V) 3.3 Input type LVPECL Output type LVDS Operating temperature range (°C) -40 to 85 Features 3.3-V VCC/VDD, Pin programmable Rating Catalog
VQFN (RHB) 32 25 mm² 5 x 5
  • 包括锁相环路 (PLL)、压控振荡器 (VCO)、和回路过滤器的集成型低噪声时钟生成器
  • 2 个低噪声 100MHz 时钟（低电压正射极耦合逻辑 (LVPECL)，低压差分信号 (LVDS)，或者低压 CMOS (LVCOMS) 对）
    • 支持高速电流控制逻辑 (HCSL) 信号传输电平
      （交流耦合）
    • 典型周期抖动：峰值到峰值 (pk-pk) 21ps
    • 典型随机抖动：510ps RMS
    • 由引脚设定的输出类型
  • 附加单端 25MHz 输出
  • 集成晶振输入接受
    25MHz 晶振
  • 输出使能引脚，可关断器件和输出
  • 32 引脚 5mm × 5mm 超薄型四方扁平无引线 (VQFN) 封装
  • 静电放电 (ESD) 保护超过 2000V 人体模型 (HBM) 和 500V 带电器件模型 (CDM)
  • 工业温度范围（-40°C 至 85°C）
  • 3.3V 电源

应用范围

  • PCI Express
    1 代、2 代和 3 代的基准时钟生成
  • 通用计时

All trademarks are the property of their respective owners.

  • 包括锁相环路 (PLL)、压控振荡器 (VCO)、和回路过滤器的集成型低噪声时钟生成器
  • 2 个低噪声 100MHz 时钟（低电压正射极耦合逻辑 (LVPECL)，低压差分信号 (LVDS)，或者低压 CMOS (LVCOMS) 对）
    • 支持高速电流控制逻辑 (HCSL) 信号传输电平
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  • PCI Express
    1 代、2 代和 3 代的基准时钟生成
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CDCM9102 是一款为诸如 PCI Express的通信标准提供基准时钟而设计的低抖动时钟生成器. 该器件最高支持 PCIE 3 代，易于配置和使用。CDCM9102 提供 2 个 100MHz 差分时钟端口。这些端口支持的输出类型包括 LVPECL，LVDS，或者一对 LVCMOS 缓冲器。HCSL 信号传输由交流耦合网络提供支持。用户配置捆绑器件引脚所需的输出缓冲器类型。此外，提供一个单端 25 MHz 时钟输出端口。这一端口的使用包括通用计时、计时以太网物理层 (PHY)、或者为附加的时钟生成器提供一个基准时钟。所有生成的时钟来自一个单一外部 25MHz 晶体。

CDCM9102 是一款为诸如 PCI Express的通信标准提供基准时钟而设计的低抖动时钟生成器. 该器件最高支持 PCIE 3 代，易于配置和使用。CDCM9102 提供 2 个 100MHz 差分时钟端口。这些端口支持的输出类型包括 LVPECL，LVDS，或者一对 LVCMOS 缓冲器。HCSL 信号传输由交流耦合网络提供支持。用户配置捆绑器件引脚所需的输出缓冲器类型。此外，提供一个单端 25 MHz 时钟输出端口。这一端口的使用包括通用计时、计时以太网物理层 (PHY)、或者为附加的时钟生成器提供一个基准时钟。所有生成的时钟来自一个单一外部 25MHz 晶体。
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* 数据表 CDCM9102 低噪声双通道 100MHz 时钟发生器 数据表 (Rev. A) PDF | HTML 下载英文版本 (Rev.A) PDF | HTML 2016年 6月 23日
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设计和开发

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仿真模型

CDCM9102 IBIS Model

SCAM055.ZIP (64 KB) - IBIS Model
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设计工具

CLOCK-TREE-ARCHITECT — 时钟树架构编程软件

时钟树架构是一款时钟树综合工具，可根据您的系统要求生成时钟树解决方案，从而帮助您简化设计流程。该工具从庞大的时钟产品数据库中提取数据，然后生成系统级多芯片时钟解决方案。
立即设计
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PSPICE-FOR-TI — 适用于 TI 设计和模拟工具的 PSpice®

PSpice® for TI 可提供帮助评估模拟电路功能的设计和仿真环境。此功能齐全的设计和仿真套件使用 Cadence® 的模拟分析引擎。PSpice for TI 可免费使用，包括业内超大的模型库之一，涵盖我们的模拟和电源产品系列以及精选的模拟行为模型。

借助 PSpice for TI 的设计和仿真环境及其内置的模型库，您可对复杂的混合信号设计进行仿真。创建完整的终端设备设计和原型解决方案，然后再进行布局和制造，可缩短产品上市时间并降低开发成本。

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  • 器件标识
  • 引脚镀层/焊球材料
  • MSL 等级/回流焊峰值温度
  • MTBF/时基故障估算
  • 材料成分
  • 认证摘要
  • 持续可靠性监测

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