ZHCSRY9B July   2023  – April 2024 TXV0108-Q1

PRODUCTION DATA  

  1.   1
  2. 1 特性
  3. 2 应用
  4. 3 说明
  5. 4 引脚配置和功能
  6. 5 规格
    1. 5.1  绝对最大额定值
    2. 5.2  ESD 等级
    3. 5.3  建议运行条件
    4. 5.4  热性能信息
    5. 5.5  电气特性
    6. 5.6  开关特性，VCCA = 1.2V ± 0.06V
    7. 5.7  开关特性，VCCA = 1.8V ± 0.15V
    8. 5.8  开关特性，VCCA = 2.5V ± 0.2V
    9. 5.9  开关特性，VCCA = 3.3V ± 0.3V
    10. 5.10 典型特性
  7. 6 参数测量信息
    1. 6.1 负载电路和电压波形
  8. 7 详细说明
    1. 7.1 概述
    2. 7.2 功能方框图
    3. 7.3 特性说明
      1. 7.3.1 平衡型高驱动 CMOS 推挽式输出
      2. 7.3.2 局部断电 (Ioff)
      3. 7.3.3 VCC 隔离和 VCC 断开 (Ioff-float)
      4. 7.3.4 过压容限输入
      5. 7.3.5 负钳位二极管
      6. 7.3.6 完全可配置的双轨设计
      7. 7.3.7 支持时序敏感型转换
      8. 7.3.8 可润湿侧翼
      9. 7.3.9 集成阻尼电阻器和阻抗匹配
    4. 7.4 器件功能模式
  9. 8 应用和实施
    1. 8.1 应用信息
    2. 8.2 典型应用
      1. 8.2.1 设计要求
      2. 8.2.2 详细设计过程
      3. 8.2.3 应用曲线
    3. 8.3 系统示例
      1. 8.3.1 借助 TXV0108-Q1 解决电源时序难题
    4. 8.4 电源相关建议
    5. 8.5 布局
      1. 8.5.1 布局指南
      2. 8.5.2 布局示例
  10. 9 器件和文档支持
    1. 9.1 文档支持
      1. 9.1.1 相关文档
    2. 9.2 接收文档更新通知
    3. 9.3 支持资源
    4. 9.4 商标
    5. 9.5 静电放电警告
    6. 9.6 术语表
  11. 10修订历史记录
  12. 11机械、封装和可订购信息

6.1 负载电路和电压波形

除非另有说明，否则所有输入脉冲由具有以下特性的发生器提供：

  • f = 1MHz
  • ZO = 50Ω
  • Δt/ΔV ≤ 1ns/V

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A. CL 包括探头和夹具电容。
图 6-1 负载电路
表 6-1 负载电路条件
参数VCCORLCLS1VTP
tpd传播（延迟）时间1.14V 至 3.6V2kΩ

15pF

开路不适用
ten，tdis启用时间，禁用时间1.14V 至 3.6V2kΩ15pF2 x VCCO0.15V
ten，tdis启用时间，禁用时间1.14V 至 3.6V2kΩ15pFGND0.15V
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  1. tPLH 和 tPHL 之间的较大者与 tpd 相同。
  2. VOH 和 VOL 是在指定 RL、CL 和 S1 下出现的典型输出电压电平
图 6-2 传播延迟
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  1. VOH 和 VOL 是在指定 RL、CL 和 S1 下出现的典型输出电压电平
图 6-3 输入和输出上升与下降时间
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A. 输入被驱动至有效逻辑低电平条件下的输出波形。
B. 输入被驱动至有效逻辑高电平条件下的输出波形。
C. VCCO 是与输出端口相关的电源引脚。
D. VOH 和 VOL 是在指定 RL、CL 和 S1 下出现的典型输出电压电平。
图 6-4 启用时间和禁用时间