ZHCACA3A January 2022 – February 2022 LM4050QML-SP , LMP7704-SP
设计目标
参数 | 值 |
---|---|
共模电压 (VCM) | 100V |
负载电流(Iload 或 Ishunt) | 1A 至 10A |
输出电压 (Vout) | 0.5V 至 5V |
输出电压误差 | < 0.7% |
功耗 | < 700mW |
总电离剂量 (TID) | 100krad (Si) |
单粒子闩锁 (SEL) 抗扰度 | 85MeV·cm2/mg |
设计说明
为了测量电源系统运行状况监控系统中的电流,在负载的高侧或低侧放置了一个分流电阻器。但是,将其放置在低侧可能会干扰负载接地。在大多数应用中,测量高侧电流更为可取。下图显示了一个高侧电流检测电路,其电源电压等于 100V,负载电流范围为 1A 至 10A。该电路的输出范围为 0.5V 至 5V。
设计注意事项
设计步骤
运算放大器共模电压 (VCM) 需要等于或大于总线电压 (Vbus)
如上图所示,分流电阻器 (Rshunt) 和负载电流 (Iload) 用作计算输出百分比误差的输入。结果表明,随着 I_load 减小或 R_shunt 减小,输出误差百分比会增大。因此,在选择 R_shunt 值以满足规格中的最小要求时,负载电流设置为其最小值 (1A)。
在以下曲线中,为获得小于 0.7% 的平方和根 (RSS) 误差,选择了 10mΩ 分流电阻器。尽管增加 R_shunt 可以进一步提高精度,但它也会增加功率耗散。所选 10mΩ CSM 系列分流电阻的器件型号为 Y14870R00100B9W。电阻器的额定功率高达 3W。降额系数为 0.6(基于 EEE-INST-002)时,设计的分流电阻器功率应小于 1.8W。当最大负载电流设计为 10A 时,R_shunt 的最大功耗为 1W,这满足要求。
根据上一个公式,选择 10mΩ (Rshunt) 时,Vload 从 100V 下降到 99.9V。
根据分流电阻器数据表中的降额曲线,可以使用以下公式计算自热系数 (θSH) 和分流电阻器温度变化 (ΔT)。
将前面的公式插入 MATLAB 工具中,可在下图中绘制负载电流与温度变化之间的关系。从曲线中可以看到,满负载电流为 10A 时,分流电阻器温度比周围温度高出约 33.3°C
根据前面的公式,若要获得 0V 至 5V 的 Vout 范围,同时 Rshunt 等于 10kΩ,计算出 R3 与 R6 的比率为 50。选择 R5、R6 和 R3 的值时应考虑 2 个方面:
R6 设为 49.9Ω,在计算的其余部分确定 R3 为 2.49kΩ。在此应用中,选择了型号为 303133 至 303138 的 Vishay® 箔电阻器作为仿真和误差计算的参考。(请参见设计参考资料 部分。)
参数 | IRF9230 | IRHE9230 | IRHN9250 | IRHNJ597230 |
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D-S 击穿 [V] | –200 | –200 | –200 | –200 |
Vgs [V] | -2 至 -4 | -2 至 -4 | -2 至 -4 | -2 至 -4 |
零栅极电压漏极电流 [μA] | -25 至 -250 | -25 至 -250 | -25 至 -250 | -10 至 -25 |
输入电容 [pF] | 700 | 1200 | 4200 | 1344 |
安装类型 | TH | SMT | SMT | SMT |
尺寸 [mm] | 39.37 × 25.53 | 7.94 × 9.41 | 16 × 11.55 | 10.28 × 7.64 |
如 PMOS 比较 表中所示,选择 IRHNJ597230 是因为它具有最小的 IDSS,并且封装尺寸和输入电容相对较小。
本设计中的并联电压基准用于为 LMP7704-SP 运算放大器创建 95V 的虚拟电源电压。LMP7704 的最大电源电流为 4.5mA。因此,所选并联基准的电流范围必须大于 4.5mA。
并联基准选项列出了用于比较的两个并联基准选项。两个并联基准的电流范围都大于 4.5mA。在这种情况下,只要 VEE 约为 95V,反向击穿电压容差就不是很重要。因此,即使 TL1431 在总体上具有更好的性能,也最好使用 LM4050QML,因为它的尺寸更小且所需的元件更少。
参数 | TL1431-SP | LM4050QML-SP |
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反向击穿电压容差 (%) | 0.4 | 1.75 |
TID (krad) | 100 | 100 |
需要的元件 | 5 | 3 |
电流范围 (mA) | 1 至 100 | 0.06 至 15 |
安装类型 | SMT | SMT |
尺寸 (mm) | 10.16 × 7.11 | 6.86 × 10.41 |
由于 LMP7704 消耗的最大电流为 4.5mA,并且所选的并联基准至少需要 0.06mA,因此流经 R2 的电流设计为 4.75mA。通过以下公式计算 R2:
设计仿真
下图显示了 2.49kΩ (R3) 电阻器上的输出电压。根据以下公式计算误差:
理想情况下,当负载电流 (Iload) 在 0A 至 10A 之间摆动时,Vout 在 0V 至 5V 之间摆动。但是,Vout 的最小值为 373mV,并且在负载电流 (Iload) 上升至 735mV 之前是非线性的。
以下仿真和计算显示了具有不同负载电流的电路中每个元件的功耗。在不考虑 R_shunt 功耗的情况下,总功耗为 471.4mW 至 651.3mW。R2 决定了功耗。
下图显示了电路的增益,其中增益 = Vout (V) / Iload (A)。负载电容为 15pF 时,1% 的全功率带宽和 3dB 带宽为 478kHz 和 3.8MHz。
通过测量系统的相位裕度并应用小信号瞬态阶跃响应来验证系统的稳定性。为了确保稳定性,在 AOL 曲线与 1/β 交点处测量的相位裕度需要至少为 45 度。
如以下原理图所示,在反馈回路中添加了一个 1μF 电容器以提高稳定性。以下开环交流仿真在输入处断环,并使用以下公式来绘制相关曲线:
上图显示了频域仿真结果。相位裕度是在 1/ꞵ 和 AOL 交点处测量的,为 58.3 度,表示系统稳定。
为了进一步确保稳定性,在电路的输入端 (IG1) 上施加了小信号瞬态阶跃响应,并在 Vo 上测量过冲百分比。下图中的过冲表示相位裕度为 59 度,进一步确认了系统的稳定性。
有必要在 PMOS 栅极前放置一个 10kΩ 的上拉电阻 (R1),以上拉 PMOS 栅极并保护 ADC 或微控制器。
另一个故障考虑因素是运算放大器 (LMP7704-sp) 是否会被 100V Vbus 损坏。要对其进行仿真,需要在 Vbus 上施加 100V 的峰峰值方波。请参阅下图中的仿真结果。
Vbus 和 VEE 之间的差值 V_opamp 始终低于 4.933V。LMP7704 专为高达 12V 的电源而设计,因此不会损坏。在仿真中,负载电流设置为 5A。正如预期的那样,Vout 被仿真为大约 2.5V。
要分析电路的输出误差,需要使用以下参数
失调电压误差:
CMRR 误差:
PSRR 误差:
分流电阻器误差:
电阻器(R3 和 R6)误差:
偏置电流误差:
平方根 (RSS) 总误差:
极值分析 (EVA):
在 MATLAB 中执行了之前的误差公式,仿真结果如下图所示。
当负载电流为 1A 时,RSS 为 0.658%。此 RSS 满足 0.7% 的误差要求。右侧还提供了 EVA 图作为参考。
先前的结果是在 R_shunt 设置为 10mΩ 的情况下计算得出的。当负载电流为 1A 时,运算放大器 Vos 决定了误差。当负载电流为 10A 时,分流电阻容差决定了误差。
通过 TINA-TITM 仿真再次验证先前的误差计算,结果如下图所示。
使用以下公式计算百分比误差。
如仿真所示,当负载电流为 1A 时,误差为 0.63%。该误差与之前 MATLAB 计算中 0.6% 的 Vos 误差一致。TINA-TITM 不对由电阻器容差和分流电阻器上温度变化引起的误差进行仿真。
设计参考资料
设计特色运算放大器
LMP7704-SP | |
---|---|
Vss | 2.7 V 至 12 V |
VinCM | 轨到轨 |
Vout | 轨到轨 |
Vos | ±60µV |
Iq | 2.9 mA |
Ib | ±1pA |
UGBW | 2.5MHz |
SR | 1V/µs |
通道数 | 4 |
总电离剂量 (TID) | 100krad (Si) |
单粒子锁定(SEL) 抗扰度 | 85MeV·cm2/mg |
LMP7704-SP |
设计备选运算放大器
LM124AQML-SP | |
---|---|
Vss | 3 V 至 32 V |
Vos | 2mV |
Ib | 45nA |
UGBW | 1MHz |
SR | 0.1 V/µs |
通道数 | 4 |
总电离剂量 (TID) | 100krad (Si) |
SEL 抗扰度 | SEL 抗扰度(双极工艺) |
LM124AQML-SP |
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