ZHCSUA4 December   2023 TAD5212

ADVANCE INFORMATION  

  1.   1
  2. 1 特性
  3. 2 应用
  4. 3 说明
  5. 4 修订历史记录
  6. 5 引脚配置和功能
  7. 6 规格
    1. 6.1  绝对最大额定值
    2. 6.2  ESD 等级
    3. 6.3  建议运行条件
    4. 6.4  热性能信息
    5. 6.5  电气特性
    6. 6.6  时序要求：I2C 接口
    7. 6.7  开关特性：I2C 接口
    8. 6.8  时序要求：SPI 接口
    9. 6.9  开关特性：SPI 接口
    10. 6.10 时序要求：TDM、I2S 或 LJ 接口
    11. 6.11 开关特性：TDM、I2S 或 LJ 接口
  8. 7 详细说明
    1. 7.1 概述
    2. 7.2 功能方框图
    3. 7.3 特性说明
      1. 7.3.1 串行接口
        1. 7.3.1.1 控制串行接口
        2. 7.3.1.2 音频串行接口
          1. 7.3.1.2.1 时分多路复用 (TDM) 音频接口
          2. 7.3.1.2.2 IC 间音频 (I2S) 接口
          3. 7.3.1.2.3 左对齐 (LJ) 接口
        3. 7.3.1.3 通过共享总线使用多个器件
        4. 7.3.1.4 锁相环 (PLL) 和时钟生成
        5. 7.3.1.5 输出通道配置
        6. 7.3.1.6 基准电压
        7. 7.3.1.7 可编程麦克风偏置
        8. 7.3.1.8 信号链处理
          1. 7.3.1.8.1 DAC 信号链
            1. 7.3.1.8.1.1 可编程通道增益和数字音量控制
            2. 7.3.1.8.1.2 可编程通道增益校准
            3. 7.3.1.8.1.3 可编程数字高通滤波器
            4. 7.3.1.8.1.4 可编程数字双二阶滤波器
            5. 7.3.1.8.1.5 可编程数字混频器
            6. 7.3.1.8.1.6 可配置数字内插滤波器
              1. 7.3.1.8.1.6.1 线性相位滤波器
                1. 7.3.1.8.1.6.1.1 采样速率：16kHz 或 14.7kHz
                2. 7.3.1.8.1.6.1.2 采样速率：24kHz 或 22.05kHz
                3. 7.3.1.8.1.6.1.3 采样速率：32kHz 或 29.4kHz
                4. 7.3.1.8.1.6.1.4 采样速率：48kHz 或 44.1kHz
                5. 7.3.1.8.1.6.1.5 采样速率：96kHz 或 88.2kHz
                6. 7.3.1.8.1.6.1.6 采样速率：384kHz 或 352.8kHz
        9. 7.3.1.9 中断、状态和数字 I/O 引脚多路复用
    4. 7.4 器件功能模式
    5. 7.5 寄存器映射
      1. 7.5.1 TAD5212_P0 寄存器
      2. 7.5.2 TAD5212_P1 寄存器
      3. 7.5.3 TAD5212_P3 寄存器
  9. 8 应用和实施
    1. 8.1 应用信息
    2. 8.2 典型应用
      1. 8.2.1 应用
      2. 8.2.2 设计要求
      3. 8.2.3 详细设计过程
  10. 9 电源相关建议
  11. 10器件和文档支持
    1. 10.1 文档支持
      1. 10.1.1 相关文档
    2. 10.2 接收文档更新通知
    3. 10.3 支持资源
    4. 10.4 商标
    5. 10.5 静电放电警告
    6. 10.6 术语表
  12. 11Mechanical, Packaging, and Orderable Information
    1. 11.1 Tape and Reel Information

封装选项

机械数据 (封装 | 引脚)
散热焊盘机械数据 (封装 | 引脚)
订购信息
7.3.1.8.1 DAC 信号链
图 7-15 展示了回放信号链的关键元件。
GUID-20230614-SS0I-0BCM-HF2B-SC9SHPNJSNZT-low.svg图 7-15 DAC 信号链处理流程图

DAC 信号链为低噪声和高保真音频应用提供高度灵活的低噪声回放路径。这款低噪声和低失真、多位 Δ-Σ DAC 使 TAD5112 能够以极低功耗实现 106dB 动态范围。此外，DAC 架构具有固有的抗混叠滤波功能，能够很好地抑制多个调制器频率分量附近的带外频率噪声。因此，该器件可防止噪声混叠到音频频带中。此外，在信号链中，集成的高性能多级数字内插滤波器会通过高阻带衰减来急剧削减任何带外频率噪声。

信号链还包含各种高度可编程的数字处理块，例如双二阶滤波器、相位校准、增益校准、高通滤波器、数字加法器或混频器、同步采样速率转换器、失真限制器、热折返、欠压预防和音量控制。本节将进一步讨论这些处理块的详细信息。该器件还支持多达四通道单端输出模式以及从模拟输入到 DAC 输出的模拟旁路选项。

可使用 CH_EN (P0_R118) 寄存器启用或禁用回放输出通道，并可使用 PASI_RX_CHx_CFG 或 SASI_RX_CHx_CFG 位启用或禁用音频串行接口的输入通道。该器件支持所有活动通道同时上电和断电，以进行同步回放。但是，根据应用需求，如果某些通道必须在另一个通道回放处于开启状态时动态上电或断电，则可以通过设置 DYN_PUPD_CFG 寄存器来支持该用例。

该器件支持多种数据混合选项，可在 DAC 输出上回放之前，使用每条路径的灵活增益选项将来自主要 ASI 的多达 8 个输入通道、来自辅助 ASI 的 2 个输入通道和音调发生器混合起来。默认情况下，这些混频器处于禁用状态，并且通道配置为仅支持单通道数据。可按照第 17 页中的设置 ASI_DIN_Mixers 配置混频器。

该器件支持高达 100kHz 的输出信号带宽，这允许使用 216kHz（或更高）采样速率来播放高频非音频信号。可以使用 DAC_CHx_BW_Mode 位启用或禁用宽带模式。

对于 48kHz 或更低的采样速率，该器件支持所有功能和各种可编程处理块。不过，对于高于 48kHz 的采样速率，支持的同时通道录音和播放数量和双二阶滤波器数量等都存在限制。有关更多详细信息，请参阅 TAC5212 采样速率和受支持的可编程处理块 应用报告。