ZHCSNV9B May   2023  – March 2024 DAC39RF10 , DAC39RFS10

PRODUCTION DATA  

  1.   1
  2. 1 特性
  3. 2 应用
  4. 3 说明
  5. 4 器件比较
  6. 5 引脚配置和功能
  7. 6 规格
    1. 6.1  绝对最大额定值
    2. 6.2  ESD 等级
    3. 6.3  建议运行条件
    4. 6.4  热性能信息
    5. 6.5  电气特征 - 直流规格
    6. 6.6  电气特性 - 交流规格
    7. 6.7  电气特性 - 功耗
    8. 6.8  时序要求
    9. 6.9  开关特性
    10. 6.10 SPI 和 FRI 时序图
    11. 6.11 典型特性：带宽和直流线性度
    12. 6.12 典型特性：单音光谱
    13. 6.13 典型特性：双音光谱
    14. 6.14 典型特性：噪声频谱密度
    15. 6.15 典型特性：线性度扫描
    16. 6.16 典型特性：调制波形
    17. 6.17 典型特性：相位和振幅噪声
    18. 6.18 典型特性：功率耗散和电源电流
  8. 7 详细说明
    1. 7.1 概述
    2. 7.2 功能方框图
    3. 7.3 特性说明
      1. 7.3.1 DAC 输出模式
        1. 7.3.1.1 NRZ 模式
        2. 7.3.1.2 RTZ 模式
        3. 7.3.1.3 射频模式
        4. 7.3.1.4 DES 模式
      2. 7.3.2 DAC 内核
        1. 7.3.2.1 DAC 输出结构
        2. 7.3.2.2 调整满量程电流
      3. 7.3.3 DEM 和抖动
      4. 7.3.4 偏移量调整
      5. 7.3.5 时钟子系统
        1. 7.3.5.1 SYSREF 频率要求
        2. 7.3.5.2 SYSREF 位置检测器和采样位置选择（SYSREF 窗口）
      6. 7.3.6 数字信号处理块
        1. 7.3.6.1 数字上变频器 (DUC)
          1. 7.3.6.1.1 内插滤波器
          2. 7.3.6.1.2 数控振荡器 (NCO)
            1. 7.3.6.1.2.1 相位连续 NCO 更新模式
            2. 7.3.6.1.2.2 相位同调 NCO 更新模式
            3. 7.3.6.1.2.3 相位同步 NCO 更新模式
            4. 7.3.6.1.2.4 NCO 同步
              1. 7.3.6.1.2.4.1 JESD204C LSB 同步
            5. 7.3.6.1.2.5 NCO 模式编程
          3. 7.3.6.1.3 混频器扩展
        2. 7.3.6.2 通道接合器
        3. 7.3.6.3 DES 内插器
      7. 7.3.7 JESD204C 接口
        1. 7.3.7.1  偏离 JESD204C 标准
        2. 7.3.7.2  传输层
        3. 7.3.7.3  扰频器和解码器
        4. 7.3.7.4  链路层
        5. 7.3.7.5  物理层
        6. 7.3.7.6  串行器/解串器 PLL 控制
        7. 7.3.7.7  串行器/解串器纵横制
        8. 7.3.7.8  多器件同步和确定性延迟
          1. 7.3.7.8.1 对 RBD 进行编程
        9. 7.3.7.9  在子类 0 系统中运行
        10. 7.3.7.10 链路复位
      8. 7.3.8 生成警报
    4. 7.4 器件功能模式
      1. 7.4.1 DUC 和 DDS 模式
      2. 7.4.2 JESD204C 接口模式
        1. 7.4.2.1 JESD204C 接口模式
        2. 7.4.2.2 JESD204C 格式图
          1. 7.4.2.2.1 16 位格式
          2. 7.4.2.2.2 12 位格式
          3. 7.4.2.2.3 8 位格式
      3. 7.4.3 NCO 同步延迟
      4. 7.4.4 数据路径延迟
    5. 7.5 编程
      1. 7.5.1 使用标准 SPI 接口
        1. 7.5.1.1 SCS
        2. 7.5.1.2 SCLK
        3. 7.5.1.3 SDI
        4. 7.5.1.4 SDO
        5. 7.5.1.5 串行接口协议
        6. 7.5.1.6 流模式
      2. 7.5.2 使用快速重新配置接口
      3. 7.5.3 SPI 寄存器映射
  9. 8 应用和实施
    1. 8.1 应用信息
      1. 8.1.1 DUC/旁路模式的启动过程
      2. 8.1.2 DDS 模式的启动过程
      3. 8.1.3 眼图扫描流程
      4. 8.1.4 前标/后标分析流程
      5. 8.1.5 了解双边采样模式
      6. 8.1.6 睡眠和禁用模式
    2. 8.2 典型应用
      1. 8.2.1 S 频带雷达发送器
        1. 8.2.1.1 系统原理图
        2. 8.2.1.2 设计要求
        3. 8.2.1.3 发送器详细设计过程
        4. 8.2.1.4 时钟子系统详细设计过程
          1. 8.2.1.4.1 示例 1：SWAP-C 优化
          2. 8.2.1.4.2 示例 2：通过外部 VCO 改善相位噪声 LMX2820
          3. 8.2.1.4.3 示例 3：分立式模拟 PLL，可实现出色的 DAC 性能
          4. 8.2.1.4.4 10GHz 时钟生成
        5. 8.2.1.5 应用曲线
    3. 8.3 电源相关建议
      1. 8.3.1 上电和断电时序
    4. 8.4 布局
      1. 8.4.1 布局指南和示例
  10. 9 器件和文档支持
    1. 9.1 接收文档更新通知
    2. 9.2 支持资源
    3. 9.3 商标
    4. 9.4 静电放电警告
    5. 9.5 术语表
  11. 10修订历史记录
  12. 11机械、封装和可订购信息

封装选项

机械数据 (封装 | 引脚)
散热焊盘机械数据 (封装 | 引脚)
订购信息

7.5.2 使用快速重新配置接口

FR 接口提供快速的只写访问来配置 NCO 频率和同步。FR 接口与 SPI 接口类似，但每个时钟周期发送 4 位。图 7-60 展示了 FR 时序图。它使用 R/W 位（对于该器件始终为写操作）、事务同步位 (FRS) 和 14 位地址，后跟一定数量的数据字节。地址在每个数据字节后递减（与小端字节序一致）。该接口可按字节寻址，数据在每个字节后提交。FR 接口每时钟占用 4 位（一个半字节）。对于多半字节字段，系统会首先发送数据的半字节最高有效位。当事务同步位 (FRS) 被置位时，NCO_SYNC_SRC 寄存器字段中指定的同步事件发生在 FRCS 的上升沿。在第一个数据字节完成之前结束的事务可能不会触发同步事件。

GUID-2408016C-C406-4CB2-885C-B331F020B0DA-low.gif图 7-60 FR 接口时序图

表 7-43 中列出了 FR 接口寄存器。有两个寄存器可以更改 NCO 频率 - FR_FREQL[3:0] 为 64 位（对于每个 NCO），会更改整个频率字。FR_FREQS[3:0] 为 32 位（对于每个 NCO），仅会更改频率字的高 32 位，从而实现更快的频率变化。

表 7-43 FR 接口寄存器
地址名称说明
0x00FFFR_NCO_AR

FR NCO 累加器复位（默认值：0x0f)

[7:4] 保留

[3:0] FR_NCO_AR 对于每个位 FR_NCO_AR[n]，如果置位，NCOn 的累加器在 NCO_SYNC_SRC 指定的每个同步事件上都会复位。

注意：当 FR_EN=0 时，该寄存器无效。

0x0100-0x011FFR_FREQL[3:0]

NCO 累加器的 FR 64 位频率（FR_FREQL[n]=0x00 时的默认值）

FR_FREQL[0] 的频率设置位于最低地址。

[63:0] FR_FREQL[n] 当 FR_EN=1 时，使用该寄存器代替 FREQ[n]。对该寄存器高 32 位的更改也会更改 FR_FREQS[n]。

注意：直到 NCO_SYNC_SRC 指定的下一个同步事件发生之后，对该寄存器的更改才会生效。

注意：当 FR_EN=0 时，该寄存器无效。

0x0120-0x0127FR_PHASE[3:0]

NCO 累加器的 FR 相位（FR_PHASE[n]=0x0000 时的默认值）

FR_PHASE[0] 的相位设置位于最低地址。

[15:0] FR_PHASE[n] 当 FR_EN=1 时，使用该寄存器代替 PHASE[n]。

注意：直到 NCO_SYNC_SRC 指定的下一个同步事件发生之后，对该寄存器的更改才会生效。

注意：当 FR_EN=0 时，该寄存器无效。

0x0128-0x0137FR_FREQS[3:0]

NCO 累加器的 FR 32 位频率（FR_FREQS[n]=0x00 时的默认值）

FR_FREQS[0] 的频率设置位于最低地址。

[31:0] FR_FREQS[n] 当 FR_EN=1 时，使用该寄存器代替 FREQ[n]。对该寄存器的更改也会更改 FR_FREQL[n] 的高 32 位。该寄存器仅控制频率的高 32 位。频率的低 32 位始终由 FR_FREQL[n] 控制。

注意：直到 NCO_SYNC_SRC 指定的下一个同步事件发生之后，对该寄存器的更改才会生效。

注意：当 FR_EN=0 时，该寄存器无效。