ZHCSLH5K August   1998  – June 2020 CD4049UB , CD4050B

PRODUCTION DATA  

  1. 1 特性
  2. 2 应用
  3. 3 描述
  4. 4 Revision History
  5. 5 Pin Configuration and Functions
  6. 6 Specifications
    1. 6.1 Absolute Maximum Ratings
    2. 6.2 ESD Ratings
    3. 6.3 Recommended Operating Conditions
    4. 6.4 Thermal Information
    5. 6.5 Electrical Characteristics: DC
    6. 6.6 Electrical Characteristics: AC
    7. 6.7 Typical Characteristics
  7. 7 Parameter Measurement Information
    1. 7.1 Test Circuits
  8. 8 Detailed Description
    1. 8.1 Overview
    2. 8.2 Functional Block Diagram
    3. 8.3 Feature Description
    4. 8.4 Device Functional Modes
  9. 9 Application and Implementation
    1. 9.1 Application Information
    2. 9.2 Typical Application
      1. 9.2.1 Design Requirements
      2. 9.2.2 Detailed Design Procedure
      3. 9.2.3 Application Curves
  10. 10Power Supply Recommendations
  11. 11Layout
    1. 11.1 Layout Guidelines
    2. 11.2 Layout Example
  12. 12Device and Documentation Support
    1. 12.1 Documentation Support
      1. 12.1.1 Related Documentation
    2. 12.2 Related Links
    3. 12.3 Receiving Notification of Documentation Updates
    4. 12.4 支持资源
    5. 12.5 Trademarks
    6. 12.6 静电放电警告
    7. 12.7 术语表
  13. 13Mechanical, Packaging, and Orderable Information

封装选项

请参考 PDF 数据表获取器件具体的封装图。

机械数据 (封装 | 引脚)
  • PW|16
  • NS|16
  • N|16
  • DW|16
  • D|16
散热焊盘机械数据 (封装 | 引脚)
订购信息

3 描述

CD4049UB 和 CD4050B 器件为反相和同相六路缓冲器，仅使用一个电源电压 (VCC) 即可实现逻辑电平转换。使用这些器件进行逻辑电平转换时，输入信号高电平 (VIH) 可以超过 VCC 电源电压用于逻辑电平转换。这些器件可用作 CMOS 至 DTL 或 TTL 转换器，并可直接驱动两个 DTL 或 TTL 负载。（VCC = 5V、
VOL ≤ 0.4V 且 IOL ≥ 3.3mA。）

器件信息
器件型号(1) 封装 封装尺寸（标称值）
CD4049UBE、CD4050BE PDIP (16) 6.35mm × 19.30mm
CD4049UBD、CD4050BD SOIC (16) 9.90mm x 3.91mm
CD4049UBDW、CD4050BDW SOIC (16) 10.30mm × 7.50mm
CD4049UBNS、CD4050BNS SO (16) 10.30mm × 5.30mm
CD4049UBPW、CD4050BPW TSSOP (16) 5.00mm × 4.40mm
(1) 如需了解所有可用封装，请参阅数据表末尾的可订购产品附录。
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6 个相同单位中的 1 个
CD4049UB 的原理图
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6 个相同单位中的 1 个
CD4050B 的原理图