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線性與低壓差 (LDO) 穩壓器

TPS74901

現行

具電源良好與啟用功能的 3-A、低 VIN (0.8-V) 可調式超低壓降電壓穩壓器

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最新 TPS7N49 現行 3A、低輸入及輸出電壓、低雜訊、可調整低壓差 (LDO) 電壓穩壓器 3x lower RMS noise with wider output voltage range in a 2x smaller solution size.

TPS74901

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產品詳細資料

Rating Catalog Vin (max) (V) 5.5 Vin (min) (V) 0.8 Iout (max) (A) 3 Output options Adjustable Output Vout (max) (V) 3.6 Vout (min) (V) 0.8 Noise (µVrms) 20 PSRR at 100 KHz (dB) 28 Iq (typ) (mA) 3 Features Enable, Power good, Soft start Thermal resistance θJA (°C/W) 34, 36 Load capacitance (min) (µF) 2.2 Regulated outputs (#) 1 Accuracy (%) 2 Dropout voltage (Vdo) (typ) (mV) 60, 120 Operating temperature range (°C) -40 to 125
Rating Catalog Vin (max) (V) 5.5 Vin (min) (V) 0.8 Iout (max) (A) 3 Output options Adjustable Output Vout (max) (V) 3.6 Vout (min) (V) 0.8 Noise (µVrms) 20 PSRR at 100 KHz (dB) 28 Iq (typ) (mA) 3 Features Enable, Power good, Soft start Thermal resistance θJA (°C/W) 34, 36 Load capacitance (min) (µF) 2.2 Regulated outputs (#) 1 Accuracy (%) 2 Dropout voltage (Vdo) (typ) (mV) 60, 120 Operating temperature range (°C) -40 to 125
TO-263 (KTW) 7 153.924 mm² 10.1 x 15.24 VQFN (RGW) 20 25 mm² 5 x 5 VSON (DRC) 10 9 mm² 3 x 3
  • VOUT range: 0.8V to 3.6V
  • Ultra-low VIN range: 0.8V to 5.5V
  • VBIAS range: 2.7V to 5.5V
  • Low dropout: 120mV (typical) at 3A
  • Power-good (PG) output allows supply monitoring or provides a sequencing signal for other supplies
  • Accuracy over line, load, and temperature: 1% (new chip)
  • Accuracy over line, load, and temperature: 2% (legacy chip)
  • Adjustable start-up in-rush control
  • VBIAS permits low VIN operation with good transient response
  • Stable with any output capacitor ≥ 2.2µF
  • Packages:
    • Small, 3mm × 3mm × 1mm VSON
    • 5mm × 5mm × 1mm VQFN and DDPAK-7
  • Active high enable
  • VOUT range: 0.8V to 3.6V
  • Ultra-low VIN range: 0.8V to 5.5V
  • VBIAS range: 2.7V to 5.5V
  • Low dropout: 120mV (typical) at 3A
  • Power-good (PG) output allows supply monitoring or provides a sequencing signal for other supplies
  • Accuracy over line, load, and temperature: 1% (new chip)
  • Accuracy over line, load, and temperature: 2% (legacy chip)
  • Adjustable start-up in-rush control
  • VBIAS permits low VIN operation with good transient response
  • Stable with any output capacitor ≥ 2.2µF
  • Packages:
    • Small, 3mm × 3mm × 1mm VSON
    • 5mm × 5mm × 1mm VQFN and DDPAK-7
  • Active high enable

The TPS74901 low-dropout (LDO) linear regulator provides an easy-to-use, robust power management solution for a wide variety of applications. User-programmable soft-start minimizes stress on the input power source by reducing capacitive inrush current during start-up. The soft-start is monotonic and designed for powering many different types of processors and application-specific integrated circuits (ASICs). The enable input and power-good output allow easy sequencing with external regulators. This complete flexibility allows a solution to be configured that meets the sequencing requirements of field-programmable gate arrays (FPGAs), digital signal processors (DSPs), and other applications with special start-up requirements.

A precision reference and error amplifier deliver 2% accuracy over load, line, temperature, and process. The device is stable with any type of capacitor ≥ 2.2µF, and the device is fully specified from –40°C to +125°C. The TPS74901 is offered in a small (3mm × 3mm) VSON package and a small (5mm × 5mm) VQFN package, yielding a highly compact total solution size. The device is also available in a DDPAK-7 package.

The TPS74901 low-dropout (LDO) linear regulator provides an easy-to-use, robust power management solution for a wide variety of applications. User-programmable soft-start minimizes stress on the input power source by reducing capacitive inrush current during start-up. The soft-start is monotonic and designed for powering many different types of processors and application-specific integrated circuits (ASICs). The enable input and power-good output allow easy sequencing with external regulators. This complete flexibility allows a solution to be configured that meets the sequencing requirements of field-programmable gate arrays (FPGAs), digital signal processors (DSPs), and other applications with special start-up requirements.

A precision reference and error amplifier deliver 2% accuracy over load, line, temperature, and process. The device is stable with any type of capacitor ≥ 2.2µF, and the device is fully specified from –40°C to +125°C. The TPS74901 is offered in a small (3mm × 3mm) VSON package and a small (5mm × 5mm) VQFN package, yielding a highly compact total solution size. The device is also available in a DDPAK-7 package.
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技術文件

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重要文件 類型 標題 格式選項 日期
* Data sheet TPS74901 3A, Low Dropout Linear Regulator With Programmable Soft-Start datasheet (Rev. K) PDF | HTML 2024年 6月 21日
Application note LDO Noise Demystified (Rev. B) PDF | HTML 2020年 8月 18日
Application note A Topical Index of TI LDO Application Notes (Rev. F) 2019年 6月 27日
Selection guide Low Dropout Regulators Quick Reference Guide (Rev. P) 2018年 3月 21日
Application note LDO PSRR Measurement Simplified (Rev. A) PDF | HTML 2017年 8月 9日
Analog Design Journal Q2 2009 Issue Analog Applications Journal 2009年 5月 1日
Analog Design Journal Taming linear-regulator inrush currents 2009年 5月 1日

設計與開發

如需其他條款或必要資源，請按一下下方的任何標題以檢視詳細頁面 (如有)。

開發板

TPS74901EVM-210 — 適用 3-A 低 VIN (0.8-V) 可調式超低壓降電壓穩壓器的 TPS74901 評估模組

TPS74901EVM-210 可幫助 TPS74901 低壓降線性穩壓器 IC 評估。

這些穩壓器需要低功耗偏壓 VBIAS 和電源輸入電壓 VIN。穩壓器可提供最低 0.8 V 的輸出電、輸出最高 3 A 電流，並擁有整合式監控電路及開汲極輸出，可在輸出電壓達到穩壓 (電源良好或 PG) 時進入高阻抗狀態。

使用指南: PDF
TI.com 無法提供
模擬型號

TPS74901 PSpice Transient Model (Rev. B)

SLIM031B.ZIP (60 KB) - PSpice Model
下載
模擬型號

TPS74901 TINA-TI Transient Reference Design

SLIM257.TSC (94 KB) - TINA-TI Spice Model
下載
模擬型號

TPS74901 TINA-TI Transient Spice Model

SLIM256.ZIP (35 KB) - TINA-TI Spice Model
下載
模擬型號

TPS74901 Unencrypted PSpice Transient Model

SBVM634.ZIP (3 KB) - PSpice Model
下載
參考設計

TIDA-00431 — 採用 8 GHz DC 耦合差動放大器的射頻取樣 4 GSPS ADC 參考設計

寬頻射頻 (RF) 接收器可大幅提高無線電設計的靈活性。寬廣的瞬時頻寬允許在不更換硬體的情況下進行靈活調諧，並能夠擷取頻率相差很大的多個通道。

此參考設計說明了一種寬頻 RF 接收器，它採用 4GSPS 類比數位轉換器 (ADC)，並具有 8GHz DC 耦合全差動放大器前端。放大器前端提供訊號增益，並允許擷取低至 DC 的訊號。這是使用平衡不平衡轉換器耦合輸入時無法實現的。

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電路圖: PDF
參考設計

TIDA-01017 — 適用於示波器、無線測試器和雷達的高速多通道 ADC 時鐘參考設計

TIDA-01017 參考設計展示高速多通道系統時脈解決方案的性能，並透過測量射頻取樣 ADC 整個輸入頻率範圍的通道間偏斜進行分析。通道間偏斜對於相位陣列雷達和示波器應用而言至關重要。ADC12J4000 是一款具緩衝類比輸入的低功率 12 位元 4 GSPS 射頻取樣類比轉數位轉換器 (ADC)，整合式數位降壓轉換器，具備 JESD204B 介面，可擷取高達 4GHz 的訊號。此設計展示了使用 LMK04828 的時脈解決方案，以使用經過同步的 SYSREF 在多個 ADC12J4000 訊號鏈之間實現同步。
Design guide: PDF
電路圖: PDF
參考設計

TIDA-01015 — 適用於數位示波器和無線測試器中的 12 位元高速 ADC 的 4 GHz 時鐘參考設計

TIDA-01015 是一款針對高速直接射頻取樣 GSPS ADC 的時鐘解決方案參考設計。此設計展現了取樣時鐘對於實現第二奈奎斯特區輸入訊號頻率之高 SNR 的重要性。ADC12J4000 是一款 12 位元、4GSPS 的射頻取樣 ADC，具有 3.2GHz 的 3dB 輸入頻寬，可擷取高達 4GHz 的訊號。此設計重點展示採用 TRF3765 的時鐘解決方案，用於 ADC12J4000，可在高輸入頻率下實現優異的 SNR 性能，適用於數位儲存示波器 (DSO) 和無線測試儀等應用。
Design guide: PDF
電路圖: PDF
參考設計

TIDA-00826 — 50 Ohm 2 GHz 示波器前端參考設計

此參考設計為 50Ω 輸入示波器應用類比前端的一部分。系統設計師可以輕鬆使用此評估平台，在頻域和時域應用中處理從 DC 至 2GHz 的輸入訊號。
Design guide: PDF
電路圖: PDF
參考設計

TIDA-00432 — 使用適用於相位陣列雷達系統的 Xilinx 平台，將 JESD204B Giga-Sample ADC 同步化

此系統級設計展示如何使用 Xilinx VC707 平台將兩個 ADC12J4000 評估模組 (EVM) 同步在一起。設計文檔描述了所需的硬體修改和設備配置，包括時脈方案。每個 EVM 都提供了範例設定檔案。本文描述了 FPGA 韌體，並展示了相關的 Xilinx IP 模組配置參數。對實際硬體上採集的數據進行展示和分析，結果表明，在沒有對電纜進行特徵分析或校準傳播延遲的情況下，同步時間在 50ps 以內。
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參考設計

TIDA-00359 — 適用於 GSPS ADC 的時鐘解決方案參考設計

適用於 GSPS 資料轉換器的低成本、高性能時脈解決方案。此參考設計探討 TRF3765 的使用，這是一款低雜訊頻率合成器，可為 4GSPS 類比轉數位轉換器 (ADC12J4000) 產生取樣時脈。實驗展示了產品規格表可比較的 SNR 和 SFDR 性能。
Design guide: PDF
電路圖: PDF
封裝 針腳 CAD 符號、佔位空間與 3D 模型
TO-263 (KTW) 7 Ultra Librarian
VQFN (RGW) 20 Ultra Librarian
VSON (DRC) 10 Ultra Librarian
適用 TI 的評估品項標準條款與條件。

訂購與品質

內含資訊：
  • RoHS
  • REACH
  • 產品標記
  • 鉛塗層/球物料
  • MSL 等級/回焊峰值
  • MTBF/FIT 估算值
  • 材料內容
  • 認證摘要
  • 進行中的可靠性監測
內含資訊：
  • 晶圓廠位置
  • 組裝地點

建議產品可能具有與此 TI 產品相關的參數、評估模組或參考設計。

支援與培訓

內含 TI 工程師技術支援的 TI E2E™ 論壇

以英文檢視所有論壇主題

內容係由 TI 和社群貢獻者依「現狀」提供，且不構成 TI 規範。檢視使用條款。

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