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SN74HC266

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具有开漏输出的 4 通道、双输入、2V 至 6V、5.2mA 驱动强度 XNOR（异或非）门

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SN74HC266

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产品详情

Technology family HC Number of channels 4 Inputs per channel 2 IOL (max) (mA) 5.2 Input type Standard CMOS IOH (max) (mA) 0 Output type Open-drain Features High speed (tpd 10- 50ns) Data rate (max) (Mbps) 28 Rating Catalog Operating temperature range (°C) -40 to 85
Technology family HC Number of channels 4 Inputs per channel 2 IOL (max) (mA) 5.2 Input type Standard CMOS IOH (max) (mA) 0 Output type Open-drain Features High speed (tpd 10- 50ns) Data rate (max) (Mbps) 28 Rating Catalog Operating temperature range (°C) -40 to 85
SOIC (D) 14 51.9 mm² (8.65 mm × 6 mm) PDIP (N) 14 181.42 mm² (19.3 mm × 9.4 mm) SOP (NS) 14 79.56 mm² (10.2 mm × 7.8 mm)
  • 宽工作电压范围：2V 至 6V
  • 输出可驱动多达 10 个低功耗肖特基晶体管逻辑电路 (LSTTL) 负载
  • 低功耗，ICC 最大值为 20µA
  • 5V 时，典型 tpd = 8ns
  • ±4 mA 输出驱动 （在 5V 时）
  • 低输入电流，1µA
  • 宽工作电压范围：2V 至 6V
  • 输出可驱动多达 10 个低功耗肖特基晶体管逻辑电路 (LSTTL) 负载
  • 低功耗，ICC 最大值为 20µA
  • 5V 时，典型 tpd = 8ns
  • ±4 mA 输出驱动 （在 5V 时）
  • 低输入电流，1µA

该器件包含四个具有漏极开路输出的独立 2 输入异或非门。每个逻辑门以正逻辑执行布尔函数 Y = A ⊕ B。

该器件包含四个具有漏极开路输出的独立 2 输入异或非门。每个逻辑门以正逻辑执行布尔函数 Y = A ⊕ B。
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顶层文档 类型 标题 格式选项 下载最新的英语版本 日期
* 数据表 使用漏极开路输出的 SN74HC266 四路 2 输入 XNOR 门 数据表 (Rev. G) PDF | HTML 英语版 (Rev.G) 2023-2-10

设计与开发

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评估板

14-24-LOGIC-EVM — 采用 14 引脚至 24 引脚 D、DB、DGV、DW、DYY、NS 和 PW 封装的逻辑产品通用评估模块

14-24-LOGIC-EVM 评估模块 (EVM) 设计用于支持采用 14 引脚至 24 引脚 D、DW、DB、NS、PW、DYY 或 DGV 封装的任何逻辑器件。

用户指南: PDF | HTML
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??asset.out-of-stock-ti_zh_CN??
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仿真模型

SN74HC266 Behavioral SPICE Model

SCLM218.ZIP (6 KB) - PSpice 模型
支持的产品和硬件
封装 引脚 CAD 符号、封装和 3D 模型
SOIC (D) 14 Ultra Librarian
PDIP (N) 14 Ultra Librarian
SOP (NS) 14 Ultra Librarian
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