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Number of channels 8 IOL (max) (mA) 7.8 IOH (max) (mA) -7.8 Input type CMOS Output type CMOS Features Balanced outputs, High speed (tpd 10-50ns), Positive input clamp diode Technology family HC Rating Catalog Operating temperature range (°C) -40 to 85
Number of channels 8 IOL (max) (mA) 7.8 IOH (max) (mA) -7.8 Input type CMOS Output type CMOS Features Balanced outputs, High speed (tpd 10-50ns), Positive input clamp diode Technology family HC Rating Catalog Operating temperature range (°C) -40 to 85
TSSOP (PW) 20 41.6 mm² (6.5 mm × 6.4 mm) SSOP (DB) 20 56.16 mm² (7.2 mm × 7.8 mm) SOIC (DW) 20 131.84 mm² (12.8 mm × 10.3 mm) PDIP (N) 20 228.702 mm² (24.33 mm × 9.4 mm) SOP (NS) 20 98.28 mm² (12.6 mm × 7.8 mm)
  • 2V 至 6V 的宽工作电压范围
  • 高电流三态输出直接驱动总线或多达 15 个 LSTTL 负载
  • 低功耗,最大 ICC 为 80µA
  • tpd典型值 = 12 ns
  • ±6mA 输出驱动(电压为 5V 时)
  • 低输入电流最大值为 1µA
  • 对于符合 MIL-PRF-38535 标准的产品, 所有参数均经过测试,除非另外注明。对于所有其他产品,生产流程不一定包含对所有参数进行的测试。
  • 2V 至 6V 的宽工作电压范围
  • 高电流三态输出直接驱动总线或多达 15 个 LSTTL 负载
  • 低功耗,最大 ICC 为 80µA
  • tpd典型值 = 12 ns
  • ±6mA 输出驱动(电压为 5V 时)
  • 低输入电流最大值为 1µA
  • 对于符合 MIL-PRF-38535 标准的产品, 所有参数均经过测试,除非另外注明。对于所有其他产品,生产流程不一定包含对所有参数进行的测试。

这些八路总线收发器专为数据总线之间的异步双向通信而设计。控制功能实现可更大限度地减少外部时序要求。

根据方向控制 (DIR) 输入上的逻辑电平,此类器件将数据从 A 总线发送至 B 总线,或者将数据从 B 总线发送至 A 总线。输出使能 (OE) 输入可用于禁用器件,这样可有效隔离总线。

这些八路总线收发器专为数据总线之间的异步双向通信而设计。控制功能实现可更大限度地减少外部时序要求。

根据方向控制 (DIR) 输入上的逻辑电平,此类器件将数据从 A 总线发送至 B 总线,或者将数据从 B 总线发送至 A 总线。输出使能 (OE) 输入可用于禁用器件,这样可有效隔离总线。

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设计与开发

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评估板

14-24-LOGIC-EVM — 采用 14 引脚至 24 引脚 D、DB、DGV、DW、DYY、NS 和 PW 封装的逻辑产品通用评估模块

14-24-LOGIC-EVM 评估模块 (EVM) 设计用于支持采用 14 引脚至 24 引脚 D、DW、DB、NS、PW、DYY 或 DGV 封装的任何逻辑器件。

用户指南: PDF | HTML
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??asset.out-of-stock-ti_zh_CN??
无货
封装 引脚 CAD 符号、封装和 3D 模型
TSSOP (PW) 20 Ultra Librarian
SSOP (DB) 20 Ultra Librarian
SOIC (DW) 20 Ultra Librarian
PDIP (N) 20 Ultra Librarian
SOP (NS) 20 Ultra Librarian

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