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JK 触发器

SN74HC109

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具有清零和预设功能的双通道 J-K 正边沿触发器

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SN74HC109

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产品详情

Number of channels 2 Technology family HC Input type LVTTL/CMOS Output type Push-Pull Clock frequency (MHz) 24 Supply current (max) (µA) 40 IOL (max) (mA) 4 IOH (max) (mA) -4 Features Balanced outputs, Clear, High speed (tpd 10-50ns), Positive edge triggered, Positive input clamp diode, Preset Operating temperature range (°C) -40 to 85 Rating Catalog
Number of channels 2 Technology family HC Input type LVTTL/CMOS Output type Push-Pull Clock frequency (MHz) 24 Supply current (max) (µA) 40 IOL (max) (mA) 4 IOH (max) (mA) -4 Features Balanced outputs, Clear, High speed (tpd 10-50ns), Positive edge triggered, Positive input clamp diode, Preset Operating temperature range (°C) -40 to 85 Rating Catalog
SOIC (D) 16 59.4 mm² (9.9 mm × 6 mm) PDIP (N) 16 181.42 mm² (19.3 mm × 9.4 mm) SOP (NS) 16 79.56 mm² (10.2 mm × 7.8 mm)
  • 2V 至 6V 的宽工作电压范围
  • 低输出电流，最大值 1µA
  • 高电流输出可驱动多达 10 个 LSTTL 负载
  • 低功耗，ICC 最大值为 40µA
  • tpd典型值 = 12ns
  • ±4mA 输出驱动（在 5 V 时）
  • 2V 至 6V 的宽工作电压范围
  • 低输出电流，最大值 1µA
  • 高电流输出可驱动多达 10 个 LSTTL 负载
  • 低功耗，ICC 最大值为 40µA
  • tpd典型值 = 12ns
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* 数据表 具有清零和预设功能的 SNx4HC109 双路 J-K 正边沿触发式触发器 数据表 (Rev. C) PDF | HTML 英语版 (Rev.C) PDF | HTML 2022-6-30
应用手册 Power-Up Behavior of Clocked Devices (Rev. B) PDF | HTML 2022-12-15

设计与开发

如需其他信息或资源，请点击以下任一标题进入详情页面查看（如有）。

评估板

14-24-LOGIC-EVM — 采用 14 引脚至 24 引脚 D、DB、DGV、DW、DYY、NS 和 PW 封装的逻辑产品通用评估模块

14-24-LOGIC-EVM 评估模块 (EVM) 设计用于支持采用 14 引脚至 24 引脚 D、DW、DB、NS、PW、DYY 或 DGV 封装的任何逻辑器件。

用户指南: PDF | HTML
支持的产品和硬件
有库存
限制：
??asset.out-of-stock-ti_zh_CN??
无货
封装 引脚 CAD 符号、封装和 3D 模型
SOIC (D) 16 Ultra Librarian
PDIP (N) 16 Ultra Librarian
SOP (NS) 16 Ultra Librarian
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