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SN74ALVC125

正在供货

具有三态输出的 4 通道、1.65V 至 3.6V 缓冲器

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数据表

SN74ALVC125

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产品详情

Technology family ALVC Number of channels 4 IOL (max) (mA) 24 Supply current (max) (µA) 10 IOH (max) (mA) -24 Input type Standard CMOS Output type 3-State Features Balanced outputs, Over-voltage tolerant inputs, Very high speed (tpd 5-10ns) Rating Catalog Operating temperature range (°C) -40 to 85
Technology family ALVC Number of channels 4 IOL (max) (mA) 24 Supply current (max) (µA) 10 IOH (max) (mA) -24 Input type Standard CMOS Output type 3-State Features Balanced outputs, Over-voltage tolerant inputs, Very high speed (tpd 5-10ns) Rating Catalog Operating temperature range (°C) -40 to 85
TSSOP (PW) 14 32 mm² (5 mm × 6.4 mm) SOIC (D) 14 51.9 mm² (8.65 mm × 6 mm) TVSOP (DGV) 14 23.04 mm² (3.6 mm × 6.4 mm) SOP (NS) 14 79.56 mm² (10.2 mm × 7.8 mm)
  • Operates From 1.65 V to 3.6 V
  • Max tpd of 2.8 ns at 3.3 V
  • ±24-mA Output Drive at 3.3 V
  • Latch-Up Performance Exceeds 250 mA Per JESD 17
  • ESD Protection Exceeds JESD 22
    • 2000-V Human-Body Model (A114-A)
    • 200-V Machine Model (A115-A)
    • 1000-V Charged-Device Model (C101)
  • Operates From 1.65 V to 3.6 V
  • Max tpd of 2.8 ns at 3.3 V
  • ±24-mA Output Drive at 3.3 V
  • Latch-Up Performance Exceeds 250 mA Per JESD 17
  • ESD Protection Exceeds JESD 22
    • 2000-V Human-Body Model (A114-A)
    • 200-V Machine Model (A115-A)
    • 1000-V Charged-Device Model (C101)

This quadruple bus buffer gate is designed for 1.65-V to 3.6-V VCC operation.

The SN74ALVC125 features independent line drivers with 3-state outputs. Each output is disabled when the associated output-enable (OE)\ input is high.

To ensure the high-impedance state during power up or power down, OE\ should be tied to VCC through a pullup resistor; the minimum value of the resistor is determined by the current-sinking capability of the driver.

This quadruple bus buffer gate is designed for 1.65-V to 3.6-V VCC operation.

The SN74ALVC125 features independent line drivers with 3-state outputs. Each output is disabled when the associated output-enable (OE)\ input is high.

To ensure the high-impedance state during power up or power down, OE\ should be tied to VCC through a pullup resistor; the minimum value of the resistor is determined by the current-sinking capability of the driver.
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* 数据表 SN74ALVC125 数据表 (Rev. H) 2004-9-17

设计与开发

如需其他信息或资源，请点击以下任一标题进入详情页面查看（如有）。

评估板

14-24-LOGIC-EVM — 采用 14 引脚至 24 引脚 D、DB、DGV、DW、DYY、NS 和 PW 封装的逻辑产品通用评估模块

14-24-LOGIC-EVM 评估模块 (EVM) 设计用于支持采用 14 引脚至 24 引脚 D、DW、DB、NS、PW、DYY 或 DGV 封装的任何逻辑器件。

用户指南: PDF | HTML
支持的产品和硬件
有库存
限制：
??asset.out-of-stock-ti_zh_CN??
无货
仿真模型

HSPICE MODEL OF SN74ALVC125

SCEJ216.ZIP (97 KB) - HSpice 模型
支持的产品和硬件
仿真模型

SN74ALVC125 Behavioral SPICE Model

SCEM765.ZIP (7 KB) - PSpice 模型
支持的产品和硬件
仿真模型

SN74ALVC125 IBIS Model

SCEM243.ZIP (45 KB) - IBIS 模型
支持的产品和硬件
参考设计

TIDA-00195 — 适用于三相逆变器系统参考设计的隔离式 IGBT 栅极驱动器评估平台

TIDA-00195 参考设计包含 22kW 功率级以及 TI 全新增强型隔离式 IGBT 栅极驱动器 ISO5852S，该设计用于各种应用中的电机控制。此设计允许对 ISO5852S 在三相逆变器中的性能进行评估，该逆变器包含额定电流为 50A-200A 的1200V IGBT 模块。

评估的一些重要功能和性能包括使用 DESAT 检测的短路保护、软关断、不同逆变器 dv/dt 下有源米勒钳位的有效性，以及 IGBT 栅极驱动器在系统级的 ESD/EFT 性能（源自可调速度电气电源驱动系统 (IEC61800-3)）。Piccolo launch pad LAUNCHXL-F28027 (...)

支持的产品和硬件
参考设计

TIDEP0036 — 使用 TMS320C6657 实现高效 OPUS 编解码器解决方案的参考设计

TIDEP0036 参考设计提供了一个在 TMS320C6657 器件上轻松运行 TI 优化型 Opus 编码器/解码器的示例。由于 Opus 支持多种比特率、帧大小和采样率，所有这些都具有较低的延迟，因此它适用于语音通信、联网音频甚至高性能音频处理应用。   此设计还重点介绍了在 DSP 上实施 Opus 编解码器时与在 ARM 等通用处理器上实施 Opus 编解码器时所实现的性能改进。  根据常规用途处理器上运行的代码的优化级别，在 C66x TI DSP 内核上实现 Opus 编解码器的性能可以是 ARM CORTEX A-15 实现方案的 3 倍。TMS320C66x DSP (...)

支持的产品和硬件
封装 引脚 CAD 符号、封装和 3D 模型
TSSOP (PW) 14 Ultra Librarian
SOIC (D) 14 Ultra Librarian
TVSOP (DGV) 14 Ultra Librarian
SOP (NS) 14 Ultra Librarian
适用于评估类项目的 TI 标准条款与条件。

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