CD74HC541
- HC540、CD74HCT540：反相
- ’HC541、’HCT541：同相
- 缓冲输入
- 三态输出
- 总线驱动能力
- VCC = 5V、 CL = 15pF 且 TA = 25℃ 时的传播延迟典型值为 9ns
- 扇出（在温度范围内）
- 标准输出：10 个 LSTTL 负载
- 总线驱动器输出：15 个 LSTTL 负载
- 宽工作温度范围：–55℃ 至 125℃
- 平衡的传播延迟及转换时间
- 与 LSTTL 逻辑 IC 相比，功耗显著降低
- HC 类型
- 工作电压为 2V 至 6V
- 高抗噪性：当 VCC = 5V 时，NIL = 30%，NIH = VCC 的 30%
- HCT 类型
- 工作电压为 4.5V 至 5.5V
- 直接 LSTTL 输入逻辑兼容性， VIL = 0.8V（最大值），VIH = 2V（最小值）
- CMOS 输入兼容性，当电压为 VOL、VOH时，II ≤ 1µA
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| 顶层文档 | 类型 | 标题 | 格式选项 | 下载最新的英语版本 | 日期 | |
|---|---|---|---|---|---|---|
| * | 数据表 | CDx4HC(T)541 具有三态输出的高速 CMOS 逻辑八路缓冲器和线路驱动器 数据表 (Rev. E) | PDF | HTML | 英语版 (Rev.E) | PDF | HTML | 2022-10-20 |
设计与开发
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评估板
14-24-LOGIC-EVM — 采用 14 引脚至 24 引脚 D、DB、DGV、DW、DYY、NS 和 PW 封装的逻辑产品通用评估模块
14-24-LOGIC-EVM 评估模块 (EVM) 设计用于支持采用 14 引脚至 24 引脚 D、DW、DB、NS、PW、DYY 或 DGV 封装的任何逻辑器件。
| 封装 | 引脚 | CAD 符号、封装和 3D 模型 |
|---|---|---|
| SOIC (DW) | 20 | Ultra Librarian |
| TSSOP (PW) | 20 | Ultra Librarian |
| PDIP (N) | 20 | Ultra Librarian |