CD74HC238
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|---|---|---|---|---|---|---|
| * | 数据表 | CDx4HC138、CDx4HCT138、CDx4HC238、CDx4HCT238 高速 CMOS 逻辑 3 线至 8 线解码器/多路解复用器（反向和同向） 数据表 (Rev. J) | PDF | HTML | 英语版 (Rev.J) | PDF | HTML | 2022-1-24 |
设计与开发
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评估板
14-24-LOGIC-EVM — 采用 14 引脚至 24 引脚 D、DB、DGV、DW、DYY、NS 和 PW 封装的逻辑产品通用评估模块
14-24-LOGIC-EVM 评估模块 (EVM) 设计用于支持采用 14 引脚至 24 引脚 D、DW、DB、NS、PW、DYY 或 DGV 封装的任何逻辑器件。
参考设计
TIDA-060014 — PLC 的 96 通道双向数字输入模块参考设计
此参考设计利用 ISO1212（一款隔离式数字输入接收器）实现了一款紧凑的 96 通道隔离数字输入模块。该设计展示了 ISO1212 器件的电流限制功能，其热性能优于传统的光耦合器解决方案。此设计让具有多个通道的数字输入电路板更加紧凑，并可降低电路板温度（低于 50°C）。具有 ISO1212 器件的多路复用器和解码器可将微控制器的引脚数量由 96 个减少至 8 个。该设计经过测试，每个通道可支持 100kHz 输入信号 (200kbit)。该设计的输入功率低于 7.3W，因而热耗散更少。所有信号均可承受符合 IEC6100-4 的 ESD、EFT 和浪涌事件。
| 封装 | 引脚 | CAD 符号、封装和 3D 模型 |
|---|---|---|
| SOIC (D) | 16 | Ultra Librarian |
| PDIP (N) | 16 | Ultra Librarian |
| TSSOP (PW) | 16 | Ultra Librarian |
| SOP (NS) | 16 | Ultra Librarian |