CD74AC109

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具有设置和复位端的双路正边沿触发式 J-K 触发器

产品详情

Number of channels 2 Technology family AC Input type LVTTL/CMOS Output type Push-Pull Clock frequency (MHz) 100 Supply current (max) (µA) 80 IOL (max) (mA) 24 IOH (max) (mA) -24 Features Balanced outputs, Clear, High speed (tpd 10-50ns), Positive edge triggered, Positive input clamp diode, Preset Operating temperature range (°C) -55 to 125 Rating Catalog
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SOIC (D) 16 59.4 mm² (9.9 mm × 6 mm) PDIP (N) 16 181.42 mm² (19.3 mm × 9.4 mm)
  • 交流类型的工作电压范围为 1.5V 至 5.5V,并在电源电压的 30% 时具有平衡的抗噪性能
  • 双极 F、AS 和 S 的速度,同时功耗显著降低
  • 平衡传播延迟
  • ±24mA 输出驱动电流
    • 扇出至 15 个 F 器件
  • 防 SCR 闩锁 CMOS 工艺和电路设计
  • ESD 保护超过 2kV(根据 MIL-STD-883 方法 3015)
  • 交流类型的工作电压范围为 1.5V 至 5.5V,并在电源电压的 30% 时具有平衡的抗噪性能
  • 双极 F、AS 和 S 的速度,同时功耗显著降低
  • 平衡传播延迟
  • ±24mA 输出驱动电流
    • 扇出至 15 个 F 器件
  • 防 SCR 闩锁 CMOS 工艺和电路设计
  • ESD 保护超过 2kV(根据 MIL-STD-883 方法 3015)

CD74AC109-Q1 器件包含两个独立的 J-K 正边沿触发式触发器。预设 (PRE) 或清零 (CLR) 输入端的低电平会设置或复位输出,不受其他输入端的电平的影响。当 PRE 和 CLR 处于非有效状态(高电平)时,满足设置时间要求的 J 和 K 输入端数据将在时钟 (CLK) 脉冲的正向边沿传输到输出端。此器件符合汽车类应用的要求。

CD74AC109-Q1 器件包含两个独立的 J-K 正边沿触发式触发器。预设 (PRE) 或清零 (CLR) 输入端的低电平会设置或复位输出,不受其他输入端的电平的影响。当 PRE 和 CLR 处于非有效状态(高电平)时,满足设置时间要求的 J 和 K 输入端数据将在时钟 (CLK) 脉冲的正向边沿传输到输出端。此器件符合汽车类应用的要求。

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* 数据表 具有清零和预设功能的 CDx4AC109 双路 J- K 正边沿触发式触发器 数据表 (Rev. A) PDF | HTML 英语版 (Rev.A) PDF | HTML 2024-12-31

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