Operating range from 1.1V to 5.5V
5.5V tolerant input pins
Supports standard pinouts
Latch-up performance exceeds 100mAper JESD 78
Supports defense and aerospace applications:
- Controlled baseline
- One assembly and test site
- One fabrication site
- Extended product life cycle
- Product traceability

Operating range from 1.1V to 5.5V
5.5V tolerant input pins
Supports standard pinouts
Latch-up performance exceeds 100mAper JESD 78
Supports defense and aerospace applications:
- Controlled baseline
- One assembly and test site
- One fabrication site
- Extended product life cycle
- Product traceability

The SN74LVC1G175B-EP device is a single D-type flip-flop with asynchronous clear (CLR) input. When CLR is HIGH, data from the input pin (D) transfers to the output pin (Q) on the rising edge of the clock (CLK). When CLR is LOW, the Q is forced into the LOW state, regardless of the clock edge or data on D.

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	应用手册	Understanding and Interpreting Standard-Logic Data Sheets (Rev. C)				2015年 12月 2日
	选择指南	逻辑器件指南 2014 (Rev. AA)		最新英语版本 (Rev.AC)	PDF \| HTML	2014年 11月 17日
	选择指南	小尺寸逻辑器件指南 (Rev. E)		最新英语版本 (Rev.G)		2012年 7月 16日
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