SN74ALVC125
- Operates From 1.65 V to 3.6 V
- Max tpd of 2.8 ns at 3.3 V
- ±24-mA Output Drive at 3.3 V
- Latch-Up Performance Exceeds 250 mA Per JESD 17
- ESD Protection Exceeds JESD 22
- 2000-V Human-Body Model (A114-A)
- 200-V Machine Model (A115-A)
- 1000-V Charged-Device Model (C101)
This quadruple bus buffer gate is designed for 1.65-V to 3.6-V VCC operation.
The SN74ALVC125 features independent line drivers with 3-state outputs. Each output is disabled when the associated output-enable (OE)\ input is high.
To ensure the high-impedance state during power up or power down, OE\ should be tied to VCC through a pullup resistor; the minimum value of the resistor is determined by the current-sinking capability of the driver.
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评估板
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14-24-LOGIC-EVM 评估模块 (EVM) 设计用于支持采用 14 引脚至 24 引脚 D、DW、DB、NS、PW、DYY 或 DGV 封装的任何逻辑器件。
参考设计
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TIDA-00195 参考设计包含 22kW 功率级以及 TI 全新增强型隔离式 IGBT 栅极驱动器 ISO5852S,该设计用于各种应用中的电机控制。此设计允许对 ISO5852S 在三相逆变器中的性能进行评估,该逆变器包含额定电流为 50A-200A 的1200V IGBT 模块。
评估的一些重要功能和性能包括使用 DESAT 检测的短路保护、软关断、不同逆变器 dv/dt 下有源米勒钳位的有效性,以及 IGBT 栅极驱动器在系统级的 ESD/EFT 性能(源自可调速度电气电源驱动系统 (IEC61800-3))。Piccolo launch pad LAUNCHXL-F28027 (...)
参考设计
TIDEP0036 — 使用 TMS320C6657 实现高效 OPUS 编解码器解决方案的参考设计
TIDEP0036 参考设计提供了一个在 TMS320C6657 器件上轻松运行 TI 优化型 Opus 编码器/解码器的示例。由于 Opus 支持多种比特率、帧大小和采样率,所有这些都具有较低的延迟,因此它适用于语音通信、联网音频甚至高性能音频处理应用。 此设计还重点介绍了在 DSP 上实施 Opus 编解码器时与在 ARM 等通用处理器上实施 Opus 编解码器时所实现的性能改进。 根据常规用途处理器上运行的代码的优化级别,在 C66x TI DSP 内核上实现 Opus 编解码器的性能可以是 ARM CORTEX A-15 实现方案的 3 倍。TMS320C66x DSP (...)
| 封装 | 引脚 | CAD 符号、封装和 3D 模型 |
|---|---|---|
| SOIC (D) | 14 | Ultra Librarian |
| SOP (NS) | 14 | Ultra Librarian |
| TSSOP (PW) | 14 | Ultra Librarian |
| TVSOP (DGV) | 14 | Ultra Librarian |
订购和质量
包含信息:
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