高性能、低相位噪声、低偏移的时钟同步器(使参考时钟与 VCXO 同步)

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产品详细信息

参数

Function Single-loop PLL Number of outputs 5 Number of Inputs 2 Output frequency (Min) (MHz) 0 Output frequency (Max) (MHz) 1500 Input type LVCMOS (REF_CLK), LVPECL (VCXO_CLK) Output type LVCMOS, LVPECL Supply voltage (Min) (V) 3 Supply voltage (Max) (V) 3.6 Features Programmable Delay Operating temperature range (C) -40 to 85 open-in-new 查找其它 时钟抖动清除器和同步器

封装|引脚|尺寸

BGA (ZVA) 64 64 mm² 8 x 8 VQFN (RGZ) 48 49 mm² 7.0 x 7.0 open-in-new 查找其它 时钟抖动清除器和同步器

特性

  • High Performance LVPECL and LVCMOS PLL Clock Synchronizer
  • Two Reference Clock Inputs (Primary and Secondary Clock) for Redundancy Support With Manual or Automatic Selection
  • Accepts LVCMOS Input Frequencies up to 200 MHz
  • VCXO_IN Clock is Synchronized to One of the Two Reference Clocks
  • VCXO_IN Frequencies Up to 2.2 GHz (LVPECL)
  • Outputs Can Be a Combination of LVPECL and LVCMOS (Up to Five Differential LVPECL Outputs or up to 10 LVCMOS Outputs)
  • Output Frequency is Selectable by ×1, /2, /3, /4, /6, /8, /16 on Each Output Individually
  • Efficient Jitter Cleaning From Low PLL Loop Bandwidth
  • Low Phase Noise PLL Core
  • Programmable Phase Offset (PRI_REF and SEC_REF to Outputs)
  • Wide Charge Pump Current Range From
    200 µA to 3 mA
  • Dedicated Charge Pump Supply (VCC_CP) for Wide Tuning Voltage Range VCOs
  • Presets Charge Pump to VCC_CP/2 for Fast Center-Frequency Setting of VC(X)O
  • Analog and Digital PLL Lock Indication
  • Provides VBB Bias Voltage Output for Single-Ended Input Signals (VCXO_IN)
  • Frequency Hold-Over Mode Improves Fail-Safe Operation
  • Power-up Control Forces LVPECL Outputs to 3-State at VCC < 1.5 V
  • SPI Controllable Device Setting
  • 3.3-V Power Supply
  • Packaged in 64-Pin BGA (0.8 mm Pitch – ZVA) or 48-Pin QFN (RGZ)
  • Industrial Temperature Range –40°C to 85°C

All trademarks are the property of their respective owners.

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描述

The CDCM7005 is a high-performance, low phase noise and low skew clock synchronizer that synchronizes a VCXO (voltage controlled crystal oscillator) or VCO (voltage controlled oscillator) frequency to one of the two reference clocks. The programmable pre-divider M and the feedback-dividers N and P give a high flexibility to the frequency ratio of the reference clock to VC(X)O

VC(X)O_IN clock operates up to 2.2 GHz. Through the selection of external VC(X)O and loop filter components, the PLL loop bandwidth and damping factor can be adjust to meet different system requirements.

The CDCM7005 can lock to one of two reference clock inputs (PRI_REF and SEC_REF), supports frequency hold-over mode and fast-frequency-locking for fail-safe and increased system redundancy. The outputs of the CDCM7005 are user definable and can be any combination of up to five LVPECL outputs or up to 10 LVCMOS outputs. The built in synchronization latches ensure that all outputs are synchronized for low output skew.

All device settings, like outputs signaling, divider value, and input selection are programmable by SPI (3-wire serial peripheral interface). SPI allows individually control of the device settings.

The device operates in 3.3-V environment and is characterized for operation from –40°C to 85°C.

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技术文档

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类型 标题 下载最新的英文版本 日期
* 数据表 CDCM7005 3.3-V High Performance Clock Synchronizer and Jitter Cleaner 数据表 2017年 8月 16日
* 辐射与可靠性报告 CDCM7005MHFG-V 5962-0723001VXC Radiation Test Report 2014年 11月 12日
选择指南 TI Components for Aerospace and Defense Guide 2017年 3月 22日
用户指南 TSW3070EVM: Amplifier Interface to Current Sink DAC - 2016年 5月 23日
技术文章 QAM modulation levels rising: 1024 QAM and beyond 2014年 2月 26日
应用手册 正确理解时钟器件的抖动性能 2013年 1月 16日
用户指南 适用于 Xilinx FPGA 的模拟器件 解决方案指南 2012年 4月 24日
用户指南 GC5325 System Evaluation Kit 2011年 4月 20日
应用手册 TLK313x/CDCM7005 Multi-hop Performance 2009年 11月 1日
用户指南 TSW4100EVM User's Guide 2008年 9月 16日
更多文献资料 TSW3003: RF Transmit Signal Chain Demonstration Kit Bulletin 2006年 9月 28日
用户指南 CDCM7005 (BGA Package) Evaluation Module Manual 2005年 12月 19日
用户指南 CDCM7005 (QFN Package) EVM Users Guide 2005年 12月 19日
应用手册 Phase Noise/Phase Jitter Performance of CDCM7005 2005年 7月 26日
用户指南 CDCM7005 (QFN Package) EVM Manual 2005年 7月 14日
用户指南 CDCM7005 (BGA Package) Evaluation Module Manual 2005年 6月 27日

设计与开发

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硬件开发

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说明

The ADS5474EVM is a circuit board which allows the designer to run an evaluation of Texas Instruments ADS5474 device, a 14-bit 400 MSPS ADC. With the supplied Logic analyzer breakout board, the ADC LVDS output can be directly captured using either an Agilent E5405A or Tektronix P6980 touchless (...)

特性
  • Transformer coupled analog input path
  • Texas Instrument’s THS9001 analog input path
  • LVDS capture ability
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说明

ADS5483EVM 是能让设计者评估德州仪器 (TI) ADS5483 器件(具有 DDR LVDS 输出的 16 位 135 MSPS ADC)的电路板。借助提供的逻辑分析器输出板,可以使用 Agilent E5405A 或 Tektronix P6980 非接触式探针直接采集 ADC LVDS 输出。ADS5483EVM 还与 TI 的 TSW1200EVM 高速 LVDS 评估和采集系统兼容,允许采集样片并将其传递到 PC,以进行快速分析和评估。

ADS5483EVM 还包括德州仪器 (TI) 的新款 10 路输出低抖动时钟同步器和抖动消除器器件 - CDCE72010,它可用于将时钟输入驱使到 ADS5483 中。我们为外部 VCXO 和晶体带通滤波器提供了开放套接,允许对组合的高性能 ADC 与时钟电路(相当于最终的系统级解决方案)进行快速评估。此外,还为 EVM 提供了外部时钟源,后者可通过 CDCE72010 进行路由或直接传递到 ADS5483 时钟输入。

特性
  • 变压器耦合模拟输入路径
  • CDCE72010 抖动时钟同步器和抖动消除器时钟电路
  • DDR LVDS 输出和采集能力
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199
说明

The CDC7005 is a high-performance, low phase noise and low skew clock synchronizer that synchronizes voltage controlled crystal oscillator (VCXO) frequency to an external reference clock; generates very low phase noise (jitter) clock.

The PLL loop bandwidth and damping factor can be adjusted to meet (...)

特性
  • Operates up to 800 MHz
  • Loop bandwidth can be selected as low as 10 Hz or less to clean the system's clock jitter
  • Can be used as a simple 1:5 LVPECL buffer with output dividing options
  • Differential outputs programmable by serial peripheral interface (SPI)
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199
说明

CDCE72010EVM 是 10 路输出低抖动时钟同步器 CDCE72010 的评估模块。可通过 SPI 接口并使用评估模块 (EVM) 编程 GUI 对 CDCE72010 进行编程。此评估模块 (EVM) 旨在演示器件的电性能。这个完全组装且经过工厂测试的评估板允许对器件的所有功能进行全面验证。为达到最佳性能,该评估板配备有 50W SMA 连接器和受控良好的 50W 阻抗微带传输线。

特性
  • 易于使用的评估板可生成高达 1.5GHz 的低相位噪声时钟
  • 通过主机供电的 USB 端口轻松进行器件编程
  • 通过所提供的图形用户界面 (GUI) 软件接口进行快速配置
  • 通过 USB 端口或单独的 3.3V 和接地来提供全部板电源
  • 单端或差动输入基准时钟
  • 输出端的晶体滤波器可随时用于时脉高速模数转换器(如有需要)。
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199
说明

The CDCM7005 is a high-performance, low phase noise and low skew clock synchronizer that synchronizes voltage controlled crystal oscillator (VCXO) frequency to an external reference clock; generates very low phase noise (jitter) clock.

The PLL loop bandwidth and damping factor can be adjusted to meet (...)

特性
  • Output frequency up to 1500 MHz
  • Loop bandwidth can be selected as low as 10 Hz or less to clean the system's clock jitter
  • Can be used as a simple 1:5 LVPECL buffer with output dividing options
  • Differential outputs programmable by serial peripheral interface (SPI)
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199
说明

TheCDCM7005QFN-EVM is an evaluation module designed to aid in evaluating the performance of the CDCM7005, which is a high-performance, low phase noise and low skew clock synchronizer that synchronizes voltage controlled crystal oscillator (VCXO) frequency to an external reference clock; generates (...)

特性
  • Output frequency up to 1500 MHz
  • Loop bandwidth can be selected as low as 10 Hz or less to clean the system's clock jitter
  • Can be used as a simple 1:5 LVPECL buffer with output dividing options
  • Differential outputs programmable by serial peripheral interface (SPI)
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499
说明

DAC5688EVM 是一块电路板,它允许设计人员评估具有宽带 LVDS 数据输入、集成 2x/4x/8x 内插滤波器、32 位 NCO 和内部参考电压的德州仪器 (TI) 双通道 16 位 800MSPS 数模转换器 (DAC)。EVM 提供了可在各种时钟、输入条件下测试 DAC5688 的灵活环境。

它能与 TSW3100 配合使用以执行各种测试程序。TSW3100 生成了测试模式,该模式将通过单行速度可达 250MSPS 的双路 CMOS 端口被馈送至 DAC5688。DAC5688EVM 具有可使 TSW3100 板与 DAC5688 同步的可编程时钟芯片。

特性
  • DAC5688 的综合测试能力
  • 与 TSW3100 信号发生器 EVM 直接连接
  • 具有能与 VCXO 或外部时钟源配合使用的可编程低抖动时钟合成器
  • 与 TSW3100 保持时钟同步,以确保信号完整性
  • 具有完整功能 GUI 的软件支持,以确保轻松测试

设计工具和仿真

仿真模型 下载
SCAC060.ZIP (37 KB) - IBIS Model
仿真模型 下载
SCAC061B.ZIP (43 KB) - IBIS Model
仿真模型 下载
SCAC062.ZIP (37 KB) - IBIS Model
仿真工具 下载
PSPICE® for TI design and simulation tool
PSPICE-FOR-TI — PSpice® for TI 可提供帮助评估模拟电路功能的设计和仿真环境。此功能齐全的设计和仿真套件使用 Cadence® 的模拟分析引擎。PSpice for TI 可免费使用,包括业内超大的模型库之一,涵盖我们的模拟和电源产品系列以及精选的模拟行为模型。

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入门

  1. 申请使用 PSPICE-FOR-TI 仿真器
  2. 下载并安装
  3. 观看有关仿真入门的培训
特性
  • 利用 Cadence PSpice 技术
  • 带有一套数字模型的预装库可在最坏情形下进行时序分析
  • 动态更新确保您可以使用全新的器件型号
  • 针对仿真速度进行了优化,且不会降低精度
  • 支持对多个产品进行同步分析
  • 基于 OrCAD Capture 框架,提供对业界广泛使用的原理图捕获和仿真环境的访问权限
  • 可离线使用
  • 在各种工作条件和器件容许范围内验证设计,包括
    • 自动测量和后处理
    • Monte Carlo 分析
    • 最坏情形分析
    • 热分析
计算工具 下载
CDC7005 和 CDCM7005 PLL 环路带宽计算器
CDC-CDCM7005-CALC This tool helps to determine the right divider values (M, N & P) and to choose the filter type and components. This calculator will help to find out the appropriate loop bandwidth, phase margin, jitter peaking, etc. just varying the loop parameters like PFD frequency, filter components, Charge pump (...)
特性

The lab view based tool can:

  • Determine the PFD frequency automatically
  • Calculate loop bandwidth, Phase margin and Jitter peaking
  • Predict the PLL output Phase noise
  • Calculate Phase Jitter (rms)
光绘文件 下载
SCAC064.ZIP (669 KB)
光绘文件 下载
SCAC065.ZIP (567 KB)

参考设计

参考设计 下载
使用高速数据转换器的 LIDAR 脉冲飞行时间参考设计
TIDA-01187 — 各种应用(如激光安全扫描仪、测距仪、无人机和制导系统)中都利用了用于高精度测量距离的飞行时间 (ToF) 光学方法。该设计详述了基于高速数据转换器的解决方案的优点,包括目标识别、宽松的采样率要求和简化的信号链。该设计还解决了光学器件、驱动器和接收器前端电路、模数转换器 (ADC)、数模转换器 (DAC) 和信号处理。
document-generic 原理图 document-generic 用户指南 document-generic 下载英文版本 (Rev.B)
参考设计 下载
宽带宽和高电压任意波形发生器前端
TIDA-00075 此设计显示如何将活动接口用于 DAC5682Z 的电流接收器输出 - 这类典型应用包括任意波形发生器的前端。EVM 包括用于数模转换的 DAC5682Z、用于演示使用宽带宽运算放大器实现活动接口的 OPA695 以及用于展示具有大电压摆幅的运算放大器的 THS3091 和 THS3095。板上还包括用于生成时钟的 CDCM7005、VCXO 和基准以及用于电压调节的线性稳压器。通过 USB 接口和 GUI 软件实现与 EVM 的通信。
document-generic 原理图 document-generic 用户指南

CAD/CAE 符号

封装 引脚 下载
BGA (ZVA) 64 了解详情
VQFN (RGZ) 48 了解详情

订购与质量

包含信息:
  • RoHS
  • REACH
  • 器件标识
  • 引脚镀层/焊球材料
  • MSL 等级/回流焊峰值温度
  • MTBF/FIT 估算
  • 材料成分
  • 认证摘要
  • 持续可靠性监测

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