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Number of channels 8 Technology family ACT Supply voltage (min) (V) 4.5 Supply voltage (max) (V) 5.5 Input type TTL-Compatible CMOS Output type 3-State Clock frequency (max) (MHz) 125 IOL (max) (mA) 24 IOH (max) (mA) -24 Supply current (max) (µA) 80 Features Balanced outputs, Positive input clamp diode, Very high speed (tpd 5-10ns) Operating temperature range (°C) -55 to 125 Rating Catalog
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PDIP (N) 20 228.702 mm² 24.33 x 9.4 SOIC (DW) 20 131.84 mm² 12.8 x 10.3
  • 防 SCR 闩锁 CMOS 工艺和电路设计
  • 双极 FAST*/AS/S 的速度，同时功耗显著降低
  • 平衡传播延迟
  • 交流类型的工作电压范围为 1.5V 至 5.5V，并在电源电压的 30% 时具有平衡的抗噪性能
  • ±24mA 输出驱动电流
    • 扇出到 15 个 FAST* IC
    • 驱动 50Ω 传输线路

(1)FAST 是 Fairchild Semiconductor Corp. 的注册商标。
  • 防 SCR 闩锁 CMOS 工艺和电路设计
  • 双极 FAST*/AS/S 的速度，同时功耗显著降低
  • 平衡传播延迟
  • 交流类型的工作电压范围为 1.5V 至 5.5V，并在电源电压的 30% 时具有平衡的抗噪性能
  • ±24mA 输出驱动电流
    • 扇出到 15 个 FAST* IC
    • 驱动 50Ω 传输线路

(1)FAST 是 Fairchild Semiconductor Corp. 的注册商标。

’AC374 器件的八个触发器是边沿触发式 D 型触发器。在时钟 (CLK) 输入发生正转换时，Q 输出被设置为在数据 (D) 输入端设置的逻辑电平。

’AC374 器件的八个触发器是边沿触发式 D 型触发器。在时钟 (CLK) 输入发生正转换时，Q 输出被设置为在数据 (D) 输入端设置的逻辑电平。
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应用手册 使用逻辑器件进行设计 (Rev. C) 1997年 6月 1日
应用手册 Using High Speed CMOS and Advanced CMOS in Systems With Multiple Vcc 1996年 4月 1日

设计和开发

如需其他信息或资源，请点击以下任一标题进入详情页面查看（如有）。

评估板

14-24-LOGIC-EVM — 采用 14 引脚至 24 引脚 D、DB、DGV、DW、DYY、NS 和 PW 封装的逻辑产品通用评估模块

14-24-LOGIC-EVM 评估模块 (EVM) 旨在支持采用 14 引脚至 24 引脚 D、DW、DB、NS、PW、DYY 或 DGV 封装的任何逻辑器件。

用户指南: PDF | HTML
英语版 (Rev.B): PDF | HTML
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PDIP (N) 20 查看选项
SOIC (DW) 20 查看选项
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订购和质量

包含信息：
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  • REACH
  • 器件标识
  • 引脚镀层/焊球材料
  • MSL 等级/回流焊峰值温度
  • MTBF/时基故障估算
  • 材料成分
  • 鉴定摘要
  • 持续可靠性监测
包含信息：
  • 制造厂地点
  • 封装厂地点

支持和培训

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