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  • 具有双环路 PLL 且符合 JESD204B 标准的 LMK04616 超低噪声和低功耗时钟抖动消除器

    • ZHCSG70B March   2017  – July 2019 LMK04616

      PRODUCTION DATA.  

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  • 具有双环路 PLL 且符合 JESD204B 标准的 LMK04616 超低噪声和低功耗时钟抖动消除器
  1. 1特性
  2. 2应用
  3. 3说明
    1.     简化原理图
  4. 4修订历史记录
  5. 5器件和文档支持
    1. 5.1 器件支持
      1. 5.1.1 开发支持
        1. 5.1.1.1 时钟设计工具
        2. 5.1.1.2 时钟架构
        3. 5.1.1.3 TICS Pro
    2. 5.2 接收文档更新通知
    3. 5.3 社区资源
    4. 5.4 商标
    5. 5.5 静电放电警告
    6. 5.6 Glossary
  6. 6机械、封装和可订购信息
  7. 重要声明
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DATA SHEET

具有双环路 PLL 且符合 JESD204B 标准的 LMK04616 超低噪声和低功耗时钟抖动消除器

本资源的原文使用英文撰写。 为方便起见,TI 提供了译文;由于翻译过程中可能使用了自动化工具,TI 不保证译文的准确性。 为确认准确性,请务必访问 ti.com 参考最新的英文版本(控制文档)。

1 特性

  • 双环路 PLL 架构
  • 超低噪声(10kHz 至 20MHz):
    • 1966.08MHz 频率下 48fs RMS 抖动
    • 983.04MHz 频率下 50fs RMS 抖动
    • 122.88MHz 频率下 61fs RMS 抖动
  • 122.88MHz 时具有 –165dBc/Hz 本底噪声
  • JESD204B 支持
    • 一次性、脉冲和连续 SYSREF
  • 16 个差动输出时钟(处于 8 个频率组中)
    • 介于 700mVpp 和 1600mVpp 之间的可编程输出摆幅
    • 每个输出对可配置为 SYSREF 时钟输出
    • 16 位通道分频器
    • 最小 SYSREF 频率为 25kHz
    • 最大输出频率为 2GHz
    • 精密数字延迟,动态可调
      • 数字延迟 (DDLY) ½ × 时钟分配路径频率(最大 2GHz)
    • 60ps 步长模拟延迟
    • 50% 占空比输出分配,1 至 65535
      (偶数和奇数)
  • 4 个基准输入
    • 输入丢失时采用保持模式
    • 自动和手动切换模式
    • 信号损失 (LOS) 检测
  • 在 16 个有源输出下的典型功耗为 1.05W
  • 通常由 1.8V(输出、输入)和 3.3V 电源(数字、PLL1、PLL2_OSC、PLL2 内核)供电
  • 完全集成的可编程环路滤波器
  • PLL2
    • PLL2 相位检测器频率高达 250MHz
    • OSCin 倍频器
    • 集成式低噪声 VCO
  • 内部功率调节:优于 –80dBc PSRR(在 VDDO 上)(对于 122.88MHz 差动输出)
  • 3 线制或 4 线制 SPI 接口(4 线制为默认设置)
  • –40ºC 至 +85ºC 工业环境温度
  • 支持 105ºC PCB 温度(在散热焊盘上测量)
  • LMK04616:10mm × 10mm NFBGA-144 封装,间距为 0.8mm

2 应用

  • LTE-BTS、小型蜂窝、远程射频单元 (RRU) 等无线基础设施
  • 数据转换器和集成收发器时钟
  • 网络、SONET/SDH、DSLAM
  • 测试和测量

3 说明

LMK0461x 器件系列具有业界性能最高且功耗最低的抖动清除器,支持 JESD204B 接口。可以配置 16 个时钟输出以驱动 8 个 JESD204B 转换器或其他逻辑器件(使用器件和 SYSREF 时钟)。可以配置第 17 个输出,以提供来自 PLL2 的信号或来自外部 VCXO 的副本。

完全 集成的 PLL1 和 PLL2 环路滤波器、大量的集成 LDO、数字和模拟延迟、提供 3.3V、2.5V 和 1.8V 输出的灵活性以及同时生成多个 SYSREF 域的灵活性等特性使得该器件易于使用。

可以为传统计时 系统 配置 17 个输出中的每一个,不限于 JESD204B 应用。

器件信息(1)

器件型号 VCO 频率
LMK04616 5870MHz 至 6175MHz
  1. 如需了解所有可用封装,请参阅数据表末尾的可订购产品附录。

简化原理图

LMK04616 g_frontpage_461x_v2.gif

4 修订历史记录

Changes from A Revision (May 2017) to B Revision

  • 删除了双环路 PLL 架构 特性要点下的项目列表Go
  • 添加了超低噪声 特性要点Go
  • 将 VCO 频率单位从“5.8GHz 至 6.175GHz”更改为“5870MHz 至 6175MHz”Go

Changes from * Revision (March 2017) to A Revision

  • 将文本从“–70dBc PSRR”更改为“–80dBc PSRR(在 VDDO 上)Go
  • 将 SPI 接口默认设置从 3 线制更改为 4 线制Go
  • 将 VCO 频率从“5.8GHz 至 6.2GHz”更改为“5.8GHz 至 6.175GHz”Go

5 器件和文档支持

5.1 器件支持

5.1.1 开发支持

5.1.1.1 时钟设计工具

如需时钟设计工具,请访问 www.ti.com.cn/tool/cn/clockdesigntool。

5.1.1.2 时钟架构

部件选择、环路滤波器设计、仿真。

如需时钟架构,请访问 www.ti.com/clockarchitect。

5.1.1.3 TICS Pro

EVM 编程软件。还可用于生成寄存器映射,以便为特定的应用进行编程。

如需 TICS Pro,请访问 www.ti.com.cn/tool/cn/TICSPRO-SW。

5.2 接收文档更新通知

如需接收文档更新通知,请导航至 TI.com.cn 上的器件产品文件夹。单击右上角的通知我 进行注册,即可每周接收产品信息更改摘要。有关更改的详细信息,请查看任何已修订文档中包含的修订历史记录。

5.3 社区资源

The following links connect to TI community resources. Linked contents are provided "AS IS" by the respective contributors. They do not constitute TI specifications and do not necessarily reflect TI's views; see TI's Terms of Use.

    TI E2E™ Online Community TI's Engineer-to-Engineer (E2E) Community. Created to foster collaboration among engineers. At e2e.ti.com, you can ask questions, share knowledge, explore ideas and help solve problems with fellow engineers.
    Design Support TI's Design Support Quickly find helpful E2E forums along with design support tools and contact information for technical support.

5.4 商标

E2E is a registered trademark of Texas Instruments.

All other trademarks are the property of their respective owners.

5.5 静电放电警告

esds-image

这些装置包含有限的内置 ESD 保护。 存储或装卸时,应将导线一起截短或将装置放置于导电泡棉中,以防止 MOS 门极遭受静电损伤。

5.6 Glossary

SLYZ022 — TI Glossary.

This glossary lists and explains terms, acronyms, and definitions.

 

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