ZHCSCZ2A July   2014  – September 2014 DS125BR820

PRODUCTION DATA.  

  1. 1 特性
  2. 2 应用
  3. 3 说明
  4. 4 修订历史记录
  5. 5 Pin Configuration and Functions
  6. 6 Specifications
    1. 6.1 Absolute Maximum Ratings
    2. 6.2 Handling Ratings
    3. 6.3 Recommended Operating Conditions
    4. 6.4 Thermal Information
    5. 6.5 Electrical Characteristics
    6. 6.6 Electrical Characteristics — Serial Management Bus Interface
    7. 6.7 Timing Requirements Serial Bus Interface
    8. 6.8 Typical Characteristics
  7. 7 Detailed Description
    1. 7.1 Overview
    2. 7.2 Functional Block Diagram
      1. 7.2.1 Functional Datapath Blocks
    3. 7.3 Feature Description
    4. 7.4 Device Functional Modes
      1. 7.4.1 Pin Control Mode:
      2. 7.4.2 Slave SMBus Mode:
      3. 7.4.3 SMBus Master Mode
    5. 7.5 Signal Conditioning Settings
    6. 7.6 Programming
      1. 7.6.1 EEPROM Register Map for Single Device
    7. 7.7 Register Maps
      1. 7.7.1 Transfer Of Data Via The SMBus
      2. 7.7.2 SMBus Transactions
      3. 7.7.3 Writing a Register
      4. 7.7.4 Reading a Register
      5. 7.7.5 Detailed Register Map
  8. 8 Applications and Implementation
    1. 8.1 Application Information
      1. 8.1.1 Signal Integrity in 40G-CR4/KR4/SAS/SATA/PCIe Applications
      2. 8.1.2 Signal Integrity in 40G-SR4/LR4 Applications
      3. 8.1.3 Rx Detect Functionality in 40G-CR4/KR4/SAS/SATA Applications
    2. 8.2 Typical Applications
      1. 8.2.1 Generic High Speed Repeater
        1. 8.2.1.1 Design Requirements
        2. 8.2.1.2 Detailed Design Procedure
        3. 8.2.1.3 Application Performance Plots
      2. 8.2.2 Front Port Applications (40G-CR4/SR4/LR4)
        1. 8.2.2.1 Design Requirements
        2. 8.2.2.2 Detailed Design Procedure
        3. 8.2.2.3 Application Performance Plots
      3. 8.2.3 PCIe Board Applications (PCIe Gen-3)
        1. 8.2.3.1 Design Requirements
        2. 8.2.3.2 Design Procedure
        3. 8.2.3.3 Application Performance Plots
  9. 9 Power Supply Recommendations
  10. 10Layout
    1. 10.1 Layout Guidelines
    2. 10.2 Layout Example
  11. 11器件和文档支持
    1. 11.1 商标
    2. 11.2 静电放电警告
    3. 11.3 术语表
  12. 12机械封装和可订购信息

封装选项

机械数据 (封装 | 引脚)
散热焊盘机械数据 (封装 | 引脚)
订购信息

1 特性

  • 每通道 70mW（典型值）的低功耗，可选择关闭不使用的通道
  • 支持无缝链路协商
  • 启用主 ASIC，从而在较长的距离上满足前端口眼图波罩要求
  • 高级可配置信号调节 I/O
    • 6GHz 时，接收高达 10dB 的连续时间线性均衡器 (CTLE)
    • 线性输出驱动器
    • 可变输出电压范围高达 1200mVp-p
  • 可通过引脚选择 EEPROM 或 SMBus 接口进行编程
  • 单电源电压：2.5V 或 3.3V
  • -40°C 至 85°C 工作温度范围
  • 10mm x 5.5mm 54 引脚超薄型四方扁平无引线 (WQFN) 封装内的直通引脚分配

2 应用

  • 前端口 40G-CR4/SR4/LR4 链路扩展
  • 背板 40G-KR4 链路扩展
  • SAS/SATA/PCIe 链路扩展
  • 其它速率高达 12.5Gbps 的专有高速接口

简化功能框图

simplified_schematic.gif

3 说明

DS125BR820 是一款超低功耗高性能中继器/转接驱动器，专用于支持高速接口速率高达 12.5Gbps 的八个通道，例如 40G-CR4、40G-KR4、SAS/SATA 和 PCIe。 接收器的连续时间线性均衡器 (CTLE) 后接一个线性输出驱动器，可在 6GHz (12Gbps) 时提供 3dB 至 10dB 的可编程高频增强功能。 CTLE 接收器能够打开一个因码间干扰 (ISI)（由电路板迹线或铜质同轴电缆等互连介质引起）而完全关闭的输入眼型状态。 可编程的均衡能够可在互连通道内的实体布局方面实现最大限度的灵活性并提高通道的总体性能。

当在 40G-CR4/KR4、SAS/SATA 和 PCIe 应用中运行时，DS125BR820 保留发射信号特性，从而使得主机控制器和端点能够协商发射均衡器系数。 这个链路协商协议的透明管理有助于实现系统级互用性并最大限度缩短延迟。

可通过引脚控制、软件（SMBus 或 I2C）来轻松应用相关可编程设置，或者通过外部 EEPROM 直接加载设置。 在 EEPROM 模式下，配置信息在加电时自动加载，这样就免除了对于外部微控制器或软件驱动程序的需要。

器件信息(1)

器件型号 封装 封装尺寸（标称值）
DS125BR820 WQFN (54) 10mm x 5.5mm
  1. 如需了解所有可用封装，请见数据表末尾的可订购产品附录。

典型应用方框图

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