ZHCS889Q June   2007  – August 2022 TMS320F28232 , TMS320F28232-Q1 , TMS320F28234 , TMS320F28234-Q1 , TMS320F28235 , TMS320F28235-Q1 , TMS320F28332 , TMS320F28333 , TMS320F28334 , TMS320F28335 , TMS320F28335-Q1

PRODUCTION DATA  

  1. 1 特性
  2. 2 应用
  3. 3 说明
    1. 3.1 功能方框图
  4. 4 修订历史记录
  5. 5 器件比较
    1. 5.1 相关产品
  6. 6 终端配置和功能
    1. 6.1 引脚图
    2. 6.2 信号说明
  7. 7 规格
    1. 7.1  绝对最大额定值
    2. 7.2  ESD 等级 - 汽车
    3. 7.3  ESD 等级 - 商用
    4. 7.4  建议运行条件
    5. 7.5  功耗摘要
      1. 7.5.1 SYSCLKOUT 150MHz 时 TMS320F28335/F28235 电源引脚的流耗
      2. 7.5.2 SYSCLKOUT 为 150MHz 时TMS320F28334/F28234 电源引脚的流耗
      3. 7.5.3 减少电流消耗
      4. 7.5.4 电流消耗图
    6. 7.6  电气特性
    7. 7.7  热阻特征
      1. 7.7.1 PGF 封装
      2. 7.7.2 PTP 封装
      3. 7.7.3 ZHH 封装
      4. 7.7.4 ZAY 封装
      5. 7.7.5 ZJZ 封装
    8. 7.8  散热设计注意事项
    9. 7.9  时序和开关特性
      1. 7.9.1 时序参数符号
        1. 7.9.1.1 定时参数的通用注释
        2. 7.9.1.2 测试负载电路
        3. 7.9.1.3 器件时钟表
          1. 7.9.1.3.1 计时和命名规则（150MHz 器件）
          2. 7.9.1.3.2 计时和命名规则（100MHz 器件）
      2. 7.9.2 电源时序
        1. 7.9.2.1 电源管理和监控电路解决方案
        2. 7.9.2.2 复位 (XRS) 序要求
      3. 7.9.3 时钟要求和特性
        1. 7.9.3.1 输入时钟频率
        2. 7.9.3.2 XCLKIN时序要求- PLL 被启用
        3. 7.9.3.3 XCLKIN时序要求- PLL 被禁用
        4. 7.9.3.4 XCLKOUT 开关特征（旁路或启用 PLL）
        5. 7.9.3.5 时序图
      4. 7.9.4 外设
        1. 7.9.4.1 通用输入/输出（GPIO）
          1. 7.9.4.1.1 GPIO - 输出时序
            1. 7.9.4.1.1.1 通用输出开关特性
          2. 7.9.4.1.2 GPIO - 输入时序
            1. 7.9.4.1.2.1 通用输入时序要求
          3. 7.9.4.1.3 输入信号的采样窗口宽度
          4. 7.9.4.1.4 低功耗模式唤醒时序
            1. 7.9.4.1.4.1 空闲模式时序要求
            2. 7.9.4.1.4.2 空闲模式开关特性
            3. 7.9.4.1.4.3 空闲模式时序图
            4. 7.9.4.1.4.4 待机模式时序要求
            5. 7.9.4.1.4.5 待机模式开关特征
            6. 7.9.4.1.4.6 待机模式时序要求
            7. 7.9.4.1.4.7 停机模式时序要求
            8. 7.9.4.1.4.8 HALT 模式开关特性
            9. 7.9.4.1.4.9 停机模式时序图
        2. 7.9.4.2 增强型控制外设
          1. 7.9.4.2.1 增强型脉宽调制器 (ePWM) 时序
            1. 7.9.4.2.1.1 ePWM 时序要求
            2. 7.9.4.2.1.2 ePWM 开关特征
          2. 7.9.4.2.2 跳变区输入时序
            1. 7.9.4.2.2.1 跳闸区域输入时序要求
          3. 7.9.4.2.3 高分辨率 PWM 时序
            1. 7.9.4.2.3.1 在 SYSCLKOUT=(60150-150300MHz) 时，高分辨率 PWM 特性
          4. 7.9.4.2.4 增强型捕捉 (eCAP) 时序
            1. 7.9.4.2.4.1 增强型捕捉 (eCAP) 时序要求
            2. 7.9.4.2.4.2 eCAP 开关特征
          5. 7.9.4.2.5 增强型正交编码器脉冲 (eQEP) 时序
            1. 7.9.4.2.5.1 增强型正交编码器脉冲 (eQEP) 时序要求
            2. 7.9.4.2.5.2 eQEP 开关特性
          6. 7.9.4.2.6 ADC 转换开始时序
            1. 7.9.4.2.6.1 外部 ADC 转换开始开关特性
            2. 7.9.4.2.6.2 ADCSOCAO 或者 ADCSOCBO 时序
        3. 7.9.4.3 外部中断时序
          1. 7.9.4.3.1 外部中断时序要求
          2. 7.9.4.3.2 外部中断开关特征
          3. 7.9.4.3.3 外部中断时序要求
        4. 7.9.4.4 I2C 电气特性和时序
          1. 7.9.4.4.1 I2C 时序
        5. 7.9.4.5 串行外设接口 (SPI) 模块
          1. 7.9.4.5.1 主模式时序
            1. 7.9.4.5.1.1 SPI 主模式外部时序（时钟相位 = 0）
            2. 7.9.4.5.1.2 SPI 主模式外部时序（时钟相位 = 1）
          2. 7.9.4.5.2 从模式时序
            1. 7.9.4.5.2.1 SPI 从模式外部时序（时钟相位 = 0）
            2. 7.9.4.5.2.2 SPI 从模式外部时序（时钟相位 = 1）
        6. 7.9.4.6 多通道缓冲串行端口 (McBSP) 模块
          1. 7.9.4.6.1 McBSP 传输和接收时序
            1. 7.9.4.6.1.1 McBSP 时序要求
            2. 7.9.4.6.1.2 McBSP 开关特征
          2. 7.9.4.6.2 McBSP 作为 SPI 主器件或从器件时序
            1. 7.9.4.6.2.1 McBSP 作为 SPI 主器件或从器件时的时序要求（CLKSTP=10b，CLKXP=0）
            2. 7.9.4.6.2.2 McBSP 作为 SPI 主控或者受控开关特性 (CLKSTP=10b，CLKXP=0)
            3. 7.9.4.6.2.3 McBSP 作为 SPI 主器件或从器件时的时序要求（CLKSTP=11b，CLKXP=0）
            4. 7.9.4.6.2.4 McBSP 作为 SPI 主控或者受控开关特性 (CLKSTP= 11b，CLKXP= 0)
            5. 7.9.4.6.2.5 McBSP 作为 SPI 主器件或从器件时的时序要求（CLKSTP= 10b，CLKXP= 1）
            6. 7.9.4.6.2.6 McBSP 作为 SPI 主控或者受控开关特性 (CLKSTP= 10b，CLKXP= 1)
            7. 7.9.4.6.2.7 McBSP 作为 SPI 主器件或从器件时的时序要求（CLKSTP= 11b，CLKXP= 1）
            8. 7.9.4.6.2.8 McBSP 作为 SPI 主器件或从器件开关特性（CLKSTP= 11b，CLKXP= 1）
      5. 7.9.5 无信号缓冲情况下 MCU 与 JTAG 调试探针的连接
      6. 7.9.6 外部接口 (XINTF) 时序
        1. 7.9.6.1 USEREADY = 0
        2. 7.9.6.2 同步模式 (USEREADY=1，READYMODE=0)
        3. 7.9.6.3 异步模式 (USEREADY=1，READYMODE=1)
        4. 7.9.6.4 XINTF 信号与 XCLKOUT 一致
        5. 7.9.6.5 外部接口读取时序
          1. 7.9.6.5.1 外部存储器接口读取时序要求
          2. 7.9.6.5.2 外部内存接口读取开关特性
        6. 7.9.6.6 外部接口写入时序
          1. 7.9.6.6.1 外部存储器接口写入开关特性
        7. 7.9.6.7 带有一个外部等待状态的外部接口读取准备就绪时序
          1. 7.9.6.7.1 外部接口读取开关特性（读取准备就绪，1 个等待状态）
          2. 7.9.6.7.2 外部接口读取时序要求（读取准备就绪，1 个等待状态）
          3. 7.9.6.7.3 同步 XREADY 时序要求（读取准备就绪，1 个等待状态）
          4. 7.9.6.7.4 异步 XREADY 时序要求（读取准备就绪，1 个等待状态）
        8. 7.9.6.8 带有一个外部等待状态的外部接口写入准备就绪时序
          1. 7.9.6.8.1 外部接口写入开关特性（写入准备就绪，1 个等待状态）
          2. 7.9.6.8.2 同步 XREADY 时序要求（写入准备就绪，1 个等待状态）
          3. 7.9.6.8.3 异步 XREADY 时序要求（写入准备就绪，1 个等待状态）
        9. 7.9.6.9 XHOLD 和 XHOLDA 时序
          1. 7.9.6.9.1 XHOLD/ XHOLDA 时序要求 (XCLKOUT = XTIMCLK)
          2. 7.9.6.9.2 XHOLD/XHOLDA时序要求 (XCLKOUT = 1/2 XTIMCLK)
      7. 7.9.7 闪存定时
        1. 7.9.7.1 A 和 S 温度材料的闪存耐久性
        2. 7.9.7.2 Q 温度材料的闪存耐久性
        3. 7.9.7.3 150MHz SYSCLKOUT 上的闪存参数：
        4. 7.9.7.4 闪存 / OTP 访问时序
        5. 7.9.7.5 闪存数据保持持续时间
    10. 7.10 片载模数转换器
      1. 7.10.1 ADC 电气特性（在推荐的工作条件下测得）
      2. 7.10.2 ADC 加电控制位时序
        1. 7.10.2.1 ADC 加电延迟
        2. 7.10.2.2 不同 ADC 配置的典型电流消耗（在 25MHz ADCCLK 条件下）
      3. 7.10.3 定义
      4. 7.10.4 顺序采样模式（单通道） (SMODE = 0)
        1. 7.10.4.1 顺序采样模式时序
      5. 7.10.5 同步采样模式（双通道）(SMODE=1)
        1. 7.10.5.1 同步采样模式时序
      6. 7.10.6 详细说明
    11. 7.11 F2833x 器件和 F2823x 器件之间的迁移
  8. 8 详细说明
    1. 8.1 简要说明
      1. 8.1.1  C28x CPU
      2. 8.1.2  内存总线（哈弗总线架构）
      3. 8.1.3  外设总线
      4. 8.1.4  实时 JTAG 和分析
      5. 8.1.5  外部接口(XINTF)
      6. 8.1.6  闪存
      7. 8.1.7  M0，M1 SARAM
      8. 8.1.8  L0, L1, L2, L3, L4, L5, L6, L7, H0, H1, H2, H3, H4, H5SARAM
      9. 8.1.9  引导 ROM
        1. 8.1.9.1 引导加载器使用的外设引脚
      10. 8.1.10 安全性
      11. 8.1.11 外设中断扩展 (PIE) 块
      12. 8.1.12 外部中断 (XINT1-XINT7，XNMI)
      13. 8.1.13 振荡器和锁相环 (PLL)
      14. 8.1.14 看门狗
      15. 8.1.15 外设时钟
      16. 8.1.16 低功耗模式
      17. 8.1.17 外设帧 0，1，2，3 (PFn)
      18. 8.1.18 通用输入/输出 (GPIO) 复用器
      19. 8.1.19 32 位 CPU 计时器 (0，1，2)
      20. 8.1.20 控制外设
      21. 8.1.21 串行端口外设
    2. 8.2 外设
      1. 8.2.1  DMA 概述
      2. 8.2.2  32 位 CPU 计时器 0，CPU 计时器 1，CPU 计时器 2
      3. 8.2.3  增强型 PWM 模块
      4. 8.2.4  高分辨率 PWM (HRPWM)
      5. 8.2.5  增强型 CAP 模块
      6. 8.2.6  增强型 QEP 模块
      7. 8.2.7  模数转换器 (ADC) 模块
        1. 8.2.7.1 如果 ADC 未被使用，ADC 连接
        2. 8.2.7.2 ADC 寄存器
        3. 8.2.7.3 ADC 校准
      8. 8.2.8  多通道缓冲串行端口 (McBSP) 模块
      9. 8.2.9  增强型控制器局域网 (eCAN) 模块（eCAN-A 和 eCAN-B）
      10. 8.2.10 串行通信接口 (SCI) 模块 (SCI-A，SCI-B，SCI-C)
      11. 8.2.11 串行外设接口 (SPI) 模块（SPI-A）
      12. 8.2.12 内部集成电路 (I2C)
      13. 8.2.13 GPIO MUX
      14. 8.2.14 外部接口 (XINTF)
    3. 8.3 内存映射
    4. 8.4 寄存器映射
      1. 8.4.1 器件仿真寄存器
    5. 8.5 中断
      1. 8.5.1 外部中断
    6. 8.6 系统控制
      1. 8.6.1 OSC 和 PLL 块
        1. 8.6.1.1 外部基准振荡器时钟选项
        2. 8.6.1.2 基于 PLL 的时钟模块
        3. 8.6.1.3 输入时钟损失
      2. 8.6.2 看门狗块
    7. 8.7 低功率模式块
  9. 9 应用、实现和布局
    1. 9.1 TI 参考设计
  10. 10器件和文档支持
    1. 10.1 入门和后续步骤
    2. 10.2 器件和开发支持工具命名规则
    3. 10.3 工具与软件
    4. 10.4 文档支持
    5. 10.5 支持资源
    6. 10.6 商标
    7. 10.7 Electrostatic Discharge Caution
    8. 10.8 术语表
  11. 11机械、封装和可订购信息
    1. 11.1 封装重新设计详情
    2. 11.2 封装信息

封装选项

请参考 PDF 数据表获取器件具体的封装图。

机械数据 (封装 | 引脚)
  • ZJZ|176
  • ZAY|179
  • PGF|176
  • PTP|176
散热焊盘机械数据 (封装 | 引脚)
订购信息

8.2.13 GPIO MUX

在 2833x/2823x 器件上，除了提供独立的引脚 Bit-banging I/O 功能外，GPIO MUX 还可以将最多 3 个独立的外设信号多路复用到单个 GPIP 引脚上。每个引脚的 GPIO MUX 方框图显示在图 8-18中。由于 I2C 引脚的开漏功能，这些引脚的 GPIO MUX 方框图是不同的。有关详细信息，请参阅 TMS320x2833x、MS320x2823x 实时微控制器技术参考手册 中的“系统控制和中断”一章。

注：

从写入 GPxMUXn 和 GPxQSELn 寄存器发生到动作有效有两个 SYSCLKOUT 周期延迟。

GUID-CA1489B6-ED5C-4E9C-8F8E-4D0B6D98ACAB-low.gif
A. x 代表端口，A 或 B。例如，GPxDIR 是指 GPADIR 或者 GPBDIR 寄存器，至于是哪一个寄存器，则取决于所选择的特定 GPIO 引脚。
B. 在相同的存储器位置访问 GPxDAT 锁存/读取。
C. 这是一个通用 GPIO 多路复用器方框图。并非所有选项都可用于所有 GPIO 引脚。有关引脚特定的变化，请参阅 TMS320x2833x、TMS320x2823x 实时微控制器技术参考手册 中的“系统控制和中断”一章。
图 8-18 GPIO MUX 方框图

器件支持 88 个 GPIO 引脚。GPIO 控制和数据寄存器会映射到外设帧 1，以便在寄存器上实现 32 位运行（连同 16 位运行）。表 8-17显示了 GPIO 寄存器映射。

表 8-17 GPIO 寄存器
名称 地址 大小 (x16) 说明
GPIO 控制寄存器（受 EALLOW 保护）
GPACTRL 0x6F80 2 GPIO A 控制寄存器（GPIO0 至 31）
GPAQSEL1 0x6F82 2 GPIO A 限定器选择 1 寄存器（GPIO0 至 15）
GPAQSEL2 0x6F84 2 GPIO A 限定器选择 2 寄存器（GPIO16 至 31）
GPAMUX1 0x6F86 2 GPIO A 多路复用器 1 寄存器（GPIO0 至 15）
GPAMUX2 0x6F88 2 GPIO A 多路复用器 2 寄存器（GPIO16 至 31）
GPADIR 0x6F8A 2 GPIO A 方向寄存器（GPIO0 至 31）
GPAPUD 0x6F8C 2 GPIO A 上拉禁用寄存器（GPIO0 至 31）
保留 0x6F8E-0x6F8F 2
GPBCTRL 0x6F90 2 GPIO B 控制寄存器（GPIO32 至 63）
GPBQSEL1 0x6F92 2 GPIO B 限定器选择 1 寄存器（GPIO32 至 47）
GPBQSEL2 0x6F94 2 GPIOB 限定符选择 2 寄存器（GPIO48 至 63）
GPBMUX1 0x6F96 2 GPIO B MUX 1 寄存器（GPIO32 至 47）
GPBMUX2 0x6F98 2 GPIO B MUX 2 寄存器（GPIO48 至 63）
GPBDIR 0x6F9A 2 GPIO B 方向寄存器（GPIO32 至 63）
GPBPUD 0x6F9C 2 GPIO B 上拉禁用寄存器（GPIO32 至 63）
保留 0x6F9E-0x6FA5 8
GPCMUX1 0x6FA6 2 GPIO C MUX1 寄存器（GPIO64 至 79）
GPCMUX2 0x6FA8 2 GPIO C MUX2 寄存器（GPIO80 至 87）
GPCDIR 0x6FAA 2 GPIO C 方向寄存器 (GPIO64 至 GPIO 87)
GPCPUD 0x6FAC 2 GPIO C 上拉禁用寄存器（GPIO64 至 87）
保留 0x6FAE–0x6FBF 18
GPIO 数据寄存器（不受 EALLOW 保护）
GPADAT 0x6FC0 2 GPIO A 数据寄存器（GPIO0 至 31）
GPASET 0x6FC2 2 GPIO A 数据集寄存器（GPIO0 至 31）
GPACLEAR 0x6FC4 2 GPIO A 数据清除寄存器（GPIO0 至 31）
GPATOGGLE 0x6FC6 2 GPIO A 数据切换寄存器（GPIO0 至 31）
GPBDAT 0x6FC8 2 GPIO B 数据寄存器（GPIO32 至 63）
GPBSET 0x6FCA 2 GPIO B 数据设定寄存器（GPIO32 至 63）
GPBCLEAR 0x6FCC 2 GPIO B 数据清除寄存器（GPIO32 至 63）
GPBTOGGLE 0x6FCE 2 GPIO B 数据切换寄存器（GPIO32 至 63）
GPCDAT 0x6FD0 2 GPIO C 数据寄存器（GPIO64 至 87）
GPCSET 0x6FD2 2 GPIO C 数据设定寄存器（GPIO64 至 87）
GPCCLEAR 0x6FD4 2 GPIO C 数据清除寄存器（GPIO64 至 87）
GPCTOGGLE 0x6FD6 2 GPIO C 数据切换寄存器（GPIO64 至 87）
保留 0x6FD8-0x6FDF 8
GPIO 中断和低功耗模式选择寄存器（受 EALLOW 保护）
GPIOXINT1SEL 0x6FE0 1 XINT1 GPIO 输入选择寄存器（GPIO0 至 31）
GPIOXINT2SEL 0x6FE1 1 XINT2 GPIO 输入选择寄存器（GPIO0 至 31）
GPIOXNMISEL 0x6FE2 1 XNMI GPIO 输入选择寄存器（GPIO0 至 31）
GPIOXINT3SEL 0x6FE3 1 XINT3 GPIO 输入选择寄存器（GPIO32 至 63）
GPIOXINT4SEL 0x6FE4 1 XINT4 GPIO 输入选择寄存器（GPIO32 至 63）
GPIOXINT5SEL 0x6FE5 1 XINT5 GPIO 输入选择寄存器（GPIO32 至 63）
GPIOXINT6SEL 0x6FE6 1 XINT6 GPIO 输入选择寄存器（GPIO32 至 63）
GPIOINT7SEL 0x6FE7 1 XINT7 GPIO 输入选择寄存器（GPIO32 至 63）
GPIOLPMSEL 0x6FE8 2 LPM GPIO 选择寄存器（GPIO0 至 31）
保留 0x6FEA-0x6FFF 22
表 8-18 GPIO 复用器外设选择矩阵
寄存器位 外设选择
GPADIR
GPADAT
GPASET
GPACLR
GPATOGGLE		 GPAMUX1
GPAQSEL1		 GPIOx
GPAMUX1 = 0,0		 PER1
GPAMUX1 = 0, 1		 PER2
GPAMUX1 = 1, 0		 PER3
GPAMUX1 = 1, 1
QUALPRD0 0 1, 0 GPIO0 (I/O) EPWM1A (O) 保留 保留
1 3, 2 GPIO1 (I/O) EPWM1B (O) ECAP6 (I/O) MFSRB (I/O)
2 5, 4 GPIO2 (I/O) EPWM2A (O) 保留 保留
3 7, 6 GPIO3 (I/O) EPWM2B (O) ECAP5 (I/O) MCLKRB (I/O)
4 9, 8 GPIO4 (I/O) EPWM3A (O) 保留 保留
5 11, 10 GPIO5 (I/O) EPWM3B (O) MFSRA (I/O) ECAP1 (I/O)
6 13, 12 GPIO6 (I/O) EPWM4A (O) EPWMSYNCI (I) EPWMSYNCO (O)
7 15, 14 GPIO7 (I/O) EPWM4B (O) MCLKRA (I/O) ECAP2 (I/O)
QUALPRD1 8 17, 16 GPIO8 (I/O) EPWM5A (O) CANTXB (O) ADCSOCAO(O)
9 19, 18 GPIO9 (I/O) EPWM5B (O) SCITXDB (O) ECAP3 (I/O)
10 21, 20 GPIO10 (I/O) EPWM6A (O) CANRXB (I) ADCSOCBO(O)
11 23, 22 GPIO11 (I/O) EPWM6B (O) SCIRXDB (I) ECAP4 (I/O)
12 25, 24 GPIO12 (I/O) TZ1(I) CANTXB (O) MDXB (O)
13 27, 26 GPIO13 (I/O) TZ2(I) CANRXB (I) MDRB (I)
14 29, 28 GPIO14 (I/O) TZ3 (I)/ XHOLD (I) SCITXDB (O) MCLKXB (I/O)
15 31, 30 GPIO15 (I/O) TZ4 (I)/ XHOLDA (O) SCIRXDB (I) MFSXB (I/O)
GPAMUX2
GPAQSEL2		 GPAMUX2 = 0, 0 GPAMUX2 = 0, 1 GPAMUX2 = 1, 0 GPAMUX2 = 1, 1
QUALPRD2 16 1, 0 GPIO16 (I/O) SPISIMOA (I/O) CANTXB (O) TZ5(I)
17 3, 2 GPIO17 (I/O) SPISOMIA (I/O) CANRXB (I) TZ6(I)
18 5, 4 GPIO18 (I/O) SPICLKA (I/O) SCITXDB (O) CANRXA (I)
19 7, 6 GPIO19 (I/O) SPISTEA(I/O) SCIRXDB (I) CANTXA (O)
20 9, 8 GPIO20 (I/O) EQEP1A (I) MDXA (O) CANTXB (O)
21 11, 10 GPIO21 (I/O) EQEP1B (I) MDRA (I) CANRXB (I)
22 13, 12 GPIO22 (I/O) EQEP1S (I/O) MCLKXA (I/O) SCITXDB (O)
23 15, 14 GPIO23 (I/O) EQEP1I (I/O) MFSXA (I/O) SCIRXDB (I)
QUALPRD3 24 17, 16 GPIO24 (I/O) ECAP1 (I/O) EQEP2A (I) MDXB (O)
25 19, 18 GPIO25 (I/O) ECAP2 (I/O) EQEP2B (I) MDRB (I)
26 21, 20 GPIO26 (I/O) ECAP3 (I/O) EQEP2I (I/O) MCLKXB (I/O)
27 23, 22 GPIO27 (I/O) ECAP4 (I/O) EQEP2S (I/O) MFSXB (I/O)
28 25, 24 GPIO28 (I/O) SCIRXDA (I) XZCS6(O)
29 27, 26 GPIO29 (I/O) SCITXDA (O) XA19(O)
30 29, 28 GPIO30 (I/O) CANRXA (I) XA18(O)
31 31, 30 GPIO31 (I/O) CANTXA (O) XA17(O)
表 8-19 GPIO-B 复用器外设选择矩阵
寄存器位 外设选择
GPBDIR
GPBDAT
GPBSET
GPBCLR
GPBTOGGLE		 GPBMUX1
GPBQSEL1		 GPIOx
GPBMUX1 = 0, 0		 PER1
GPBMUX1 = 0, 1		 PER2
GPBMUX1 = 1, 0		 PER3
GPBMUX1 = 1, 1
QUALPRD0 0 1, 0 GPIO32(I/O) SDAA (I/OC)(1) EPWMSYNCI (I) ADCSOCAO (O)
1 3, 2 GPIO33(I/O) SCLA (I/OC)(1) EPWMSYNCO (O) ADCSOCBO (O)
2 5, 4 GPIO34 (I/O) ECAP1 (I/O) XREADY (I)
3 7, 6 GPIO35(I/O) SCITXDA (O) XR/ W (O)
4 9, 8 GPIO36(I/O) SCIRXDA (I) XZCS0(O)
5 11, 10 GPIO37(I/O) ECAP2 (I/O) XZCS7 (O)
6 13, 12 GPIO38(I/O) 保留 XWE0(O)
7 15, 14 GPIO39(I/O) XA16(O)
QUALPRD1 8 17, 16 GPIO40(I/O) XA0/ XWE1 (O)
9 19, 18 GPIO41 (I/O) XA1(O)
10 21, 20 GPIO42(I/O) XA2(O)
11 23, 22 GPIO43(I/O) XA3(O)
12 25, 24 GPIO44(I/O) XA4(O)
13 27, 26 GPIO45 (I/O) XA5(O)
14 29, 28 GPIO46(I/O) XA6(O)
15 31, 30 GPIO47(I/O) XA7(O)
GPBMUX2
GPBQSEL2		 GPBMUX2 = 0, 0 GPBMUX2 = 0, 1 GPBMUX2 = 1, 0 GPBMUX2 = 1, 1
QUALPRD2 16 1, 0 GPIO48 (I/O) ECAP5 (I/O) XD31(I/O)
17 3, 2 GPIO49 (I/O) ECAP6 (I/O) XD30 (I/O)
18 5, 4 GPIO50 (I/O) EQEP1A (I) XD29 (I/O)
19 7, 6 GPIO51 (I/O) EQEP1B (I) XD28 (I/O)
20 9, 8 GPIO52 (I/O) EQEP1S (I/O) XD27 (I/O)
21 11, 10 GPIO53 (I/O) EQEP1I (I/O) XD26 (I/O)
22 13, 12 GPIO54 (I/O) SPISIMOA (I/O) XD25 (I/O)
23 15, 14 GPIO55 (I/O) SPISOMIA (I/O) XD24 (I/O)
QUALPRD3 24 17, 16 GPIO56 (I/O) SPICLKA (I/O) XD23 (I/O)
25 19, 18 GPIO57 (I/O) SPISTEA(I/O) XD22(I/O)
26 21, 20 GPIO58 (I/O) MCLKRA (I/O) XD21 (I/O)
27 23, 22 GPIO59 (I/O) MFSRA (I/O) XD20 (I/O)
28 25, 24 GPIO60(I/O) MCLKRB (I/O) XD19(I/O)
29 27, 26 GPIO61 (I/O) MFSRB (I/O) XD18 (I/O)
30 29, 28 GPIO62 (I/O) SCIRXDC (I) XD17 (I/O)
31 31, 30 GPIO63 (I/O) SCITXDC (O) XD16 (I/O)
(1) 开漏
表 8-20 GPIO-C 复用器外设选择矩阵
寄存器位 外设选择
GPCDIR
GPCDAT
GPCSET
GPCCLR
GPCTOGGLE		 GPCMUX1 GPIOx 或 PER1
GPCMUX1 = 0, 0 或 0, 1		 PER2 或 PER3
GPCMUX1 = 1, 0 或 1, 1
在其中 0 1, 0 GPIO64 (I/O) XD15 (I/O)
1 3, 2 GPIO65 (I/O) XD14 (I/O)
2 5, 4 GPIO66 (I/O) XD13 (I/O)
3 7, 6 GPIO67 (I/O) XD12 (I/O)
4 9, 8 GPIO68 (I/O) XD11 (I/O)
5 11, 10 GPIO69 (I/O) XD10 (I/O)
6 13, 12 GPIO70 (I/O) XD9 (I/O)
7 15, 14 GPIO71 (I/O) XD8 (I/O)
在其中 8 17, 16 GPIO72 (I/O) XD7 (I/O)
9 19, 18 GPIO73 (I/O) XD6 (I/O)
10 21, 20 GPIO74 (I/O) XD5 (I/O)
11 23, 22 GPIO75 (I/O) XD4 (I/O)
12 25, 24 GPIO76 (I/O) XD3 (I/O)
13 27, 26 GPIO77 (I/O) XD2 (I/O)
14 29, 28 GPIO78 (I/O) XD1 (I/O)
15 31, 30 GPIO79 (I/O) XD0 (I/O)
GPCMUX2 GPCMUX2 = 0, 0 或 0, 1 GPCMUX2 = 1, 0 或 1, 1
在其中 16 1, 0 GPIO80 (I/O) XA8 (O)
17 3, 2 GPIO81 (I/O) XA9 (O)
18 5, 4 GPIO82 (I/O) XA10 (O)
19 7, 6 GPIO83 (I/O) XA11(O)
20 9, 8 GPIO84 (I/O) XA12 (O)
21 11, 10 GPIO85 (I/O) XA13 (O)
22 13, 12 GPIO86 (I/O) XA14 (O)
23 15, 14 GPIO87 (I/O) XA15 (O)

通过 GPxQSEL1/2 寄存器，用户可从四个选项中为每一个 GPIO 引脚选择输入限定的类型：

  • 仅同步到 SYSCLKOUT (GPxQSEL1/2 = 0, 0)；这是复位时所有 GPIO 引脚的默认模式，它只会将输入信号同步至系统时钟 (SYSCLKOUT)。
  • 使用采样窗口的限定（GPxQSEL1/2 = 0, 1 和 1, 0）：在此模式下，输入信号会在同步到系统时钟 (SYSCLKOUT) 后，通过指定数量的周期进行限定，然后才允许输入发生变化。
    GUID-97587CB1-7282-4DD8-9502-0786E1A20B66-low.gif图 8-19 使用采样窗口的限定：
  • 采样周期由 GPxCTRL 寄存器内的 QUALPRD 位指定并且可在一组 8 个信号中进行配置。它为采样输入信号指定了多个 SYSCLKOUT 周期。采样窗口为 3 个样本或 6 个样本宽，只有当所有样本如图 8-19（6 样本模式）所示全部相同（全为 0 或全为 1）时，输出才会发生变化。
  • 不同步 (GPxQSEL1/2 = 1,1)：此模式在无需同步的情况下用于外设（在外设内执行同步）。

器件上需要多级多路复用，因此在某些情况下，可以将外设输入信号映射到多个 GPIO 引脚。此外，当一个输入信号未被选择时，此输入信号将缺省为一个 0 或者 1 状态，依外设而定。