데이터 시트
TDEL3G511
- 1% typical, 10% maximum delay variation
- Pre-configured digital timing - no external timing components required
- Wide operating range from 1.65V to 5.5V
- I/O clamp diodes protect from over- and under-voltage transients
- Schmitt-trigger architecture on all inputs
기술 자료
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| 상위 문서 | 유형 | 직함 | 형식 옵션 | 최신 영어 버전 다운로드 | 날짜 | |
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| * | 데이터 시트 | TDEL3G511 Triple Rising Edge Delay Elements datasheet | PDF | HTML | 2026. 4. 23 |
설계 및 개발
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평가 보드
5-8-LOGIC-EVM — 5핀~8핀 DCK, DCT, DCU, DRL 및 DBV 패키지용 일반 논리 평가 모듈
5~8핀 수의 DCK, DCT, DCU, DRL 또는 DBV 패키지가 있는 모든 디바이스를 지원하도록 설계된 유연한 EVM.
사용 설명서:
PDF
재고 있음
제한:
??asset.out-of-stock-ti_ko_KR??
이용할 수 없음
| 패키지 | 핀 | CAD 기호, 풋프린트 및 3D 모델 |
|---|---|---|
| SOT-5X3 (DRL) | 8 | Ultra Librarian |