SN74CBTLV3125
- Standard 125-Type Terminal Out
- 5Ω Switch Connection Between Two Ports
- Rail-to-Rail Switching on Data I/O Ports
- Ioff Supports Partial-Power-Down Mode Operation
- Latch-Up Performance Exceeds 100 mA Per JESD 78, Class II
The SN74CBTLV3125 quadruple FET bus switch features independent line switches. Each switch is disabled when the associated output-enable ( OE) input is high.
This device is fully specified for partial-power-down applications using Ioff. The Ioff feature ensures that damaging current does not backflow through the device when it is powered down. The device has isolation during power off.
To ensure the high-impedance state during power up or power down, OE should be tied to VCC through a pullup resistor; the minimum value of the resistor is determined by the current-sinking capability of the driver.
기술 자료
| 상위 문서 | 유형 | 직함 | 형식 옵션 | 최신 영어 버전 다운로드 | 날짜 | |
|---|---|---|---|---|---|---|
| * | 데이터 시트 | SN74CBTLV3125 Low-Voltage Quadruple FET Bus Switch datasheet (Rev. K) | PDF | HTML | 2026. 7. 17 | ||
| 애플리케이션 노트 | Selecting the Correct Texas Instruments Signal Switch (Rev. E) | PDF | HTML | 2022. 6. 2 | |||
| 애플리케이션 노트 | Multiplexers and Signal Switches Glossary (Rev. B) | PDF | HTML | 2021. 12. 1 | |||
| Application brief | Eliminate Power Sequencing with Powered-off Protection Signal Switches (Rev. C) | PDF | HTML | 2021. 1. 6 |
설계 및 개발
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LEADED-ADAPTER1 — TI의 5, 8, 10, 16 및 24핀 리드 패키지의 빠른 테스트를 위한 DIP 헤더 어댑터에 대한 표면 실장
EVM-LEADED1 보드를 사용하면 TI의 공통 리드가 있는 패키지를 브레드보드 방식으로 빠르게 테스트할 수 있습니다. 이 보드에는 TI의 D, DBQ, DCT, DCU, DDF, DGS, DGV 및 PW 표면 실장 패키지를 100mil DIP 헤더로 변환할 수 있는 풋프린트가 있습니다.
| 패키지 | 핀 | CAD 기호, 풋프린트 및 3D 모델 |
|---|---|---|
| TSSOP (PW) | 14 | Ultra Librarian |
| VQFN (RGY) | 14 | Ultra Librarian |
| SOIC (D) | 14 | Ultra Librarian |
| SSOP (DBQ) | 16 | Ultra Librarian |
| TVSOP (DGV) | 14 | Ultra Librarian |
주문 및 품질
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