홈 로직 및 전압 변환 플립플롭, 래치 및 레지스터 D형 플립플롭
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D형 플립플롭

CD74AC174

활성

리셋을 지원하는 16진 D형 플립플롭

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데이터 시트

CD74AC174

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제품 상세 정보

Number of channels 6 Technology family AC Input type Standard CMOS Output type Push-Pull Clock frequency (max) (MHz) 95 IOL (max) (mA) 24 IOH (max) (mA) -24 Supply current (max) (µA) 160 Features Balanced outputs, High speed (tpd 10-50ns), Positive input clamp diode Operating temperature range (°C) -55 to 125 Rating Catalog
Number of channels 6 Technology family AC Input type Standard CMOS Output type Push-Pull Clock frequency (max) (MHz) 95 IOL (max) (mA) 24 IOH (max) (mA) -24 Supply current (max) (µA) 160 Features Balanced outputs, High speed (tpd 10-50ns), Positive input clamp diode Operating temperature range (°C) -55 to 125 Rating Catalog
SOIC (D) 16 59.4 mm² (9.9 mm × 6 mm) WQFN (BQB) 16 8.75 mm² (3.5 mm × 2.5 mm) PDIP (N) 16 181.42 mm² (19.3 mm × 9.4 mm) TSSOP (PW) 16 32 mm² (5 mm × 6.4 mm)
  • AC types feature 1.5V to 5.5V operation and balanced noise immunity at 30% of the supply voltage
  • Contains six flip-flops with single-rail outputs
  • Buffered inputs
  • Speed of Bipolar F, AS, and S, with significantly reduced power consumption
  • Balanced propagation delays
  • ±24mA output drive current
    • Fanout to 15 F devices
  • SCR-latchup-resistant CMOS process and circuit design
  • AC types feature 1.5V to 5.5V operation and balanced noise immunity at 30% of the supply voltage
  • Contains six flip-flops with single-rail outputs
  • Buffered inputs
  • Speed of Bipolar F, AS, and S, with significantly reduced power consumption
  • Balanced propagation delays
  • ±24mA output drive current
    • Fanout to 15 F devices
  • SCR-latchup-resistant CMOS process and circuit design

The CD74AC174 is a positive-edge-triggered D-type flip-flop with a direct clear (CLR) input and is designed for 1.5V to 5.5V VCC operation.

The CD74AC174 is a positive-edge-triggered D-type flip-flop with a direct clear (CLR) input and is designed for 1.5V to 5.5V VCC operation.
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CD74ACT174 활성 리셋을 지원하는 16진 D형 플립플롭 Voltage range 4.5V to 5.5V, average propagation delay 8ns, average drive strength 24mA

기술 자료

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상위 문서 유형 직함 형식 옵션 최신 영어 버전 다운로드 날짜
* 데이터 시트 CD74AC174 Hex D-type Flip-Flop with Clear datasheet (Rev. C) PDF | HTML 2024. 10. 1
애플리케이션 노트 Power-Up Behavior of Clocked Devices (Rev. B) PDF | HTML 2022. 12. 15

설계 및 개발

추가 조건 또는 필수 리소스는 사용 가능한 경우 아래 제목을 클릭하여 세부 정보 페이지를 확인하세요.

평가 보드

14-24-LOGIC-EVM — 14핀~24핀 D, DB, DGV, DW, DYY, NS 및 PW 패키지용 로직 제품 일반 평가 모듈

14-24-LOGIC-EVM 평가 모듈(EVM)은 14핀~24핀 D, DW, DB, NS, PW, DYY 또는 DGV 패키지에 있는 모든 로직 장치를 지원하도록 설계되었습니다.

사용 설명서: PDF | HTML
지원되는 제품 및 하드웨어
재고 있음
제한:
??asset.out-of-stock-ti_ko_KR??
이용할 수 없음
패키지 핀 CAD 기호, 풋프린트 및 3D 모델
SOIC (D) 16 Ultra Librarian
WQFN (BQB) 16 Ultra Librarian
PDIP (N) 16 Ultra Librarian
TSSOP (PW) 16 Ultra Librarian
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