ZHCSC13C November   2013  – June 2024 UCC27524A-Q1

PRODUCTION DATA  

  1.   1
  2. 1 特性
  3. 2 应用
  4. 3 说明
  5. 4 说明（续）
  6. 5 引脚配置和功能
  7. 6 规格
    1. 6.1 绝对最大额定值
    2. 6.2 ESD 等级
    3. 6.3 建议运行条件
    4. 6.4 热性能信息
    5. 6.5 电气特性
    6. 6.6 开关特性
    7. 6.7 时序图
    8. 6.8 典型特性
  8. 7 详细说明
    1. 7.1 概述
    2. 7.2 功能方框图
    3. 7.3 特性说明
      1. 7.3.1 工作电源电流
      2. 7.3.2 输入级
      3. 7.3.3 使能功能
      4. 7.3.4 输出级
    4. 7.4 低传播延迟和紧密匹配的输出
    5. 7.5 器件功能模式
  9. 8 应用和实施
    1. 8.1 应用信息
    2. 8.2 典型应用
      1. 8.2.1 设计要求
      2. 8.2.2 详细设计过程
        1. 8.2.2.1 VDD 和欠压锁定
        2. 8.2.2.2 驱动电流和功率损耗
      3. 8.2.3 应用曲线
  10. 9 电源相关建议
  11. 10布局
    1. 10.1 布局指南
    2. 10.2 布局示例
    3. 10.3 散热注意事项
  12. 11器件和文档支持
    1. 11.1 器件支持
      1. 11.1.1 第三方产品免责声明
    2. 11.2 接收文档更新通知
    3. 11.3 支持资源
    4. 11.4 商标
    5. 11.5 静电放电警告
    6. 11.6 术语表
  13. 12修订历史记录
  14. 13机械、封装和可订购信息

8.2.2.1 VDD 和欠压锁定

UCC27524A-Q1 器件的 VDD 引脚电源电路块具有内部欠压锁定 (UVLO) 保护特性。当 VDD 上升且电平仍低于 UVLO 阈值时，无论输入状态如何，该电路都会将输出保持为低电平。UVLO 通常为 4V，通常具有 300mV 的迟滞。当低 VDD 电源电压具有来自电源的噪声时，以及在系统开始进行开关、IDD 突然增加的情况下 VDD 偏置电压下降时，该迟滞有助于防止发生抖动。它能够在低电压电平（如低于 5V）下运行，并具有出色的开关特性，尤其适合驱动新兴的 GaN 功率半导体器件。

例如，在上电时，如果使能引脚激活或悬空，UCC27524A-Q1 驱动器器件输出会保持低电平，直到 VDD 电压达到 UVLO 阈值。OUT 信号的幅度随 VDD 的增加而增加，直到达到稳定状态 VDD。图 8-2 中的运行表明，输出保持在低电平，直到达到 UVLO 阈值，然后输出与输入同相。

由于器件通过 VDD 引脚消耗电流，以便对所有内部电路进行偏置，因此，为了实现出色的高速电路性能，建议使用两个 VDD 旁路电容器来防止出现噪声问题。强烈建议使用表面贴装组件。必须将一个 0.1μF 陶瓷电容器放置在尽可能靠近栅极驱动器器件的 VDD 至 GND 引脚的位置。此外，必须以并联方式在非常靠近的位置连接一个具有相对较低 ESR 的更大电容器（例如 1μF），以帮助提供负载需要的高电流峰值。电容器的并联组合具有低阻抗特性，以便在应用中实现预期的电流电平和开关频率。

UCC27524A-Q1 使同相驱动器上电图 8-2 使同相驱动器上电