KOKT054 February   2024 LM5155 , LM51551 , LM5156 , TPS55340

 

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John Betten

절연된 저전력 출력에 어떤 토폴로지를 사용할 것인지 묻는 메시지가 나타나면 첫 번째 생각은 플라이백일 가능성이 있습니다. 플라이백은 저렴한 비용, 적은 부품 수, 추가 출력 추가 용이성과 같은 이점을 갖춘 탁월한 토폴로지이지만 여전히 몇 가지 단점이 있습니다. 플라이백 변압기 누설 인덕턴스와 관련된 FET(전계 효과 트랜지스터) 및 정류기 링잉은 EMI(전자기 간섭)를 생성하고, 구성 요소 응력을 높이고 효율성을 낮춥니다. 또한 다중 출력이 있을 때, 특히 폭넓은 부하 변동에서 잘 조정된 전압을 얻는 것이 어려울 수 있습니다. 단일 종단 1차 인덕터 컨버터(SEPIC) 절연으로 대체 접근 방식을 제공하고 이러한 문제를 일부 완화하는 방법을 살펴보겠습니다.

SEPIC는 비절연 토폴로지입니다. 그러나 플라이백과 마찬가지로 변압기 권선을 쉽게 추가하여 절연 출력을 만들 수 있습니다. 그림 1의 간소화된 회로도는 왼쪽에 단일 비절연 출력을 생성하고 오른쪽에 2개의 추가 절연 출력을 생성하는 표준 SEPIC 컨버터를 보여줍니다. 첫 번째 절연 권선은 5V 선형 레귤레이터에 입력으로 정격 6V 출력을 공급합니다. 두 번째 절연 권선은 첫 번째 권선 위에 쌓여 비조정 12V 출력을 생성합니다.

이 권선의 에너지가 세 개의 출력 모두로 동시에 전달되므로 VOUT1의 변압기 권선과 절연 권선(VOUT2, VOUT3 ) 사이에 긴밀한 커플링이 필요합니다. 이러한 권선 사이의 누설 인덕턴스는 전압 조정을 저하시킬 뿐입니다. 그러나 SEPIC의 1차 권선과 VOUT1 권선 사이에 정밀한 커플링은 ‌‌ 필요하지‌‌ 않습니다. 커패시터 CAC가 부스트 FET가 꺼질 때 VOUT1로 누설 에너지를 위한 낮은 임피던스 경로를 제공하기 때문에 FET 링잉이 최소화됩니다. SEPIC의 1차 권선 전압 파형은 플라이백보다 링잉이 훨씬 적기 때문에 특히 스파이크 피크 감지가 자주 발생하는 극심한 크로스 부하 조건에서 출력 전압 조정을 개선할 수 있습니다.

GUID-3DE533AC-AEC9-4CAD-84B1-CD08713E47A8-low.jpg그림 1 추가 권선이 있는 SEPIC 컨버터는 절연 출력을 제공합니다.

모든 SEPIC에서 마찬가지로, 1차 및 VOUT1 사이의 변환 비율은 1:1이어야 합니다. 하지만 다른 모든 출력은 이 변환 비율에 구속되지 않으며, 필요한 출력 전압을 제공하도록 조정하면 방정식 1로 쉽게 계산할 수 있습니다.

방정식 1. NxN1 = VOUT x + Vdiode xVOUT 1+ Vdiode 1

그림 2은 SEPIC과 플라이백 간의 FET 전압 링잉의 차이를 보여줍니다. CAC를 제거하여 플라이백으로 변환하는 간단한 방법으로 SEPIC 회로에서 플라이백 FET 전압 파형을 얻을 수 있습니다. FET에서 링잉 제거는 절연 출력으로 발생하는 비결합 에너지를 크게 줄여 조정을 개선합니다.

GUID-13F50BAA-F3CD-4098-8468-E164564DCB41-low.png그림 2 SEPIC FET의 전압 링잉은 플라이백보다 적으므로 스트레스를 낮추고 출력 전압 조정을 개선합니다.

그림 3그림 4에서 조정 데이터를 얻는 데 사용되는 테스트 회로 회로도이며, 그림 5은 실제 하드웨어의 사진을 보여줍니다. 이 설계는 VOUT1의 조정 전압에 1차측 피드백을사용합니다. 절연 출력은 합리적인 전압 조정을 위해 정밀한 변압기 커플링과 소형 프리부하를 조합하여 사용합니다. 선형 레귤레이터는 절연된 5V 출력을 일정하게 유지하므로 최소 및 최대 입력이 가장 중요합니다. 선형 레귤레이터에 대한 입력이 너무 낮으면 출력 전압이 떨어질 수 있습니다. 반대로 선형 레귤레이터에 대한 입력이 너무 높으면 과도한 전력이 소모됩니다.

절연 출력에 대한 조정 데이터는 극한의 크로스 부하 조건에서 최악의 경우 최소 및 최대 전압이 발생한다는 것을 보여줍니다. 절연 권선에서 최소 전압을 볼 수 있으며 VOUT1이 무부하 상태에서 최대 부하입니다. 절연 권선의 최대 전압은 무부하 상태에서 발생하며 VOUT1은 최대 부하 상태에서 발생합니다. 테스트 데이터를 바탕으로 ±4% 미만의 조정 편차를 측정했습니다. 이러한 결과가 모든 설계를 나타내는 것은 아니지만, 유사한 설계가 합리적으로 ± 5% 전압 조정을 달성할 수 있다는 반면, 플라이백은 최소 몇% 이상 높을 가능성이 높습니다.

전원 팁 #78에 설명된 Brian King의 설명에 따라 동기 정류기를 구현함으로써 플라이백의 교차 조정을 크게 개선할 수 있습니다. 그러나 이러한 개선에는 더 저렴한 FET와 추가 드라이브 회로를 사용해야 합니다. 절연 SEPIC 컨버터에 동일한 기술을 적용할 수 있지만 비절연 출력을 위한 정류기도 동기 방식이어야 합니다. 이전의 TI 블로그 게시물에서 동기 SEPIC을 손쉽게 구현하는 방법을 설명했습니다.

GUID-A8A01236-A410-4983-BE2B-27B67F3DE519-low.png그림 3 듀얼 절연 출력을 사용한 실제 SEPIC 설계.
GUID-CFDDB2CF-71DE-4860-9E63-419FE9374525-low.png그림 4 측정된 전압 조절 데이터.
GUID-F734B8C7-5092-4D23-90BB-2AAAD99D96C9-low.jpg그림 5 프로토타입 회로 하드웨어.

절연 SEPIC 컨버터는 절연 출력 전압을 추가하기 위한 첫 번째 선택이 아닐 수도 있지만, 플라이백보다 누설 인덕턴스 관련 링잉에 대한 내성이 높아 출력 전압 조절을 개선할 수 있습니다. 이로 인해 추가적인 사후 조정이 필요 없게 되어 비용을 절약할 수 있습니다.

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