SN74LVC165A
- Operating range from 1.1V to 3.6V
- Over-voltage tolerant inputs support up to 5.5V independent of VCC
- Supports partial-power-down with back drive protection (Ioff)
-
High push-pull output drive strength:
- ±24mA at 3.3V
- ±8mA at 2.3V
- ±4mA at 1.65V
- Maximum propagation delay of 20ns at 3.3V
- Latch-up performance exceeds 100mAper JESD78
The SN74LVC165A contains one 8-bit parallel-load shift register. Data is loaded asynchronously using the shift or load (SH/LD) select pin. The device includes a serial (SER) input to allow for daisy chaining, and a standard (QH) and inverted (QH) output.
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| 重要文件 | 類型 | 標題 | 格式選項 | 下載最新的英文版本 | 日期 | |
|---|---|---|---|---|---|---|
| * | 資料表 | SN74LVC165A 8-Bit Parallel-Load Shift Registers datasheet | PDF | HTML | 2024/5/30 |
設計與開發
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開發板
14-24-LOGIC-EVM — 適用於 14 針腳至 24 針腳 D、DB、DGV、DW、DYY、NS 和 PW 封裝的邏輯產品通用評估模組
14-24-LOGIC-EVM 評估模組 (EVM) 設計用於支援任何 14 針腳至 24 針腳 D、DW、DB、NS、PW、DYY 或 DGV 封裝的任何邏輯裝置。
開發板
14-24-NL-LOGIC-EVM — 適用於 14 針腳至 24 針腳無引線封裝的邏輯產品通用評估模組
14-24-NL-LOGIC-EVM 是一款靈活的評估模組 (EVM)，設計用於支援任何具有 14 針腳至 24 針腳 BQA、BQB、RGY、RSV、RJW 或 RHL 封裝的邏輯或轉換裝置。
| 封裝 | 針腳 | CAD 符號、佔位空間與 3D 模型 |
|---|---|---|
| TSSOP (PW) | 16 | Ultra Librarian |
| WQFN (BQB) | 16 | Ultra Librarian |
| SOIC (D) | 16 | Ultra Librarian |