產品詳細資料

Technology family LV-A Number of channels 8 IOL (max) (mA) 16 Supply current (max) (µA) 20 IOH (max) (mA) -16 Input type Standard CMOS Output type 3-State Features Balanced outputs, Over-voltage tolerant inputs, Partial power down (Ioff), Very high speed (tpd 5-10ns) Rating Catalog Operating temperature range (°C) -40 to 125
Technology family LV-A Number of channels 8 IOL (max) (mA) 16 Supply current (max) (µA) 20 IOH (max) (mA) -16 Input type Standard CMOS Output type 3-State Features Balanced outputs, Over-voltage tolerant inputs, Partial power down (Ioff), Very high speed (tpd 5-10ns) Rating Catalog Operating temperature range (°C) -40 to 125
VSSOP (DGS) 20 24.99 mm² (5.1 mm × 4.9 mm) VQFN (RGY) 20 15.75 mm² (4.5 mm × 3.5 mm) SOP (NS) 20 98.28 mm² (12.6 mm × 7.8 mm) TSSOP (PW) 20 41.6 mm² (6.5 mm × 6.4 mm) SOIC (DW) 20 131.84 mm² (12.8 mm × 10.3 mm) VQFN (RKS) 20 11.25 mm² (4.5 mm × 2.5 mm) SSOP (DB) 20 56.16 mm² (7.2 mm × 7.8 mm)
  • Operation of 2-V to 5.5-V V CC
  • Max t pd of 6 ns at 5 V
  • Typical V OLP (output ground bounce) < 0.8 V at V CC = 3.3 V, T A = 25°C
  • Typical V OHV (output V OH undershoot) > 2.3 V at V CC = 3.3 V, T A = 25°C
  • Support mixed-mode voltage operation on all ports
  • I off supports partial-power-down mode operation
  • Latch-up performance exceeds 250 mA per JESD 17
  • Operation of 2-V to 5.5-V V CC
  • Max t pd of 6 ns at 5 V
  • Typical V OLP (output ground bounce) < 0.8 V at V CC = 3.3 V, T A = 25°C
  • Typical V OHV (output V OH undershoot) > 2.3 V at V CC = 3.3 V, T A = 25°C
  • Support mixed-mode voltage operation on all ports
  • I off supports partial-power-down mode operation
  • Latch-up performance exceeds 250 mA per JESD 17

The SN74LV541A device is an octal buffer/driver designed for 2-V to 5.5-V V CC operation.

The SN74LV541A device is an octal buffer/driver designed for 2-V to 5.5-V V CC operation.

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* 資料表 SN74LV541A Octal Buffers/Drivers With 3-State Outputs datasheet (Rev. N) PDF | HTML 2023/8/2
使用指南 TI Power Reference Design for Xilinx® Zynq 7000 (ZC702) (Rev. A) 2014/12/16
測試報告 TI Power Reference Design for Xilinx(R) Virtex(R)-7 (VC709) (Rev. A) 2014/12/16
測試報告 PMP7977 Test Results (Rev. A) 2014/6/11
測試報告 TI Power Reference Design for Xilinx® Artix®-7 (AC701) 2014/5/12
使用指南 PMP7977 User's Guide 2013/9/11

設計與開發

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開發板

14-24-LOGIC-EVM — 適用於 14 針腳至 24 針腳 D、DB、DGV、DW、DYY、NS 和 PW 封裝的邏輯產品通用評估模組

14-24-LOGIC-EVM 評估模組 (EVM) 設計用於支援任何 14 針腳至 24 針腳 D、DW、DB、NS、PW、DYY 或 DGV 封裝的任何邏輯裝置。

使用指南: PDF | HTML
支援產品和硬體
有庫存
限制:
??asset.out-of-stock-ti_zh_TW??
無法提供
開發板

14-24-NL-LOGIC-EVM — 適用於 14 針腳至 24 針腳無引線封裝的邏輯產品通用評估模組

14-24-NL-LOGIC-EVM 是一款靈活的評估模組 (EVM),設計用於支援任何具有 14 針腳至 24 針腳 BQA、BQB、RGY、RSV、RJW 或 RHL 封裝的邏輯或轉換裝置。

使用指南: PDF | HTML
支援產品和硬體
有庫存
限制:
??asset.out-of-stock-ti_zh_TW??
無法提供
模擬型號

HSPICE MODEL OF SN74LV541A

SCEJ189.ZIP (100 KB) - HSpice 模型
支援產品和硬體
模擬型號

SN74LV541A Behavioral SPICE Model

SCEM649.ZIP (7 KB) - PSpice 模型
支援產品和硬體
模擬型號

SN74LV541A IBIS Model

SCEM144.ZIP (18 KB) - IBIS 模型
支援產品和硬體
參考設計

PMP7977 — 具有 PMBus 電源管理的 Xilinx Artix 7 FPGA 參考設計

The Artix 7 power management reference design board uses power modules, linear regulators, and a PMBus compliant system controller to supply all required core and auxiliary voltages needed by the FPGA, including DDR memory termination. A Digital Power graphical user interface is used to monitor the (...)

支援產品和硬體
封裝 針腳 CAD 符號、佔位空間與 3D 模型
VSSOP (DGS) 20 Ultra Librarian
VQFN (RGY) 20 Ultra Librarian
SOP (NS) 20 Ultra Librarian
TSSOP (PW) 20 Ultra Librarian
SOIC (DW) 20 Ultra Librarian
VQFN (RKS) 20 Ultra Librarian
SSOP (DB) 20 Ultra Librarian

訂購與品質

支援與培訓

內含 TI 工程師技術支援的 TI E2E™ 論壇

內容係由 TI 和社群貢獻者依「現狀」提供,且不構成 TI 規範。檢視使用條款

若有關於品質、封裝或訂購 TI 產品的問題,請參閱 TI 支援。​​​​​​​​​​​​​​

影片