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數位轉類比轉換器 (DAC)
高速 DAC (>10 MSPS)

DAC38RF80

現行

雙通道、14 位元、9-GSPS、6x-24x 內插、6 & 9 GHz PLL 數位轉類比轉換器 (DAC)

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產品規格表

DAC38RF80

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產品詳細資料

Resolution (Bits) 14 Number of DAC channels 2 Interface type JESD204B Sample/update rate (Msps) 9000 Features Ultra High Speed Rating Catalog Interpolation 10x, 12x, 16x, 18x, 20x, 24x, 6x, 8x Power consumption (typ) (mW) 3800 SFDR (dB) 94 Architecture Current Source Operating temperature range (°C) -40 to 85 Reference type Ext, Int
Resolution (Bits) 14 Number of DAC channels 2 Interface type JESD204B Sample/update rate (Msps) 9000 Features Ultra High Speed Rating Catalog Interpolation 10x, 12x, 16x, 18x, 20x, 24x, 6x, 8x Power consumption (typ) (mW) 3800 SFDR (dB) 94 Architecture Current Source Operating temperature range (°C) -40 to 85 Reference type Ext, Int
FCCSP (AAV) 144 100 mm² (10 mm × 10 mm)
  • 14-bit resolution
  • Maximum DAC sample rate: 9 GSPS
  • Key Specifications:
    • RF full-scale output power at 2.1 GHz:
      • DAC38RF80/90/84: 0 dBm
      • DAC38RF83/93/85: 3 dBm (with 2:1 balun)
    • Spectral performance(on-chip PLL, DIFF):
      • fDAC = 5898.24 MSPS, fOUT = 2.14 GHz
        • WCDMA ACLR: 75 dBc
        • WCDMA alt-ACLR: 77 dBc
      • fDAC = 8847.36 MSPS, fOUT = 3.7 GHz
        • 20 MHz LTE ACLR: 63 dBc
      • fDAC = 9 GSPS, fOUT = 1.8 GHz
        • IMD3 = 70 dBc (–6 dBFS, 10-MHz tone spacing)
        • NSD = –157 dBc/Hz
  • Dual-band digital up-converter per DAC
    • 6, 8, 10, 12, 16, 18, 20 or 24x interpolation
    • 4 Independent NCOs with 48-bit resolution
  • JESD204B Interface, subclass 1
    • Support for multichip synchronization
    • Maximum lane rate: 12.5 Gbps
  • Single-ended output with integrated balun (DAC38RF80/90/84) covering 700 MHz to 3800 MHz
  • Internal PLL and VCO with bypass
    • fC(VCO) = 5.9 or 8.9 GHz
  • Power dissipation: 1.4 to 2.2 W/ch
  • Power supplies: –1.8 V, 1 V, 1.8 V
  • Package: 10 x 10 mm BGA, 0.8 mm pitch, 144-balls
  • 14-bit resolution
  • Maximum DAC sample rate: 9 GSPS
  • Key Specifications:
    • RF full-scale output power at 2.1 GHz:
      • DAC38RF80/90/84: 0 dBm
      • DAC38RF83/93/85: 3 dBm (with 2:1 balun)
    • Spectral performance(on-chip PLL, DIFF):
      • fDAC = 5898.24 MSPS, fOUT = 2.14 GHz
        • WCDMA ACLR: 75 dBc
        • WCDMA alt-ACLR: 77 dBc
      • fDAC = 8847.36 MSPS, fOUT = 3.7 GHz
        • 20 MHz LTE ACLR: 63 dBc
      • fDAC = 9 GSPS, fOUT = 1.8 GHz
        • IMD3 = 70 dBc (–6 dBFS, 10-MHz tone spacing)
        • NSD = –157 dBc/Hz
  • Dual-band digital up-converter per DAC
    • 6, 8, 10, 12, 16, 18, 20 or 24x interpolation
    • 4 Independent NCOs with 48-bit resolution
  • JESD204B Interface, subclass 1
    • Support for multichip synchronization
    • Maximum lane rate: 12.5 Gbps
  • Single-ended output with integrated balun (DAC38RF80/90/84) covering 700 MHz to 3800 MHz
  • Internal PLL and VCO with bypass
    • fC(VCO) = 5.9 or 8.9 GHz
  • Power dissipation: 1.4 to 2.2 W/ch
  • Power supplies: –1.8 V, 1 V, 1.8 V
  • Package: 10 x 10 mm BGA, 0.8 mm pitch, 144-balls

The DAC38RFxx is a family of high-performance, dual/single-channel, 14-bit, 9-GSPS, RF-sampling digital-to-analog converters (DACs) that are capable of synthesizing wideband signals from 0 to 4.5 GHz. A high dynamic range allows the DAC38RFxx family to generate signals for a wide range of applications including 3G/4G signals for wireless base-stations and radar.

The devices feature a low-power JESD204B Interface with up to 8 lanes with a maximum bit rate of 12.5 Gbps allowing an input data rate of 1.25 GSPS complex per channel. The DAC38RFxx provides two digital up-converters per channel, with multiple options for interpolation rates. A digital quadrature modulator with independent, frequency flexible NCOs are available to support multi-band operation. An optional low-jitter PLL/VCO simplifies the DAC sampling clock generation by allowing use of a lower frequency reference clock.

The DAC38RFxx is a family of high-performance, dual/single-channel, 14-bit, 9-GSPS, RF-sampling digital-to-analog converters (DACs) that are capable of synthesizing wideband signals from 0 to 4.5 GHz. A high dynamic range allows the DAC38RFxx family to generate signals for a wide range of applications including 3G/4G signals for wireless base-stations and radar.

The devices feature a low-power JESD204B Interface with up to 8 lanes with a maximum bit rate of 12.5 Gbps allowing an input data rate of 1.25 GSPS complex per channel. The DAC38RFxx provides two digital up-converters per channel, with multiple options for interpolation rates. A digital quadrature modulator with independent, frequency flexible NCOs are available to support multi-band operation. An optional low-jitter PLL/VCO simplifies the DAC sampling clock generation by allowing use of a lower frequency reference clock.
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* 資料表 DAC38RFxx Dual- or Single-Channel, Single-Ended or Differential Output, 14-Bit, 9-GSPS, RF-Sampling DAC With JESD204B Interface and On-Chip PLL datasheet (Rev. D) PDF | HTML 2023/12/28
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應用說明 Eye Scan Testing with the DAC38RFxx 2017/8/10
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應用說明 DAC38RF8x Test Modes 2017/7/25
應用說明 Digital RF Power Control for Power Amplifer Protection in Wireless Base 2017/2/6
應用說明 RF Sampling DAC with 800 MHz of IBW LTE 2016/10/28
設計指南 Efficient Power Supply Scheme for RF-Sampling DAC Reference Design 2016/8/22

設計與開發

如需其他條款或必要資源，請按一下下方的任何標題以檢視詳細頁面 (如有)。

開發板

DAC38RF80EVM — DAC38RF80 雙通道、14 位元、9GSPS、6x-24x 內插、6 和 9GHz PLL DAC 評估模組

DAC38RF80EVM 是用於評估 DAC38RF80/84/90 數位類比轉換器 (DAC) 的電路板。EVM 可用於評估高達 9GSPS 取樣率的 DAC 性能。此設計可搭配基於 FPGA 的圖型產生器卡 TSW14J56EVM（Rev B 及以上版本）協同運作。EVM 中提供的 FMC 連接器亦可將 DAC 與第三方廠商的 FPGA 開發板進行介接。同時提供易於使用的軟體介面，可透過 SPI 控制 DAC 與板載的 LMK04828 時鐘晶片。

使用指南: PDF
支援產品和硬體
有庫存
限制：
??asset.out-of-stock-ti_zh_TW??
無法提供
開發板

TSW40RF80EVM — 具有雙通道 14 位元 3 GSPS ADC/9 GSPS DAC 時鐘解決方案的 2T2R 射頻取樣收發器評估模組

TSW40RF80 評估模組 (EVM) 是二發射二接收 (2T2R) 射頻取樣收發器參考設計。本模組包含 DAC38RF80 雙通道射頻取樣數位轉類比轉換器 (DAC) 及 ADC32RF45 雙通道射頻取樣類比轉數位轉換器 (ADC)。

DAC38RF80 取樣率最高可運作 9 GSPS，包括用於產生高頻時鐘的板載 PLL/VCO。輸出為單端，可輕鬆從介面連接 50-Ω 電路。ADC32RF45 取樣率最高可運作 3 GSPS。可選擇在各通道中使用雙數位降壓轉換器，或繞過轉換器以存取完整 Nyquist 頻寬。

TSW40RF80EVM 包含 LMK04828 時脈產生器，用於為 DAC (...)

使用指南: PDF
支援產品和硬體
有庫存
限制：
??asset.out-of-stock-ti_zh_TW??
無法提供
韌體

SLAC771 — Arria10 + DAC38RF82 Design Firmware

支援產品和硬體
韌體

SLAC779 — DAC38RF8x KCU105 Firmware

支援產品和硬體
韌體

TI204C-IP — Request for JESD204 rapid design IP

JESD204 快速設計 IP 被設計用於幫助 FPGA 工程師快速實現可運作的 JESD204 系統，從而加速開發過程。該 IP 的架構設計使得下游數位處理和其他應用邏輯能夠隔離於 JESD204 通訊協定的大多數性能和時序關鍵約束之外。該 IP 能夠幫助設計人員減少韌體開發時間並簡化 FPGA 的整合。

JESD204 快速設計 IP 無需權利金，用於 TI 高速資料轉換器。TI 將協助使用者配置初始連結，針對特定 FPGA 平台與 TI 資料轉換器 JMODE 之間的使用進行自訂。TI 將在 IP 測試完成並準備部署後，透過安全下載連結提供 IP。

JESD204 快速設計 IP 支援下列 (...)

支援產品和硬體
開發模組 (EVM) 的 GUI

DATACONVERTERPRO-SW — 高速資料轉換器 Pro GUI 安裝程式，v5.31

這款高速資料轉換器專業 GUI 是一款 PC（與 Windows® XP/7/10 相容）程式，旨在協助評估大多數 TI 高速資料轉換器 [類比轉數位轉換器 (ADC) 和數位轉類比轉換器 (DAC)] 和類比前端 (AFE) 平台。DATACONVERTERPRO-SW 旨在支援整個 TSW14xxx 系列資料擷取和模式產生卡，為時域和頻域中的資料轉換器分析提供強大且快速的解決方案，並支援單音、多音和調變訊號。此 GUI 也與 TI 模式產生 GUI 相容，可快速合成單音、多音和調變訊號。

使用者可以向 DATACONVERTERPRO-SW 提供自訂模式，以載入到 TI DAC。支援從 (...)

支援產品和硬體
開發模組 (EVM) 的 GUI

SLAC722 — DAC38RF8x EVM GUI

支援產品和硬體
模擬型號

DAC38RF80 IBIS Model

SLAM304.ZIP (70 KB) - IBIS 模型
支援產品和硬體
模擬型號

DAC38RF8x IBIS-AMI Model (Rev. A)

SLAM343A.ZIP (24658 KB) - IBIS-AMI 模型
支援產品和硬體
參考設計

TIDA-01215 — 適用於最佳化射頻取樣 DAC 中的突波和相位雜訊的電源參考設計

此參考設計提供高效率的電源供應方案，可在不犧牲性能並縮小電路板面積和 BOM 的情況下，將射頻取樣 DAC38RF8x 數位轉類比資料轉換器 (DAC) 開機。此參考設計使用 DC/DC 交換器和 LDO 將 DAC38RF8x 開機，同時達到高類比性能（雜散與相位雜訊），並最大限度避免在電源效率方面做出取捨。此處概述的設計方法可延伸至其他射頻取樣資料轉換器的電源供應設計。
支援產品和硬體
參考設計

TIDA-01240 — 射頻取樣 S 波段雷達發送器參考設計

運用 DAC38RF80（一款 9GSPS 16 位元數位轉類比轉換器 (DAC)）的射頻取樣架構，展示適合 S 頻帶多功能相位陣列雷達 (MPAR) 的波形合成。RF 取樣發射架構可簡化訊號鏈，讓資料轉換器更貼近天線，實現靈活性與高性能。
支援產品和硬體
封裝 針腳 CAD 符號、佔位空間與 3D 模型
FCCSP (AAV) 144 Ultra Librarian
適用 TI 的評估品項標準條款與條件。

訂購與品質

建議產品可能具有與此 TI 產品相關的參數、評估模組或參考設計。

支援與培訓

內含 TI 工程師技術支援的 TI E2E™ 論壇

以英文檢視所有論壇主題

內容係由 TI 和社群貢獻者依「現狀」提供，且不構成 TI 規範。檢視使用條款。

若有關於品質、封裝或訂購 TI 產品的問題，請參閱 TI 支援。​​​​​​​​​​​​​​

影片