CD74AC74

現行

具有清除和預設功能的雙路正緣觸發 D 型正反器

產品詳細資料

Number of channels 2 Technology family AC Input type Standard CMOS Output type Push-Pull Clock frequency (max) (MHz) 125 IOL (max) (mA) 24 IOH (max) (mA) -24 Supply current (max) (µA) 80 Features Balanced outputs, High speed (tpd 10-50ns), Positive input clamp diode Operating temperature range (°C) -55 to 125 Rating Catalog
Number of channels 2 Technology family AC Input type Standard CMOS Output type Push-Pull Clock frequency (max) (MHz) 125 IOL (max) (mA) 24 IOH (max) (mA) -24 Supply current (max) (µA) 80 Features Balanced outputs, High speed (tpd 10-50ns), Positive input clamp diode Operating temperature range (°C) -55 to 125 Rating Catalog
PDIP (N) 14 181.42 mm² (19.3 mm × 9.4 mm) SOIC (D) 14 51.9 mm² (8.65 mm × 6 mm)
  • AC types feature 1.5V to 5.5V operation and balanced noise immunity at 30% of the supply
  • Speed of bipolar F, AS, and S, with significantly reduced power consumption
  • Balanced propagation delays
  • ±24mA output drive current – fanout to 15 F devices
  • SCR-latchup-resistant CMOS process and circuit design
  • AC types feature 1.5V to 5.5V operation and balanced noise immunity at 30% of the supply
  • Speed of bipolar F, AS, and S, with significantly reduced power consumption
  • Balanced propagation delays
  • ±24mA output drive current – fanout to 15 F devices
  • SCR-latchup-resistant CMOS process and circuit design

The ’AC74 dual positive-edge-triggered devices are D-type flip-flops.

The ’AC74 dual positive-edge-triggered devices are D-type flip-flops.

下載 觀看有字幕稿的影片 影片

您可能會感興趣的類似產品

open-in-new 比較替代產品
針腳對針腳的功能與所比較的裝置相同。
CD74HC74 現行 具有設定和重設功能的高速 CMOS 邏輯雙路正緣觸發 D 型正反器 Voltage range 2V to 6V, average propagation delay 20ns, average drive strength 8mA
SN74HCS74 現行 具有清除與預設功能的施密特觸發器輸入雙 D 型正緣觸發正反器 Voltage range 2V to 6V, average propagation delay 20ns, average drive strength 8mA
功能相似於所比較的產品。
SN74AHC74 現行 具有清除和預設功能的二路正緣觸發 D 型正反器 Voltage range 2V to 5.5V, average propagation delay 12ns, average drive strength 9mA

技術文件

找不到結果。請清除您的搜尋條件,然後再試一次。
檢視所有 2
重要文件 類型 標題 格式選項 下載最新的英文版本 日期
* 資料表 CDx4AC74 Dual Positive-Edge-Triggered D-Type Flip-Flops With Clear And Preset datasheet (Rev. E) PDF | HTML 2024/8/2
應用說明 Power-Up Behavior of Clocked Devices (Rev. B) PDF | HTML 2022/12/15

設計與開發

如需其他條款或必要資源,請按一下下方的任何標題以檢視詳細頁面 (如有)。

開發板

14-24-LOGIC-EVM — 適用於 14 針腳至 24 針腳 D、DB、DGV、DW、DYY、NS 和 PW 封裝的邏輯產品通用評估模組

14-24-LOGIC-EVM 評估模組 (EVM) 設計用於支援任何 14 針腳至 24 針腳 D、DW、DB、NS、PW、DYY 或 DGV 封裝的任何邏輯裝置。

使用指南: PDF | HTML
支援產品和硬體
有庫存
限制:
??asset.out-of-stock-ti_zh_TW??
無法提供
封裝 針腳 CAD 符號、佔位空間與 3D 模型
PDIP (N) 14 Ultra Librarian
SOIC (D) 14 Ultra Librarian

訂購與品質

支援與培訓

內含 TI 工程師技術支援的 TI E2E™ 論壇

內容係由 TI 和社群貢獻者依「現狀」提供,且不構成 TI 規範。檢視使用條款

若有關於品質、封裝或訂購 TI 產品的問題,請參閱 TI 支援。​​​​​​​​​​​​​​

影片