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正反器、鎖存器和暫存器
D 型正反器

CD74AC574

現行

具有 3 態輸出的八路非反相 D 型正反器

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產品規格表

CD74AC574

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產品詳細資料

Number of channels 8 Technology family AC Input type Standard CMOS Output type 3-State Clock frequency (max) (MHz) 125 IOL (max) (mA) 24 IOH (max) (mA) -24 Supply current (max) (µA) 160 Features Balanced outputs, High speed (tpd 10-50ns), Positive input clamp diode Operating temperature range (°C) -55 to 125 Rating Catalog
Number of channels 8 Technology family AC Input type Standard CMOS Output type 3-State Clock frequency (max) (MHz) 125 IOL (max) (mA) 24 IOH (max) (mA) -24 Supply current (max) (µA) 160 Features Balanced outputs, High speed (tpd 10-50ns), Positive input clamp diode Operating temperature range (°C) -55 to 125 Rating Catalog
SOIC (DW) 20 131.84 mm² (12.8 mm × 10.3 mm) PDIP (N) 20 228.702 mm² (24.33 mm × 9.4 mm)
  • SCR-latchup-resistant CMOS process and circuit design
  • Speed of bipolar FAST*/AS/S with significantly reduced power consumption
  • Balanced propagation delays
  • AC types feature 1.5V to 5.5V operation and balanced noise immunity at 30% of the supply
  • ± 24mA output drive current
    • Fanout to 15 FAST* ICs
    • Drives 50ohm transmission lines

(1)*FAST is a Registered Trademark of Fairchild Semiconductor Corp.
  • SCR-latchup-resistant CMOS process and circuit design
  • Speed of bipolar FAST*/AS/S with significantly reduced power consumption
  • Balanced propagation delays
  • AC types feature 1.5V to 5.5V operation and balanced noise immunity at 30% of the supply
  • ± 24mA output drive current
    • Fanout to 15 FAST* ICs
    • Drives 50ohm transmission lines

(1)*FAST is a Registered Trademark of Fairchild Semiconductor Corp.

The CDx4AC574 and the CDx4ACT574 octal D-type, 3-state, positive-edge-triggered flip-flops use the RCA ADVANCED CMOS technology.

The CDx4AC574 and the CDx4ACT574 octal D-type, 3-state, positive-edge-triggered flip-flops use the RCA ADVANCED CMOS technology.

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* 資料表 CDx4AC574, CDx4ACT574 Octal D-Type Flip-Flop, 3-State Positive-Edge-Triggered datasheet (Rev. A) PDF | HTML 2024/5/10
應用說明 Power-Up Behavior of Clocked Devices (Rev. B) PDF | HTML 2022/12/15

設計與開發

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開發板

14-24-LOGIC-EVM — 適用於 14 針腳至 24 針腳 D、DB、DGV、DW、DYY、NS 和 PW 封裝的邏輯產品通用評估模組

14-24-LOGIC-EVM 評估模組 (EVM) 設計用於支援任何 14 針腳至 24 針腳 D、DW、DB、NS、PW、DYY 或 DGV 封裝的任何邏輯裝置。

使用指南: PDF | HTML
支援產品和硬體
有庫存
限制：
??asset.out-of-stock-ti_zh_TW??
無法提供
封裝 針腳 CAD 符號、佔位空間與 3D 模型
SOIC (DW) 20 Ultra Librarian
PDIP (N) 20 Ultra Librarian
適用 TI 的評估品項標準條款與條件。

訂購與品質

支援與培訓

內含 TI 工程師技術支援的 TI E2E™ 論壇

以英文檢視所有論壇主題

內容係由 TI 和社群貢獻者依「現狀」提供，且不構成 TI 規範。檢視使用條款。

若有關於品質、封裝或訂購 TI 產品的問題，請參閱 TI 支援。​​​​​​​​​​​​​​

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