ADS5560
- 16-Bit Resolution
- Maximum Sample Rate:
- ADS5562: 80 MSPS
- ADS5560: 40 MSPS
- Total Power:
- 865 mW at 80 MSPS
- 674 mW at 40 MSPS
- No Missing Codes
- High SNR: 84 dBFS (3 MHz IF)
- SFDR: 85 dBc (3 MHz IF)
- Low-Frequency Noise Suppression Mode
- Programmable Fine Gain, 1-dB steps Until
6-dB Maximum Gain - Double Data-Rate (DDR) LVDS and Parallel
CMOS Output Options - Internal and External Reference Support
- 3.3-V Analog and Digital Supply
- Pin-for-Pin With ADS5547 Family
- 48-VQFN Package (7.00 mm × 7.00 mm)
The ADS556x is a high-performance 16-bit family of ADCs with sampling rates up to 80 MSPS. The device supports very-high SNR for input frequencies in the first Nyquist zone. The device includes a low-frequency noise suppression mode that improves the noise from DC to about 1 MHz.
In addition to high performance, the device offers several flexible features such as output interface (either Double Data Rate [DDR] LVDS or parallel CMOS) and fine gain in 1-dB steps until 6-dB maximum gain.
Innovative techniques, such as DDR LVDS and an internal reference that does not require external decoupling capacitors, have been used to achieve significant savings in pin count. This innovation results in a compact 7-mm × 7-mm 48-pin VQFN package.
The device can be put in an external reference mode, where the VCM pin behaves as the external reference input. For applications where power is important, the ADS556x device offers power down modes and automatic power scaling at lower sample rates.
The device is specified over the industrial temperature range of –40°C to 85°C.
技術文件
| 重要文件 | 類型 | 標題 | 格式選項 | 下載最新的英文版本 | 日期 | |
|---|---|---|---|---|---|---|
| * | 資料表 | ADS556x 16-Bit, 40 and 80 MSPS ADCs With DDR LVDS and CMOS Outputs datasheet (Rev. B) | PDF | HTML | 2016/1/13 | ||
| 應用說明 | Design Considerations for Avoiding Timing Errors during High-Speed ADC, LVDS Dat (Rev. A) | 2015/5/22 | ||||
| 應用說明 | Why Use Oversampling when Undersampling Can Do the Job? (Rev. A) | 2013/7/19 | ||||
| 應用說明 | Driving High-Speed ADCs: Circuit Topologies and System-Level Parameters (Rev. A) | 2010/9/10 | ||||
| 應用說明 | Smart Selection of ADC/DAC Enables Better Design of Software-Defined Radio | 2009/4/28 | ||||
| 應用說明 | CDCE72010 as a Clocking Solution for High-Speed Analog-to-Digital Converters | 2008/6/8 | ||||
| 應用說明 | Phase Noise Performance and Jitter Cleaning Ability of CDCE72010 | 2008/6/2 | ||||
| 應用說明 | QFN Layout Guidelines | 2006/7/28 |
設計與開發
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ADS5560EVM — ADS5560 16 位元、40-MSPS 類比轉數位轉換器評估模組
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HSADC-SPI-UTILITY — ADS5400 EVM GUI
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JITTER-SNR-CALC — Jitter and SNR calculator
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| 封裝 | 針腳 | CAD 符號、佔位空間與 3D 模型 |
|---|---|---|
| VQFN (RGZ) | 48 | Ultra Librarian |
訂購與品質
建議產品可能具有與此 TI 產品相關的參數、評估模組或參考設計。