SN74LVC166A
- Operating range from 1.1V to 3.6V
- Over-voltage tolerant inputs support up to 5.5V independent of VCC
- Supports partial-power-down with back drive protection (Ioff)
-
High push-pull output drive strength:
- ±24mA at 3.3V
- ±8mA at 2.3V
- ±4mA at 1.65V
- Maximum propagation delay of 11.2ns at 3.3V supply
- Latch-up performance exceeds 100mAper JESD78
The SN74LVC166A contains one 8-bit parallel-load shift register. Data is loaded synchronously using the shift or load (SH/LD) select and clock (CLK) inputs. The device includes a serial (SER) input to allow for daisy chaining and an asynchronous clear (CLR) input.
기술 자료
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| 상위 문서 | 유형 | 직함 | 형식 옵션 | 최신 영어 버전 다운로드 | 날짜 | |
|---|---|---|---|---|---|---|
| * | 데이터 시트 | SN74LVC166A 8-Bit Parallel-Load Shift Registers with Clear datasheet | PDF | HTML | 2024. 5. 30 |
설계 및 개발
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평가 보드
14-24-LOGIC-EVM — 14핀~24핀 D, DB, DGV, DW, DYY, NS 및 PW 패키지용 로직 제품 일반 평가 모듈
14-24-LOGIC-EVM 평가 모듈(EVM)은 14핀~24핀 D, DW, DB, NS, PW, DYY 또는 DGV 패키지에 있는 모든 로직 장치를 지원하도록 설계되었습니다.
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제한:
??asset.out-of-stock-ti_ko_KR??
이용할 수 없음
평가 보드
14-24-NL-LOGIC-EVM — 14핀~24핀 비 리드 패키지용 로직 제품 일반 평가 모듈
14-24-NL-LOGIC-EVM은 14핀~24핀 BQA, BQB, RGY, RSV, RJW 또는 RHL 패키지가 있는 로직 또는 변환 장치를 지원하도록 설계된 유연한 평가 모듈(EVM)입니다.
재고 있음
제한:
??asset.out-of-stock-ti_ko_KR??
이용할 수 없음
| 패키지 | 핀 | CAD 기호, 풋프린트 및 3D 모델 |
|---|---|---|
| TSSOP (PW) | 16 | Ultra Librarian |
| WQFN (BQB) | 16 | Ultra Librarian |
| SOIC (D) | 16 | Ultra Librarian |