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SN74LV4051A

활성

5V, 8:1, 1채널, 아날로그 멀티플렉서

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데이터 시트

SN74LV4051A

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제품 상세 정보

Configuration 8:1 Number of channels 1 Power supply voltage - single (V) 1.8, 2.5, 3.3, 5 Protocols Analog Ron (typ) (Ω) 22 CON (typ) (pF) 23.4 ON-state leakage current (max) (µA) 1 Bandwidth (MHz) 35 Operating temperature range (°C) -40 to 125 Input/output continuous current (max) (A) 0.025 Rating Catalog Drain supply voltage (max) (V) 5.5
Configuration 8:1 Number of channels 1 Power supply voltage - single (V) 1.8, 2.5, 3.3, 5 Protocols Analog Ron (typ) (Ω) 22 CON (typ) (pF) 23.4 ON-state leakage current (max) (µA) 1 Bandwidth (MHz) 35 Operating temperature range (°C) -40 to 125 Input/output continuous current (max) (A) 0.025 Rating Catalog Drain supply voltage (max) (V) 5.5
SOP (NS) 16 79.56 mm² (10.2 mm × 7.8 mm) TSSOP (PW) 16 32 mm² (5 mm × 6.4 mm) SSOP (DB) 16 48.36 mm² (6.2 mm × 7.8 mm) SOT-23-THN (DYY) 16 8.4 mm² (4.2 mm × 2 mm) VQFN (RGY) 16 14 mm² (4 mm × 3.5 mm) SOIC (D) 16 59.4 mm² (9.9 mm × 6 mm) TVSOP (DGV) 16 23.04 mm² (3.6 mm × 6.4 mm) PDIP (N) 16 181.42 mm² (19.3 mm × 9.4 mm)
  • 1.65V to 5.5V VCC operation
  • Support mixed-mode voltage operation on all ports
  • High on-off output-voltage ratio
  • Low crosstalk between switches
  • Individual switch controls
  • Extremely low input current
  • Latch-up performance exceeds 100mA per JESD 78, class II
  • ESD protection exceeds JESD 22
    • 2000V human-body model (A114-A)
    • 200V machine model (A115-A)
    • 1000V charged-device model (C101)
  • 1.65V to 5.5V VCC operation
  • Support mixed-mode voltage operation on all ports
  • High on-off output-voltage ratio
  • Low crosstalk between switches
  • Individual switch controls
  • Extremely low input current
  • Latch-up performance exceeds 100mA per JESD 78, class II
  • ESD protection exceeds JESD 22
    • 2000V human-body model (A114-A)
    • 200V machine model (A115-A)
    • 1000V charged-device model (C101)

The SN74LV4051A 8-channel CMOS analog multiplexers and demultiplexers are designed for 1.65V to 5.5V VCC operation.

The SN74LV4051A devices handle both analog and digital signals. Each channel permits signals with amplitudes up to 5.5V (peak) to be transmitted in either direction.

Applications include: signal gating, chopping, modulation or demodulation (modem), and signal multiplexing for analog-to-digital and digital-to-analog conversion systems.

The SN74LV4051A 8-channel CMOS analog multiplexers and demultiplexers are designed for 1.65V to 5.5V VCC operation.

The SN74LV4051A devices handle both analog and digital signals. Each channel permits signals with amplitudes up to 5.5V (peak) to be transmitted in either direction.

Applications include: signal gating, chopping, modulation or demodulation (modem), and signal multiplexing for analog-to-digital and digital-to-analog conversion systems.
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기술 자료

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상위 문서 유형 직함 형식 옵션 최신 영어 버전 다운로드 날짜
* 데이터 시트 SN74LV4051A 8-Channel Analog Multiplexers and Demultiplexers datasheet (Rev. K) PDF | HTML 2024. 9. 11
Product overview Enhancing Smart Metering with TI Multiplexers and Analog Switches PDF | HTML 2025. 1. 28
애플리케이션 노트 Selecting the Correct Texas Instruments Signal Switch (Rev. E) PDF | HTML 2022. 6. 2
애플리케이션 노트 Multiplexers and Signal Switches Glossary (Rev. B) PDF | HTML 2021. 12. 1

설계 및 개발

추가 조건 또는 필수 리소스는 사용 가능한 경우 아래 제목을 클릭하여 세부 정보 페이지를 확인하세요.

평가 보드

16DYYPWEVM — SOT-23 THIN(DYY) 및 TSSOP(PW) 패키지용 테스트 보드

16DYYPWEVM 테스트 보드는 SOT-23 THIN(DYY) 및 TSSOP(PW) 패키지를 위한 이중 풋프린트를 제공합니다.  이 테스트 보드는 16핀 SOT-23 THIN(DYY) 및 TSSOP(PW) 패키지의 통합 회로를 빠르게 프로토타이핑 및 테스트하는 데 사용됩니다. 
사용 설명서: PDF
지원되는 제품 및 하드웨어
재고 있음
제한:
??asset.out-of-stock-ti_ko_KR??
이용할 수 없음
인터페이스 어댑터

LEADED-ADAPTER1 — TI의 5, 8, 10, 16 및 24핀 리드 패키지의 빠른 테스트를 위한 DIP 헤더 어댑터에 대한 표면 실장

EVM-LEADED1 보드를 사용하면 TI의 공통 리드가 있는 패키지를 브레드보드 방식으로 빠르게 테스트할 수 있습니다.  이 보드에는 TI의 D, DBQ, DCT, DCU, DDF, DGS, DGV 및 PW 표면 실장 패키지를 100mil DIP 헤더로 변환할 수 있는 풋프린트가 있습니다.     

사용 설명서: PDF
지원되는 제품 및 하드웨어
재고 있음
제한:
??asset.out-of-stock-ti_ko_KR??
이용할 수 없음
인터페이스 어댑터

LEADLESS-ADAPTER1 — TI의 6, 8, 10, 12, 14, 16 및 20핀 리드 없는 패키지의 테스트를 위한 DIP 헤더 어댑터에 대한 표면 실장

EVM-LEADLESS1 보드를 사용하면 TI의 공통 리드가 없는 패키지를 브레드보드 방식으로 빠르게 테스트할 수 있습니다.  이 보드에는 TI의 DRC, DTP, DQE, RBW, RGY, RSE, RSV, RSW, RTE, RTJ, RUK, RUC, RUG, RUM, RUT 및 YZP 표면 실장 패키지를 100mil DIP 헤더로 변환할 수 있는 풋프린트가 있습니다.
사용 설명서: PDF
지원되는 제품 및 하드웨어
재고 있음
제한:
??asset.out-of-stock-ti_ko_KR??
이용할 수 없음
시뮬레이션 모델

SN74LV4051A PSpice Transient Model

SCLM117.ZIP (35 KB) - PSpice 모델
지원되는 제품 및 하드웨어
패키지 핀 CAD 기호, 풋프린트 및 3D 모델
SOP (NS) 16 Ultra Librarian
TSSOP (PW) 16 Ultra Librarian
SSOP (DB) 16 Ultra Librarian
SOT-23-THN (DYY) 16 Ultra Librarian
VQFN (RGY) 16 Ultra Librarian
SOIC (D) 16 Ultra Librarian
TVSOP (DGV) 16 Ultra Librarian
PDIP (N) 16 Ultra Librarian
TI의 평가 항목에 대한 표준 약관이 적용됩니다.

주문 및 품질

권장 제품에는 본 TI 제품과 관련된 매개 변수, 평가 모듈 또는 레퍼런스 디자인이 있을 수 있습니다.

지원 및 교육

TI 엔지니어의 기술 지원을 받을 수 있는 TI E2E™ 포럼

포럼 주제 모두 보기(영문)

콘텐츠는 TI 및 커뮤니티 기고자에 의해 "있는 그대로" 제공되며 TI의 사양으로 간주되지 않습니다. 사용 약관을 참조하십시오.

품질, 패키징, TI에서 주문하는 데 대한 질문이 있다면 TI 지원을 방문하세요. ​​​​​​​​​​​​​​

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