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SN74GTL2014

활성

GTL 트랜시버에 대한 4비트 LVTTL

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데이터 시트

SN74GTL2014

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제품 상세 정보

Bits (#) 4 Data rate (max) (Mbps) 100 Topology Open drain, Push-Pull Direction control (typ) Fixed-direction Vin (min) (V) 3 Vin (max) (V) 3.6 Vout (min) (V) 0.8 Vout (max) (V) 3.6 Applications GTL, SDIO Features Overvoltage tolerant inputs Technology family GTL Supply current (max) (mA) 10 Rating Catalog Operating temperature range (°C) -40 to 85
Bits (#) 4 Data rate (max) (Mbps) 100 Topology Open drain, Push-Pull Direction control (typ) Fixed-direction Vin (min) (V) 3 Vin (max) (V) 3.6 Vout (min) (V) 0.8 Vout (max) (V) 3.6 Applications GTL, SDIO Features Overvoltage tolerant inputs Technology family GTL Supply current (max) (mA) 10 Rating Catalog Operating temperature range (°C) -40 to 85
TSSOP (PW) 14 32 mm² (5 mm × 6.4 mm)
  • Operates as a GTL–/GTL/GTL+ to LVTTL or LVTTL to GTL–/GTL/GTL+ Translator
  • The LVTTL Inputs are Tolerant up to 5.5 V Allowing Direct Access to TTL or 5 V CMOS
  • The GTL Input/Output Operate up to 3.6 V, Allowing the Device to be Used in High Voltage Open-Drain Applications
  • VREF Goes Down to 0.5 V for Low Voltage CPU Usage
  • Partial Power-Down Permitted
  • Latch-up Protection Exceed 500 mA per JESD78
  • Package Option: TSSOP14
  • –40°C to 85°C Operating Temperature Range
  • ESD Protection on All Terminals
    • 2000 V HBM, JESD22-A114
    • 1000 V CDM, IEC61000-4-2
  • Operates as a GTL–/GTL/GTL+ to LVTTL or LVTTL to GTL–/GTL/GTL+ Translator
  • The LVTTL Inputs are Tolerant up to 5.5 V Allowing Direct Access to TTL or 5 V CMOS
  • The GTL Input/Output Operate up to 3.6 V, Allowing the Device to be Used in High Voltage Open-Drain Applications
  • VREF Goes Down to 0.5 V for Low Voltage CPU Usage
  • Partial Power-Down Permitted
  • Latch-up Protection Exceed 500 mA per JESD78
  • Package Option: TSSOP14
  • –40°C to 85°C Operating Temperature Range
  • ESD Protection on All Terminals
    • 2000 V HBM, JESD22-A114
    • 1000 V CDM, IEC61000-4-2

The SN74GTL2014 is a 4-channel translator to interface between 3.3-V LVTTL chip set I/O and Xeon processor GTL–/GTL/GTL+ I/O.

The SN74GTL2014 integrates ESD protection cells on all terminals and is available in a TSSOP package (5.0 mm × 4.4 mm). The device is characterized over the free air temperature range of –40°C to 85°C.

The SN74GTL2014 is a 4-channel translator to interface between 3.3-V LVTTL chip set I/O and Xeon processor GTL–/GTL/GTL+ I/O.

The SN74GTL2014 integrates ESD protection cells on all terminals and is available in a TSSOP package (5.0 mm × 4.4 mm). The device is characterized over the free air temperature range of –40°C to 85°C.

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기술 자료

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상위 문서 유형 직함 형식 옵션 최신 영어 버전 다운로드 날짜
* 데이터 시트 SN74GTL2014 4-Channel LVTTL to GTL Transceiver datasheet (Rev. A) PDF | HTML 2014. 10. 16
선택 가이드 Logic Guide (Rev. AC) PDF | HTML 2025. 11. 13
애플리케이션 노트 Schematic Checklist - A Guide to Designing with Auto-Bidirectional Translators PDF | HTML 2024. 7. 12
애플리케이션 노트 Understanding Transient Drive Strength vs. DC Drive Strength in Level-Shifters (Rev. A) PDF | HTML 2024. 7. 3
선택 가이드 Voltage Translation Buying Guide (Rev. A) 2021. 4. 15
애플리케이션 노트 Voltage Translation Between 3.3-V, 2.5-V, 1.8-V, and 1.5-V Logic Standards (Rev. B) 2015. 4. 30
애플리케이션 노트 Selecting the Right Level Translation Solution (Rev. A) 2004. 6. 22
애플리케이션 노트 Power-Up 3-State (PU3S) Circuits in TI Standard Logic Devices 2002. 5. 10
애플리케이션 노트 Logic in Live-Insertion Applications With a Focus on GTLP 2002. 1. 14
애플리케이션 노트 Achieving Maximum Speed on Parallel Buses With Gunning Transceiver Logic (GTLP) 2001. 4. 5
애플리케이션 노트 Basic Design Considerations for Backplanes (Rev. B) 2001. 4. 5
애플리케이션 노트 Fast GTLP Backplanes With the GTLPH1655 (Rev. A) 2000. 9. 19
애플리케이션 노트 GTLP in BTL Applications 2000. 7. 31
애플리케이션 노트 High-Performance Backplane Design With GTL+ (Rev. A) 1999. 10. 25
애플리케이션 노트 GTL/BTL: A Low-Swing Solution for High-Speed Digital Logic (Rev. A) 1997. 3. 1

설계 및 개발

추가 조건 또는 필수 리소스는 사용 가능한 경우 아래 제목을 클릭하여 세부 정보 페이지를 확인하세요.

평가 보드

14-24-LOGIC-EVM — 14핀~24핀 D, DB, DGV, DW, DYY, NS 및 PW 패키지용 로직 제품 일반 평가 모듈

14-24-LOGIC-EVM 평가 모듈(EVM)은 14핀~24핀 D, DW, DB, NS, PW, DYY 또는 DGV 패키지에 있는 모든 로직 장치를 지원하도록 설계되었습니다.

사용 설명서: PDF | HTML
지원되는 제품 및 하드웨어
재고 있음
제한:
??asset.out-of-stock-ti_ko_KR??
이용할 수 없음
시뮬레이션 모델

SN74GTL2014 IBIS Model

SCLM111.ZIP (24 KB) - IBIS 모델
지원되는 제품 및 하드웨어
패키지 핀 CAD 기호, 풋프린트 및 3D 모델
TSSOP (PW) 14 Ultra Librarian
TI의 평가 항목에 대한 표준 약관이 적용됩니다.

주문 및 품질

지원 및 교육

TI 엔지니어의 기술 지원을 받을 수 있는 TI E2E™ 포럼

포럼 주제 모두 보기(영문)

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