SN74LVC1G139

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Produktdetails

Technology family

LVC

Number of channels

1

Operating temperature range (°C)

-40 to 85

Rating

Catalog

Supply current (max) (µA)

10

Technology family

LVC

Number of channels

1

Operating temperature range (°C)

-40 to 85

Rating

Catalog

Supply current (max) (µA)

10

SSOP (DCT)

8

11.8 mm² (2.95 mm × 4 mm)

VSSOP (DCU)

8

6.2 mm² (2 mm × 3.1 mm)

DSBGA (YZP)

8

2.8125 mm² (— mm × — mm)

Available in the Texas Instruments
NanoStar™ and NanoFree™ Packages
Supports 5-V V_CC Operation
Inputs Accept Voltages to 5.5 V
Supports Down Translation to V_CC
Maximum t_pd of 4.9 ns at 3.3 V and 15 pF
Low Power Consumption, 10-µA Maximum I_CC
±24-mA Output Drive at 3.3 V
I_off Supports Live Insertion, Partial-Power-Down Mode, and Back-Drive Protection
Latch-Up Performance Exceeds 100 mA Per JESD 78, Class II
ESD Protection Exceeds JESD22
- 2000-V Human-Body Model (A114-A)
- 200-V Machine Model (A115-A)
- 1000-V Charged-Device Model (C101)

Available in the Texas Instruments
NanoStar™ and NanoFree™ Packages
Supports 5-V V_CC Operation
Inputs Accept Voltages to 5.5 V
Supports Down Translation to V_CC
Maximum t_pd of 4.9 ns at 3.3 V and 15 pF
Low Power Consumption, 10-µA Maximum I_CC
±24-mA Output Drive at 3.3 V
I_off Supports Live Insertion, Partial-Power-Down Mode, and Back-Drive Protection
Latch-Up Performance Exceeds 100 mA Per JESD 78, Class II
ESD Protection Exceeds JESD22
- 2000-V Human-Body Model (A114-A)
- 200-V Machine Model (A115-A)
- 1000-V Charged-Device Model (C101)

This SN74LVC1G139 2-to-4 line decoder is designed for 1.65-V to 5.5-V V_CC operation.

The SN74LVC1G139 2-line to 4-line decoder is designed to be used in high-performance memory-decoding or data-routing applications requiring very short propagation delay times. In high-performance memory systems, this decoder can be used to minimize the effects of system decoding. When used with high-speed memories using a fast enable circuit, the delay times of these decoders and the enable time of the memory usually are less than the typical access time of the memory. This means that the effective system delay introduced by the decoder is negligible.

NanoStar and NanoFree package technology is a major breakthrough in device packaging concepts, using the die as the package.

This device is fully specified for partial-power-down applications using I_off. The I_off circuitry disables the outputs, preventing damaging current backflow through the device when it is powered down.

This SN74LVC1G139 2-to-4 line decoder is designed for 1.65-V to 5.5-V V_CC operation.

The SN74LVC1G139 2-line to 4-line decoder is designed to be used in high-performance memory-decoding or data-routing applications requiring very short propagation delay times. In high-performance memory systems, this decoder can be used to minimize the effects of system decoding. When used with high-speed memories using a fast enable circuit, the delay times of these decoders and the enable time of the memory usually are less than the typical access time of the memory. This means that the effective system delay introduced by the decoder is negligible.

NanoStar and NanoFree package technology is a major breakthrough in device packaging concepts, using the die as the package.

This device is fully specified for partial-power-down applications using I_off. The I_off circuitry disables the outputs, preventing damaging current backflow through the device when it is powered down.

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*	Datenblatt	SN74LVC1G139 2-to-4 Line Decoder datasheet (Rev. E)	PDF \| HTML		09.01.2018

Design und Entwicklung

Weitere Bedingungen oder erforderliche Ressourcen enthält gegebenenfalls die Detailseite, die Sie durch Klicken auf einen der unten stehenden Titel erreichen.

Evaluierungsplatine

5-8-LOGIC-EVM — Generisches Logik-Evaluierungsmodul für 5- bis 8-polige DCK-, DCT-, DCU-, DRL- und DBV-Gehäuse

Flexibles EVM zur Unterstützung aller Geräte mit 5- bis 8-poligem DCK-, DCT-, DCU-, DRL- oder DBV-Gehäuse.

Benutzerhandbuch: PDF

Unterstützte Produkte und Hardware

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Referenzdesign

TIDA-01565 — Referenzdesign für drahtgebundene ODER MUX- und PGA-Lösungen

Diese Platine zeigt einen kabelgebundenen OR-Multiplexer (MUX) und eine programmierbare Verstärkeranwendung (PGA) des OPA837-Operationsverstärkers. Diese Anwendungen werden durch den Hochimpedanzausgang des Verstärkers und den invertierenden Hochimpedanzeingang im Abschaltmodus (PD-Modus) (...)

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Gehäuse	Pins	CAD-Symbole, Footprints und 3D-Modelle
SSOP (DCT)	8	Ultra Librarian
VSSOP (DCU)	8	Ultra Librarian
DSBGA (YZP)	8	Ultra Librarian

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