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SN74LVC1G02

AKTIV

Einfaches NOR-Gatter mit 2 Eingängen, 1,65 bis 5,5 V

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Datenblatt

SN74LVC1G02

AKTIV
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Produktdetails

Technology family LVC Number of channels 1 Inputs per channel 2 IOL (max) (mA) 32 IOH (max) (mA) -32 Output type Push-Pull Input type Standard CMOS Features Over-voltage tolerant Inputs, Partial power down (Ioff), Ultra high speed (tpd <5ns) Data rate (max) (Mbps) 100 Rating Catalog Operating temperature range (°C) -40 to 125
Technology family LVC Number of channels 1 Inputs per channel 2 IOL (max) (mA) 32 IOH (max) (mA) -32 Output type Push-Pull Input type Standard CMOS Features Over-voltage tolerant Inputs, Partial power down (Ioff), Ultra high speed (tpd <5ns) Data rate (max) (Mbps) 100 Rating Catalog Operating temperature range (°C) -40 to 125
USON (DRY) 6 1.45 mm² (1.45 mm × 1 mm) X2SON (DPW) 5 0.64 mm² (0.8 mm × 0.8 mm) SOT-SC70 (DCK) 5 4.2 mm² (2 mm × 2.1 mm) SOT-23 (DBV) 5 8.12 mm² (2.9 mm × 2.8 mm) X2SON (DSF) 6 1 mm² (1 mm × 1 mm) SOT-5X3 (DRL) 5 2.56 mm² (1.6 mm × 1.6 mm) DSBGA (YZP) 5 2.1875 mm² (— mm × — mm)
  • Available in the Ultra-Small 0.64 mm2
    Package (DPW) with 0.5-mm Pitch
  • Supports 5-V VCC Operation
  • Inputs Accept Voltages to 5.5 V
  • Provides Down Translation to VCC
  • Max tpd of 3.6 ns at 3.3 V
  • Low Power Consumption, 10-μA Max ICC
  • ±24-mA Output Drive at 3.3 V
  • Ioff Supports Live Insertion, Partial-Power-Down Mode, and Back-Drive Protection
  • Latch-Up Performance Exceeds 100 mA
    Per JESD 78, Class II
  • ESD Protection Exceeds JESD 22
    • 2000-V Human-Body Model (A114-A)
    • 200-V Machine Model (A115-A)
    • 1000-V Charged-Device Model (C101)
  • Available in the Ultra-Small 0.64 mm2
    Package (DPW) with 0.5-mm Pitch
  • Supports 5-V VCC Operation
  • Inputs Accept Voltages to 5.5 V
  • Provides Down Translation to VCC
  • Max tpd of 3.6 ns at 3.3 V
  • Low Power Consumption, 10-μA Max ICC
  • ±24-mA Output Drive at 3.3 V
  • Ioff Supports Live Insertion, Partial-Power-Down Mode, and Back-Drive Protection
  • Latch-Up Performance Exceeds 100 mA
    Per JESD 78, Class II
  • ESD Protection Exceeds JESD 22
    • 2000-V Human-Body Model (A114-A)
    • 200-V Machine Model (A115-A)
    • 1000-V Charged-Device Model (C101)

This single 2-input positive-NOR gate is designed for 1.65-V to 5.5-V VCC operation.

The SN74LVC1G02 performs the Boolean function
Y = A + B or Y = A • B in positive logic.

The CMOS device has high output drive while maintaining low static power dissipation over a broad VCC operating range.

The SN74LVC1G02 device is available in a variety of packages, including the ultra-small DPW package with a body size of 0.8 × 0.8 mm.

This single 2-input positive-NOR gate is designed for 1.65-V to 5.5-V VCC operation.

The SN74LVC1G02 performs the Boolean function
Y = A + B or Y = A • B in positive logic.

The CMOS device has high output drive while maintaining low static power dissipation over a broad VCC operating range.

The SN74LVC1G02 device is available in a variety of packages, including the ultra-small DPW package with a body size of 0.8 × 0.8 mm.
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Technische Dokumentation

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Top-Dokumentation Typ Titel Format-Optionen Neueste englische Version herunterladen Datum
* Datenblatt SN74LVC1G02 Single 2-Input Positive NOR-Gate datasheet (Rev. X) PDF | HTML 23.04.2014
Anwendungshinweis Designing and Manufacturing with TI's X2SON Packages 23.08.2017

Design und Entwicklung

Weitere Bedingungen oder erforderliche Ressourcen enthält gegebenenfalls die Detailseite, die Sie durch Klicken auf einen der unten stehenden Titel erreichen.

Evaluierungsplatine

5-8-LOGIC-EVM — Generisches Logik-Evaluierungsmodul für 5- bis 8-polige DCK-, DCT-, DCU-, DRL- und DBV-Gehäuse

Flexibles EVM zur Unterstützung aller Geräte mit 5- bis 8-poligem DCK-, DCT-, DCU-, DRL- oder DBV-Gehäuse.
Benutzerhandbuch: PDF
Unterstützte Produkte und Hardware
Vorrätig
Limit:
??asset.out-of-stock-ti_de_DE??
Nicht verfügbar
Evaluierungsplatine

5-8-NL-LOGIC-EVM — Generische Logik- und Übersetzungs-EVM mit Unterstützung von 5- bis 8-poligen DPW-, DQE-, DRY-, DSF-

Generisches EVM entwickelt zur Unterstützung sämtlicher Logik- und Übersetzungsbausteine, welche ein DTT-, DRY-, DPW-, DTM-, DQE-, DQM-, DSF- oder DTQ-Gehäuse aufweisen. Das Platinendesign ermöglicht eine flexible Evaluierung.

Benutzerhandbuch: PDF | HTML
Unterstützte Produkte und Hardware
Vorrätig
Limit:
??asset.out-of-stock-ti_de_DE??
Nicht verfügbar
Simulationsmodell

SN74LVC1G02 Behavioral SPICE Model

SCEM645.ZIP (7 KB) - PSpice-Modell
Unterstützte Produkte und Hardware
Simulationsmodell

SN74LVC1G02 IBIS Model (Rev. B)

SCEM166B.ZIP (44 KB) - IBIS-Modell
Unterstützte Produkte und Hardware
Referenzdesign

TIDA-01081 — Referenzdesign zur LED-Beleuchtungssteuerung für maschinelles Sehen

Dieses Referenzdesign für die Steuerung von LED-Beleuchtung demonstriert einen einzigartigen Ansatz zum Ansteuern und Regeln einer Kette aus mehreren leistungsstarken Leuchtdioden (LEDs). Dieses Referenzdesign ist für industrielle Systeme für maschinelles Sehen vorgesehen und eignet sich auch für (...)
Unterstützte Produkte und Hardware
Gehäuse Pins CAD-Symbole, Footprints und 3D-Modelle
USON (DRY) 6 Ultra Librarian
X2SON (DPW) 5 Ultra Librarian
SOT-SC70 (DCK) 5 Ultra Librarian
SOT-23 (DBV) 5 Ultra Librarian
X2SON (DSF) 6 Ultra Librarian
SOT-5X3 (DRL) 5 Ultra Librarian
DSBGA (YZP) 5 Ultra Librarian
Es gelten die allgemeinen Geschäftsbedingungen von TI für Evaluierungsartikel.

Bestellen & Qualität

Support und Schulungen

TI E2E™-Foren mit technischem Support von TI-Ingenieuren

Alle Forenthemen auf Englisch anzeigen

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