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Nicht invertierende Puffer & Treiber

SN74LV541A

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8-Kanal-Puffer, 2 bis 5,5 V mit Tri-State-Ausgängen

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SN74LV541A

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Produktdetails

Technology family LV-A Number of channels 8 IOL (max) (mA) 16 Supply current (max) (µA) 20 IOH (max) (mA) -16 Input type Standard CMOS Output type 3-State Features Balanced outputs, Over-voltage tolerant inputs, Partial power down (Ioff), Very high speed (tpd 5-10ns) Rating Catalog Operating temperature range (°C) -40 to 125
Technology family LV-A Number of channels 8 IOL (max) (mA) 16 Supply current (max) (µA) 20 IOH (max) (mA) -16 Input type Standard CMOS Output type 3-State Features Balanced outputs, Over-voltage tolerant inputs, Partial power down (Ioff), Very high speed (tpd 5-10ns) Rating Catalog Operating temperature range (°C) -40 to 125
VSSOP (DGS) 20 24.99 mm² (5.1 mm × 4.9 mm) VQFN (RGY) 20 15.75 mm² (4.5 mm × 3.5 mm) SOP (NS) 20 98.28 mm² (12.6 mm × 7.8 mm) TSSOP (PW) 20 41.6 mm² (6.5 mm × 6.4 mm) SOIC (DW) 20 131.84 mm² (12.8 mm × 10.3 mm) VQFN (RKS) 20 11.25 mm² (4.5 mm × 2.5 mm) SSOP (DB) 20 56.16 mm² (7.2 mm × 7.8 mm)
  • Operation of 2-V to 5.5-V V CC
  • Max t pd of 6 ns at 5 V
  • Typical V OLP (output ground bounce) < 0.8 V at V CC = 3.3 V, T A = 25°C
  • Typical V OHV (output V OH undershoot) > 2.3 V at V CC = 3.3 V, T A = 25°C
  • Support mixed-mode voltage operation on all ports
  • I off supports partial-power-down mode operation
  • Latch-up performance exceeds 250 mA per JESD 17
  • Operation of 2-V to 5.5-V V CC
  • Max t pd of 6 ns at 5 V
  • Typical V OLP (output ground bounce) < 0.8 V at V CC = 3.3 V, T A = 25°C
  • Typical V OHV (output V OH undershoot) > 2.3 V at V CC = 3.3 V, T A = 25°C
  • Support mixed-mode voltage operation on all ports
  • I off supports partial-power-down mode operation
  • Latch-up performance exceeds 250 mA per JESD 17

The SN74LV541A device is an octal buffer/driver designed for 2-V to 5.5-V V CC operation.

The SN74LV541A device is an octal buffer/driver designed for 2-V to 5.5-V V CC operation.
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Technische Dokumentation

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* Datenblatt SN74LV541A Octal Buffers/Drivers With 3-State Outputs datasheet (Rev. N) PDF | HTML 02.08.2023
Benutzerhandbuch TI Power Reference Design for Xilinx® Zynq 7000 (ZC702) (Rev. A) 16.12.2014
Prüfbericht TI Power Reference Design for Xilinx(R) Virtex(R)-7 (VC709) (Rev. A) 16.12.2014
Prüfbericht PMP7977 Test Results (Rev. A) 11.06.2014
Prüfbericht TI Power Reference Design for Xilinx® Artix®-7 (AC701) 12.05.2014
Benutzerhandbuch PMP7977 User's Guide 11.09.2013

Design und Entwicklung

Weitere Bedingungen oder erforderliche Ressourcen enthält gegebenenfalls die Detailseite, die Sie durch Klicken auf einen der unten stehenden Titel erreichen.

Evaluierungsplatine

14-24-LOGIC-EVM — Generisches Logikprodukt-Evaluierungsmodul für 14-polige bis 24-polige D-, DB-, DGV-, DW-, DYY-, NS-

Das 14-24-LOGIC-EVM-Evaluierungsmodul (EVM) ist für die Unterstützung aller Logikgeräte konzipiert, die sich in einem 14-Pin- bis 24-Pin-D-, DW-, DB-, NS-, PW-, DYY- oder DGV-Gehäuse befinden.

Benutzerhandbuch: PDF | HTML
Unterstützte Produkte und Hardware
Vorrätig
Limit:
??asset.out-of-stock-ti_de_DE??
Nicht verfügbar
Evaluierungsplatine

14-24-NL-LOGIC-EVM — Generisches Logikprodukt-Evaluierungsmodul für 14- bis 24-polige bleifreie Gehäuse

14-24-NL-LOGIC-EVM ist ein flexibles Evaluierungsmodul (EVM), das alle Logik- oder Übersetzungsbausteine mit einem 14- bis 24-poligen BQA-, BQB-, RGY-, RSV-, RJW- oder RHL-Gehäuse unterstützt.

Benutzerhandbuch: PDF | HTML
Unterstützte Produkte und Hardware
Vorrätig
Limit:
??asset.out-of-stock-ti_de_DE??
Nicht verfügbar
Simulationsmodell

HSPICE MODEL OF SN74LV541A

SCEJ189.ZIP (100 KB) - HSpice-Modell
Unterstützte Produkte und Hardware
Simulationsmodell

SN74LV541A Behavioral SPICE Model

SCEM649.ZIP (7 KB) - PSpice-Modell
Unterstützte Produkte und Hardware
Simulationsmodell

SN74LV541A IBIS Model

SCEM144.ZIP (18 KB) - IBIS-Modell
Unterstützte Produkte und Hardware
Referenzdesign

PMP7977 — Xilinx Artix 7 FPGA mit PMBus-Power-Management – Referenzdesign

The Artix 7 power management reference design board uses power modules, linear regulators, and a PMBus compliant system controller to supply all required core and auxiliary voltages needed by the FPGA, including DDR memory termination. A Digital Power graphical user interface is used to monitor the (...)

Unterstützte Produkte und Hardware
Gehäuse Pins CAD-Symbole, Footprints und 3D-Modelle
VSSOP (DGS) 20 Ultra Librarian
VQFN (RGY) 20 Ultra Librarian
SOP (NS) 20 Ultra Librarian
TSSOP (PW) 20 Ultra Librarian
SOIC (DW) 20 Ultra Librarian
VQFN (RKS) 20 Ultra Librarian
SSOP (DB) 20 Ultra Librarian
Es gelten die allgemeinen Geschäftsbedingungen von TI für Evaluierungsartikel.

Bestellen & Qualität

Support und Schulungen

TI E2E™-Foren mit technischem Support von TI-Ingenieuren

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Bei Fragen zu den Themen Qualität, Gehäuse oder Bestellung von TI-Produkten siehe TI-Support. ​​​​​​​​​​​​​​

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