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SN74AUP1G08

AKTIV

UND-Gatter (< 1uA) mit geringem Stromverbrauch, 1 Kanäle, 2 Eingänge, 0,8 V bis 3,6 V

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Datenblatt

SN74AUP1G08

AKTIV
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Produktdetails

Technology family AUP Number of channels 1 Inputs per channel 2 IOL (max) (mA) 4 IOH (max) (mA) -4 Input type Standard CMOS Output type Push-Pull Features Over-voltage tolerant inputs, Partial power down (Ioff), Very high speed (tpd 5-10ns) Data rate (max) (Mbps) 100 Rating Catalog Operating temperature range (°C) -40 to 85
Technology family AUP Number of channels 1 Inputs per channel 2 IOL (max) (mA) 4 IOH (max) (mA) -4 Input type Standard CMOS Output type Push-Pull Features Over-voltage tolerant inputs, Partial power down (Ioff), Very high speed (tpd 5-10ns) Data rate (max) (Mbps) 100 Rating Catalog Operating temperature range (°C) -40 to 85
SOT-23 (DBV) 5 8.12 mm² (2.9 mm × 2.8 mm) X2SON (DSF) 6 1 mm² (1 mm × 1 mm) SOT-SC70 (DCK) 5 4.2 mm² (2 mm × 2.1 mm) USON (DRY) 6 1.45 mm² (1.45 mm × 1 mm) X2SON (DPW) 5 0.64 mm² (0.8 mm × 0.8 mm) DSBGA (YFP) 6 1.4000000000000001 mm² (— mm × — mm) DSBGA (YZP) 5 2.1875 mm² (— mm × — mm) SOT-5X3 (DRL) 5 2.56 mm² (1.6 mm × 1.6 mm)
  • Available in the Ultra Small 0.64mm2 Package (DPW) With 0.5mm Pitch
  • Low Static-Power Consumption: ICC = 0.9µA Maximum
  • Low Dynamic-Power Consumption: Cpd = 4.3pF Typical at 3.3V
  • Low Input Capacitance: Ci = 1.5pF Typical
  • Low Noise: Overshoot and Undershoot <10% of VCC
  • Ioff Supports Live Insertion, Partial-Power-Down Mode, and Back Drive Protection
  • Schmitt-Trigger Action Allows Slow Input Transition and Better Switching Noise Immunity at the Input (Vhys = 250 mV Typical at 3.3V)
  • Wide Operating VCC Range of 0.8V to 3.6V
  • Optimized for 3.3V Operation
  • 3.6V I/O Tolerant to Support Mixed-Mode Signal Operation
  • tpd = 4.3ns Maximum at 3.3V
  • Suitable for Point-to-Point Applications
  • Latch-Up Performance Exceeds 100mA Per JESD 78, Class II
  • ESD Performance Tested Per JESD 22
    • 2000V Human-Body Model (A114-B, Class II)
    • 1000V Charged-Device Model (C101)
  • Available in the Ultra Small 0.64mm2 Package (DPW) With 0.5mm Pitch
  • Low Static-Power Consumption: ICC = 0.9µA Maximum
  • Low Dynamic-Power Consumption: Cpd = 4.3pF Typical at 3.3V
  • Low Input Capacitance: Ci = 1.5pF Typical
  • Low Noise: Overshoot and Undershoot <10% of VCC
  • Ioff Supports Live Insertion, Partial-Power-Down Mode, and Back Drive Protection
  • Schmitt-Trigger Action Allows Slow Input Transition and Better Switching Noise Immunity at the Input (Vhys = 250 mV Typical at 3.3V)
  • Wide Operating VCC Range of 0.8V to 3.6V
  • Optimized for 3.3V Operation
  • 3.6V I/O Tolerant to Support Mixed-Mode Signal Operation
  • tpd = 4.3ns Maximum at 3.3V
  • Suitable for Point-to-Point Applications
  • Latch-Up Performance Exceeds 100mA Per JESD 78, Class II
  • ESD Performance Tested Per JESD 22
    • 2000V Human-Body Model (A114-B, Class II)
    • 1000V Charged-Device Model (C101)

This single 2-input positive-AND gate is designed for 0.8V to 3.6V VCC operation and performs the Boolean function Y = A • B or Y = /A + /B in positive logic.

This single 2-input positive-AND gate is designed for 0.8V to 3.6V VCC operation and performs the Boolean function Y = A • B or Y = /A + /B in positive logic.
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Technische Dokumentation

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Top-Dokumentation Typ Titel Format-Optionen Neueste englische Version herunterladen Datum
* Datenblatt SN74AUP1G08 Low-Power Single 2-Input Positive-AND Gate datasheet (Rev. Q) PDF | HTML 01.03.2024
Application brief Understanding Schmitt Triggers (Rev. B) PDF | HTML 17.04.2025
Application brief Optimizing Industrial Robot CPU Boards with Logic and Voltage Translation PDF | HTML 12.12.2022
Application brief Optimizing WLAN and WiFi Access Point Systems With Logic and Voltage Translation PDF | HTML 03.11.2022
Anwendungshinweis Designing and Manufacturing with TI's X2SON Packages 23.08.2017

Design und Entwicklung

Weitere Bedingungen oder erforderliche Ressourcen enthält gegebenenfalls die Detailseite, die Sie durch Klicken auf einen der unten stehenden Titel erreichen.

Evaluierungsplatine

5-8-LOGIC-EVM — Generisches Logik-Evaluierungsmodul für 5- bis 8-polige DCK-, DCT-, DCU-, DRL- und DBV-Gehäuse

Flexibles EVM zur Unterstützung aller Geräte mit 5- bis 8-poligem DCK-, DCT-, DCU-, DRL- oder DBV-Gehäuse.
Benutzerhandbuch: PDF
Unterstützte Produkte und Hardware
Vorrätig
Limit:
??asset.out-of-stock-ti_de_DE??
Nicht verfügbar
Evaluierungsplatine

5-8-NL-LOGIC-EVM — Generische Logik- und Übersetzungs-EVM mit Unterstützung von 5- bis 8-poligen DPW-, DQE-, DRY-, DSF-

Generisches EVM entwickelt zur Unterstützung sämtlicher Logik- und Übersetzungsbausteine, welche ein DTT-, DRY-, DPW-, DTM-, DQE-, DQM-, DSF- oder DTQ-Gehäuse aufweisen. Das Platinendesign ermöglicht eine flexible Evaluierung.

Benutzerhandbuch: PDF | HTML
Unterstützte Produkte und Hardware
Vorrätig
Limit:
??asset.out-of-stock-ti_de_DE??
Nicht verfügbar
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SN74AUP1G08 Behavioral SPICE Model

SCEM690.ZIP (7 KB) - PSpice-Modell
Unterstützte Produkte und Hardware
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SN74AUP1G08 IBIS Model (Rev. A)

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Gehäuse Pins CAD-Symbole, Footprints und 3D-Modelle
SOT-23 (DBV) 5 Ultra Librarian
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SOT-5X3 (DRL) 5 Ultra Librarian
Es gelten die allgemeinen Geschäftsbedingungen von TI für Evaluierungsartikel.

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