DAC38RF83

AKTIV

Zweikanaliger Digital-Analog-Wandler (DAC), 14 Bit, 9 GSPS, 6–24x interpolierend, GSM-PLL mit 6 & 9 

Produktdetails

Resolution (Bits) 14 Number of DAC channels 2 Interface type JESD204B Sample/update rate (Msps) 9000 Features Ultra High Speed Rating Catalog Interpolation 10x, 12x, 16x, 18x, 20x, 24x, 6x, 8x Power consumption (typ) (mW) 3800 SFDR (dB) 97 Architecture Current Source Operating temperature range (°C) -40 to 85 Reference type Ext, Int
Resolution (Bits) 14 Number of DAC channels 2 Interface type JESD204B Sample/update rate (Msps) 9000 Features Ultra High Speed Rating Catalog Interpolation 10x, 12x, 16x, 18x, 20x, 24x, 6x, 8x Power consumption (typ) (mW) 3800 SFDR (dB) 97 Architecture Current Source Operating temperature range (°C) -40 to 85 Reference type Ext, Int
FCCSP (AAV) 144 100 mm² (10 mm × 10 mm)
  • 14-bit resolution
  • Maximum DAC sample rate: 9 GSPS
  • Key Specifications:
    • RF full-scale output power at 2.1 GHz:
      • DAC38RF80/90/84: 0 dBm
      • DAC38RF83/93/85: 3 dBm (with 2:1 balun)
    • Spectral performance(on-chip PLL, DIFF):
      • fDAC = 5898.24 MSPS, fOUT = 2.14 GHz
        • WCDMA ACLR: 75 dBc
        • WCDMA alt-ACLR: 77 dBc
      • fDAC = 8847.36 MSPS, fOUT = 3.7 GHz
        • 20 MHz LTE ACLR: 63 dBc
      • fDAC = 9 GSPS, fOUT = 1.8 GHz
        • IMD3 = 70 dBc (–6 dBFS, 10-MHz tone spacing)
        • NSD = –157 dBc/Hz
  • Dual-band digital up-converter per DAC
    • 6, 8, 10, 12, 16, 18, 20 or 24x interpolation
    • 4 Independent NCOs with 48-bit resolution
  • JESD204B Interface, subclass 1
    • Support for multichip synchronization
    • Maximum lane rate: 12.5 Gbps
  • Single-ended output with integrated balun (DAC38RF80/90/84) covering 700 MHz to 3800 MHz
  • Internal PLL and VCO with bypass
    • fC(VCO) = 5.9 or 8.9 GHz
  • Power dissipation: 1.4 to 2.2 W/ch
  • Power supplies: –1.8 V, 1 V, 1.8 V
  • Package: 10 x 10 mm BGA, 0.8 mm pitch, 144-balls
  • 14-bit resolution
  • Maximum DAC sample rate: 9 GSPS
  • Key Specifications:
    • RF full-scale output power at 2.1 GHz:
      • DAC38RF80/90/84: 0 dBm
      • DAC38RF83/93/85: 3 dBm (with 2:1 balun)
    • Spectral performance(on-chip PLL, DIFF):
      • fDAC = 5898.24 MSPS, fOUT = 2.14 GHz
        • WCDMA ACLR: 75 dBc
        • WCDMA alt-ACLR: 77 dBc
      • fDAC = 8847.36 MSPS, fOUT = 3.7 GHz
        • 20 MHz LTE ACLR: 63 dBc
      • fDAC = 9 GSPS, fOUT = 1.8 GHz
        • IMD3 = 70 dBc (–6 dBFS, 10-MHz tone spacing)
        • NSD = –157 dBc/Hz
  • Dual-band digital up-converter per DAC
    • 6, 8, 10, 12, 16, 18, 20 or 24x interpolation
    • 4 Independent NCOs with 48-bit resolution
  • JESD204B Interface, subclass 1
    • Support for multichip synchronization
    • Maximum lane rate: 12.5 Gbps
  • Single-ended output with integrated balun (DAC38RF80/90/84) covering 700 MHz to 3800 MHz
  • Internal PLL and VCO with bypass
    • fC(VCO) = 5.9 or 8.9 GHz
  • Power dissipation: 1.4 to 2.2 W/ch
  • Power supplies: –1.8 V, 1 V, 1.8 V
  • Package: 10 x 10 mm BGA, 0.8 mm pitch, 144-balls

The DAC38RFxx is a family of high-performance, dual/single-channel, 14-bit, 9-GSPS, RF-sampling digital-to-analog converters (DACs) that are capable of synthesizing wideband signals from 0 to 4.5 GHz. A high dynamic range allows the DAC38RFxx family to generate signals for a wide range of applications including 3G/4G signals for wireless base-stations and radar.

The devices feature a low-power JESD204B Interface with up to 8 lanes with a maximum bit rate of 12.5 Gbps allowing an input data rate of 1.25 GSPS complex per channel. The DAC38RFxx provides two digital up-converters per channel, with multiple options for interpolation rates. A digital quadrature modulator with independent, frequency flexible NCOs are available to support multi-band operation. An optional low-jitter PLL/VCO simplifies the DAC sampling clock generation by allowing use of a lower frequency reference clock.

The DAC38RFxx is a family of high-performance, dual/single-channel, 14-bit, 9-GSPS, RF-sampling digital-to-analog converters (DACs) that are capable of synthesizing wideband signals from 0 to 4.5 GHz. A high dynamic range allows the DAC38RFxx family to generate signals for a wide range of applications including 3G/4G signals for wireless base-stations and radar.

The devices feature a low-power JESD204B Interface with up to 8 lanes with a maximum bit rate of 12.5 Gbps allowing an input data rate of 1.25 GSPS complex per channel. The DAC38RFxx provides two digital up-converters per channel, with multiple options for interpolation rates. A digital quadrature modulator with independent, frequency flexible NCOs are available to support multi-band operation. An optional low-jitter PLL/VCO simplifies the DAC sampling clock generation by allowing use of a lower frequency reference clock.

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Technische Dokumentation

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* Datenblatt DAC38RFxx Dual- or Single-Channel, Single-Ended or Differential Output, 14-Bit, 9-GSPS, RF-Sampling DAC With JESD204B Interface and On-Chip PLL datasheet (Rev. D) PDF | HTML 28.12.2023
Anwendungshinweis Impact of Power-Supply Noise on Phase Noise Performance of RF DACs 13.06.2018
Anwendungshinweis Eye Scan Testing with the DAC38RFxx 10.08.2017
Anwendungshinweis Quick-Start Methods in Simulating the DAC38RF8x Input/Output Buffer Information 02.08.2017
Anwendungshinweis DAC38RF8x Test Modes 25.07.2017
Technischer Artikel Digital signal processing in RF sampling DACs – part 2 PDF | HTML 04.04.2017
Technischer Artikel Digital signal processing in RF sampling DACs - part 1 PDF | HTML 13.02.2017
Anwendungshinweis Digital RF Power Control for Power Amplifer Protection in Wireless Base 06.02.2017
Anwendungshinweis RF Sampling DAC with 800 MHz of IBW LTE 28.10.2016
Designleitfaden Efficient Power Supply Scheme for RF-Sampling DAC Reference Design 22.08.2016

Design und Entwicklung

Weitere Bedingungen oder erforderliche Ressourcen enthält gegebenenfalls die Detailseite, die Sie durch Klicken auf einen der unten stehenden Titel erreichen.

Evaluierungsplatine

DAC38RF82EVM — DAC38RF82 – interpolierender PLL-DAC, 1x-24x, zwei Kanäle, 14 Bit, 9 GSPS, 6 & 9 GHz – Evaluierungsm

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Vorrätig
Limit:
??asset.out-of-stock-ti_de_DE??
Nicht verfügbar
Firmware

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SLAC779 — DAC38RF8x KCU105 Firmware

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Die JESD204 Rapid Design IP ist dazu entwickelt worden, FPGA-Technikern einen beschleunigten Weg zu einem funktionierenden JESD204-System zu ermöglichen. Diese IP ist derart ausgelegt worden, dass nachgelagerte digitale Verarbeitung und sonstige Anwendungslogik von den meisten leistungs- und (...)

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Simulationsmodell

DAC38RF80 IBIS Model

SLAM304.ZIP (70 KB) - IBIS-Modell
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Simulationsmodell

DAC38RF8x IBIS-AMI Model (Rev. A)

SLAM343A.ZIP (24658 KB) - IBIS-AMI-Modell
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Das Referenzdesign TIDA-01084 demonstriert die Verwendung eines DAC-Systems mit HF-Abtastung zur Generierung kontinuierlicher phasenausgerichteter Mehrton-Wellenformen. Mit vier unabhängigen 48-Bit-NCOs kann der DAC38RF83 mit 14 Bit und 9 GSPS vier CW-Töne erzeugen, die an beliebiger Stelle (...)

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Referenzdesign

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Gehäuse Pins CAD-Symbole, Footprints und 3D-Modelle
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Bestellen & Qualität

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